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公報発行日 2018年12月6
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【図1】半導体装置内部における過剰酸素の拡散について説明する断面模式図。
【図2】イオンの入射を説明する図。
【図3】本発明の一態様に係る半導体装置の一例を示す上面図および断面図。
【図4】本発明の一態様に係る半導体装置の作製方法の一例を示す断面図。
【図5】本発明の一態様に係る半導体装置の作製方法の一例を示す断面図。
【図6】本発明の一態様に係る半導体装置の作製方法の一例を示す断面図。
【図7】本発明の一態様に係る半導体装置の作製方法の一例を示す断面図。
【図8】本発明の一態様に係る半導体装置の作製方法の一例を示す断面図。
【図9】本発明の一態様に係る半導体装置の一例を示す上面図および断面図。
【図10】本発明の一態様に係る半導体装置の作製方法の一例を示す断面図。
【図11】本発明の一態様に係る半導体装置の作製方法の一例を示す断面図。
【図12】本発明の一態様に係る半導体装置の作製方法の一例を示す断面図。
【図13】本発明の一態様に係る半導体装置の作製方法の一例を示す断面図。
【図14】本発明の一態様に係る半導体装置の作製方法の一例を示す断面図。
【図15】本発明の一態様に係る半導体装置の一例を示す上面図および断面図。
【図16】本発明の一態様に係る半導体装置の作製方法の一例を示す断面図。
【図17】本発明の一態様に係る半導体装置の作製方法の一例を示す断面図。
【図18】本発明の一態様に係る半導体装置の作製方法の一例を示す断面図。
【図19】本発明の一態様に係る半導体装置の作製方法の一例を示す断面図。
【図20】本発明の一態様に係るCPUの一例を示すブロック図。
【図21】本発明の一態様に係る電子機器の一例を示す図。
【図22】TDSによる基板温度とイオン強度との関係を示す図。
【図23】リンイオン注入濃度と酸素放出量との関係を示す図。
【図24】エッチング深さと酸素放出量との関係を示す図。
【図25】TDSによる基板温度とイオン強度との関係を示す図。
【図26】本発明の一態様に係る半導体装置の一例を示す断面図。
【図27】半導体装置内部における酸素の拡散について説明する断面模式図。
【図28】本発明の一態様に係る半導体装置の作製方法の一例を示す断面図。
【図29】本発明の一態様に係る半導体装置の作製方法の一例を示す断面図。
【図30】本発明の一態様に係る半導体装置の作製方法の一例を示す断面図。
【図31】本発明の一態様に係る半導体装置の一例を示す回路図およびタイミングチャート。
【図32】本発明の一態様に係る半導体装置の一例を示すブロック図および回路図。
【図33】トランジスタのオフ電流を測定するための回路構成を説明する図。
【図34】トランジスタのオフ電流の温度特性。
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