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公報発行日 2017年4月19
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【図1】本開示の一実施形態による方法のフローチャートである。
【図2】図1の方法によってプログラミングされる単一レベルセルメモリに関する閾値電圧レベルのグラフである。
【図3】図1の方法によってプログラミングされる多重レベルセルメモリに関する閾値電圧レベルのグラフである。
【図4】本開示の別の実施形態による方法のフローチャートである。
【図5】図4の方法によってプログラミングされるメモリに関する閾値電圧レベルのグラフである。
【図6】本開示の別の実施形態による方法のフローチャートである。
【図7】本開示の一実施形態による電子システムの概略ブロック図である。
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