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公報発行日 2018年4月25
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【図1】本開示の幾つかの実施形態によるメモリ装置を含むコンピューティングシステム形態の装置のブロック図である。
【図2】本開示の幾つかの実施形態による検知回路に接続されたメモリアレイの一部の概略図を示す。
【図3】本開示の幾つかの実施形態による検知回路に接続されたメモリアレイの一部の概略図を示す。
【図4】本開示の幾つかの実施形態による極値を識別するための方法の一例を示す。
【図5】本開示の幾つかの実施形態による極値を識別するための方法の一例を示す。
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