特許 5725083 半導体装置

(19)【発行国】日本国特許庁(JP)

(12)【公報種別】特許公報(B2)

(11)【特許番号】5725083

(24)【登録日】2015年4月10日

(45)【発行日】2015年5月27日

(54)【発明の名称】半導体装置

(51)【国際特許分類】

   H01L 29/861 20060101AFI20150507BHJP

   H01L 29/868 20060101ALI20150507BHJP

   H01L 29/06 20060101ALI20150507BHJP

   H01L 29/41 20060101ALI20150507BHJP

   H01L 27/04 20060101ALI20150507BHJP

   H01L 29/78 20060101ALI20150507BHJP

【ＦＩ】

   H01L29/91 D

   H01L29/06 301G

   H01L29/06 301F

   H01L29/06 301V

   H01L29/91 J

   H01L29/44 Y

   H01L29/78 657D

【請求項の数】8

【全頁数】25

(21)【出願番号】特願2013-104959(P2013-104959)

(22)【出願日】2013年5月17日

(62)【分割の表示】特願2009-157894(P2009-157894)の分割

【原出願日】2009年7月2日

(65)【公開番号】特開2013-179342(P2013-179342A)

(43)【公開日】2013年9月9日

【審査請求日】2013年5月17日

(31)【優先権主張番号】特願2008-188613(P2008-188613)

(32)【優先日】2008年7月22日

(33)【優先権主張国】JP

(73)【特許権者】

【識別番号】000005234

【氏名又は名称】富士電機株式会社

(74)【代理人】

【識別番号】100150441

【弁理士】

【氏名又は名称】松本 洋一

(72)【発明者】

【氏名】河野 涼一

(72)【発明者】

【氏名】山崎 智幸

(72)【発明者】

【氏名】根本 道生

(72)【発明者】

【氏名】掛布 光泰

【審査官】 大橋 達也

(56)【参考文献】

【文献】 特開２０００−１８３３６６（ＪＰ，Ａ）

【文献】 特開平０８−３０６９３７（ＪＰ，Ａ）

【文献】 特開２００５−３４０５２８（ＪＰ，Ａ）

【文献】 特開２００７−０４２８３６（ＪＰ，Ａ）

【文献】 特開平０９−２４６５７０（ＪＰ，Ａ）

【文献】 特許第３４４４０８１（ＪＰ，Ｂ２）

【文献】 特開平０６−０９７４６９（ＪＰ，Ａ）

(58)【調査した分野】（Int.Cl.，ＤＢ名）

Ｈ０１Ｌ ２９／８６１

Ｈ０１Ｌ ２７／０４

Ｈ０１Ｌ ２９／０６

Ｈ０１Ｌ ２９／４１

Ｈ０１Ｌ ２９／７８

Ｈ０１Ｌ ２９／８６８

(57)【特許請求の範囲】

【請求項1】

第一導電型半導体基板と、
該半導体基板の一方の主面の表面層に形成される第２導電型のアノード拡散領域と、
前記アノード拡散領域の表面で該アノード拡散領域とオーミック接触するアノード電極と、を備え、
前記アノード拡散領域が、前記アノード電極と接触するアノード拡散接触部と、該アノード拡散接触部と同じ不純物濃度および同じ拡散深さを保ちつつ、前記アノード拡散接触部よりも外周方向に延在してなるアノード拡散外延部と、を有し、
該アノード拡散外延部の表面には、該アノード拡散外延部を被覆するとともに該アノード拡散外延部よりもさらに外周方向に延在し、前記アノード電極に隣接する絶縁膜が形成され、
該絶縁膜の外周端下部の前記半導体基板表面層には、前記半導体基板の表面部を挟んで前記アノード拡散外延部と離間するとともに、該アノード拡散外延部および前記アノード拡散領域を取り巻く環状の第２導電型ガードリングが形成され、
該ガードリングの表面に接するとともに前記絶縁膜の表面上で該絶縁膜の外周端よりも内周側に延在し、前記アノード拡散外延部よりも外周側で該アノード拡散外延部と離間するフィールドプレート電極が形成され、
該フィールドプレート電極と前記アノード電極に挟まれた開口部には前記絶縁膜が露出し、
前記アノード拡散外延部上部の前記絶縁膜の面積より、該絶縁膜上面に外延する部分の前記アノード電極の面積が小さく、
前記絶縁膜上面に外延する部分の前記アノード電極の外周方向への幅が、前記アノード拡散外延部上部における前記絶縁膜の外周方向への幅の二分の一以下であり、
前記アノード拡散領域と前記半導体基板とのｐｎ接合は、前記アノード拡散外延部の外周端で前記半導体基板の表面に湾曲して露出するとともに、前記開口部にて露出する絶縁膜に接することを特徴とする半導体装置。

【請求項2】

前記アノード電極と電気的に分離された環状のフローティングメタルを前記絶縁膜の表面に有することを特徴とする請求項１に記載の半導体装置。

【請求項3】

第一導電型半導体基板と、
該半導体基板の一方の主面の表面層に形成される第２導電型のアノード拡散領域と、
該アノード拡散領域の表面で該アノード拡散領域とオーミック接触するアノード電極と、
前記アノード拡散領域が前記アノード電極と接触するアノード拡散接触部と、
該アノード拡散接触部と同じ不純物濃度および同じ拡散深さを保ちつつ、前記アノード拡散領域が前記アノード拡散接触部よりも外周方向に延在してなるアノード拡散外延部と、
該アノード拡散外延部の表面に形成され、前記アノード拡散接触部よりも外周方向に延在し、前記アノード電極に隣接する第１の絶縁膜と、
該第１の絶縁膜を挟んで前記アノード電極と離間するように前記アノード拡散外延部の表面に形成され、該アノード拡散外延部の表面に接触し、前記アノード電極を取り巻く環状の第１金属膜と、
該第１金属膜に隣接し、前記アノード拡散外延部の表面に形成されるとともに該アノード拡散外延部よりもさらに外周方向に延在する第２の絶縁膜と、
該第２の絶縁膜の外周端下部の前記半導体基板表面層に形成され、前記半導体基板の表面部を挟んで前記アノード拡散外延部と離間するとともに、該アノード拡散外延部および前記アノード拡散領域を取り巻く環状の第２導電型ガードリングと、
該ガードリングの表面に形成され、該ガードリングと接触する浮遊電極と、を備え、
前記第１金属膜と前記アノード拡散外延部が接触する部分の外周方向の幅が、前記アノード拡散接触部端部から前記アノード拡散外延部端部までの幅の半分よりも長く、
前記第１金属膜は前記浮遊電極と離間し、
前記第１金属膜は、前記アノード拡散外延部の少なくとも内周側と接触していることを特徴とする半導体装置。

【請求項4】

前記第１金属膜の外周方向の幅Ｗ_FFMが１０μｍ以上であり、
前記アノード拡散領域の前記一方の主面上における幾何学的な重心から、前記アノード拡散領域の外周端が表す多角形の各辺に垂直に線を伸ばしたときの外周端までの距離のうち最短の距離をＷ_ACTとして、Ｗ_FFM／Ｗ_ACT≦０．３であることを特徴とする請求項３に記載の半導体装置。

【請求項5】

前記第１金属膜が前記アノード拡散外延部と接触する部分の外周方向の幅Ｗ_CNTが、前記第１金属膜の幅Ｗ_FFMから前記開口部の幅Ｗ_CNTを引いた値Ｗ_R以上であることを特徴とする請求項３または４に記載の半導体装置。

【請求項6】

前記アノード拡散外延部の下層であって、前記半導体基板と前記アノード拡散領域との間のｐｎ接合を含む近傍の領域に、少数キャリアのライフタイムを局所的に短くしたライフタイム制御領域を備えることを特徴とする請求項３〜５のいずれか一項に記載の半導体装置。

【請求項7】

第一導電型半導体基板と、
該半導体基板の一方の主面の表面層に形成される第２導電型のアノード拡散領域と、
前記アノード拡散領域の表面で該アノード拡散領域とオーミック接触するアノード電極と、
該アノード電極との接触部と同じ拡散深さで前記アノード拡散領域が前記接触部よりも外周方向に延在してなるアノード拡散外延部と、
該アノード拡散外延部の表面に形成され、前記アノード電極に隣接する第１の絶縁膜と、
該第１の絶縁膜の外周端に隣接し、前記アノード拡散外延部と接触するメタルフィールドプレートと、
該メタルフィールドプレートと外周方向に隣接し、前記アノード拡散外延部の表面に形成されるとともに該アノード拡散外延部よりもさらに外周方向に延在する第２の絶縁膜と、
該第２の絶縁膜の外周端下部の前記半導体基板表面層に形成され、前記半導体基板の表面部を挟んで前記アノード拡散外延部と離間するとともに、該アノード拡散外延部および前記アノード拡散領域を取り巻く環状の第２導電型ガードリングと、を備え、
前記アノード拡散外延部上部の前記第１の絶縁膜の面積より、該第１の絶縁膜上面に外延する部分の前記アノード電極の面積が小さく、
前記第１の絶縁膜上面に外延する部分の前記アノード電極の外周方向への幅が、前記アノード拡散外延部上部における前記第１の絶縁膜の外周方向への幅の二分の一以下であり、
前記アノード電極と電気的に分離された環状のフローティングメタルを前記第１の絶縁膜の表面に有することを特徴とする半導体装置。

【請求項8】

第一導電型半導体基板と、
該半導体基板の一方の主面の表面層に形成される第２導電型のアノード拡散領域と、
前記アノード拡散領域の表面で該アノード拡散領域とオーミック接触するアノード電極と、
該アノード電極との接触部と同じ拡散深さで前記アノード拡散領域が前記接触部よりも外周方向に延在してなるアノード拡散外延部と、
該アノード拡散外延部の表面に形成され、前記アノード電極に隣接する第１の絶縁膜と、
該第１の絶縁膜の外周端に隣接し、前記アノード拡散外延部と接触するメタルフィールドと、
該メタルフィールドプレートと外周方向に隣接し、前記アノード拡散外延部の表面に形成されるとともに該アノード拡散外延部よりもさらに外周方向に延在する第２の絶縁膜と、
該第２の絶縁膜の外周端下部の前記半導体基板表面層に形成され、前記半導体基板の表面部を挟んで前記アノード拡散外延部と離間するとともに、該アノード拡散外延部および前記アノード拡散領域を取り巻く環状の第２導電型ガードリングと、を備え、
前記アノード拡散外延部上部の前記第１の絶縁膜の面積より、該第１の絶縁膜上面に外延する部分の前記アノード電極の面積が小さく、
前記第１の絶縁膜上面に外延する部分の前記アノード電極の外周方向への幅が、前記アノード拡散外延部上部における前記第１の絶縁膜の外周方向への幅の二分の一以下であり、
前記第１の絶縁膜が前記アノード拡散外延部上で環状に開口されてなる開口部を１つ以上備え、
該開口部にて前記アノード拡散外延部と接触する金属膜をさらに備えることを特徴とする半導体装置。

【発明の詳細な説明】

【技術分野】

【0001】

この発明はパワーモジュール等に搭載されるパワーデバイスなどの半導体装置、特には逆回復耐量が要求される接合ダイオード構造を有する半導体装置に関する。

【背景技術】

【0002】

近年省エネルギー化の要求に対し、電力変換装置などに用いられるパワーモジュールの適用範囲が拡大している。これらパワーモジュールの構成は、たとえば、図１０に示すように、コンバータ部１００、ブレーキ部２００、インバータ部３００を備え、インバータ部３００ではＩＧＢＴ（Ｉｎｓｕｌａｔｅｄ Ｇａｔｅ Ｂｉｐｏｌａｒ Ｔｒａｎｓｉｓｔｏｒ）３０１とＦＷＤ（Ｆｒｅｅ Ｗｈｅｅｌｉｎｇ Ｄｉｏｄｅ）３０２が逆並列に接続される構成を有している。通常、インバータ部３００に用いられる前記ＦＷＤ３０２には順方向の通電状態から逆電圧阻止状態を回復する逆回復モードがある。この際、素子破壊が最も起こりやすいため、ＦＷＤ３０２には素子破壊を起こし難くする逆回復耐量が求められる。

【0003】

図１１に示す従来のＦＷＤの半導体基板の断面図を用い、前記逆回復モードにおける破壊が起きる過程を、内部キャリアの挙動を通して説明する。一般的なＦＷＤの構成として、ｎ型シリコン半導体基板（以降、ｎ型基板と略記する）１を使用し、一方の主表面にｐ型アノード拡散領域２を形成する。このｐ型アノード拡散領域２の表面にＡｌ−Ｓｉなどの合金からなるアノード電極３をオーミック接触させる。ｎ型基板１の裏面にはオーミック接触が可能な表面不純物濃度を有するｎ⁺拡散層４を形成し、Ｔｉ／Ｎｉ／Ａｕなどの積層金属膜からなるカソード電極５を形成する。また、ＦＷＤのアノード側の外周縁部の表面層には、素子耐圧を確保できるようにガードリング構造６−１、フィールドプレート構造、リサーフ構造などの電界緩和構造を含むエッジ耐圧領域６が設けられる。このエッジ耐圧領域６の内側のアノード拡散領域２は主電流が流れるので、活性領域７と称する。以下の説明では、エッジ耐圧領域６と活性領域７の境界はｐ型アノード拡散領域２の外周端１２とする。

【0004】

このような構成のＦＷＤを搭載したパワーモジュールの負荷は、一般的にモーターを代表とするインダクタンスであり、図１０に示すように各ＩＧＢＴのゲートのＯＮ／ＯＦＦに応じて、還流電流がＦＷＤにも流れる。初期状態としてＦＷＤは阻止状態であって逆バイアス状態である。還流電流が流れる際は、まず、前述のような構成を有するＦＷＤが順バイアスされる。図１１に戻って説明を続けると、順バイアスされてＦＷＤ内のｐ型アノード拡散領域２内の正孔の電位がｐｎ接合の拡散電位（内部電位）を超えると、ｐ型アノード拡散領域２から正孔がｎ^-層（ｎ型基板に同じ）１に少数キャリアとして注入される。その結果、ｎ^-層１には高注入される正孔キャリアの濃度に応じた電導度変調が生じて電子キャリア（多数キャリア）濃度が増加するので、よく知られたダイオードの順方向Ｉ−Ｖ曲線に見られるように、抵抗が激減して順方向電流が急激に増加する順方向特性を示す。次にＦＷＤが逆バイアスされると、ｎ^-層１に残存する、前記電導度変調によって生じた過剰な少数キャリア（正孔）、多数キャリア（電子）が再結合および掃き出し過程を経てｎ^-層１に空乏層が広がる。空乏層が広がりきると電圧阻止状態となる。この過程が逆回復と呼ばれる。この逆回復時の前述のキャリア掃き出し過程はマクロ的には逆回復電流と称され、逆バイアスにもかかわらず、過渡的な電流が流れる状態である。この逆回復電流は順から逆方向に移行する際の電流低減率が大きいほど、ピーク電流値が大きくなる（ハードリカバリーともいう）。しかも、この電流は、少数キャリア（正孔）が、逆バイアス時の負極側であるアノード電極から引き抜かれる（または掃き出される）際、逆バイアスの電界集中が起き易いｐ型アノード拡散領域の外周部の曲率部１３に集中するので、この部分で電流密度が高くなって破壊を引き起こす（特に前記順逆移行時の電流低減率が大きい時）ことが知られている。この現象はｐ型アノード拡散領域の外周部形状が曲率を有しているため、等電位線が密になり易いことと、一般的にＦＷＤで主電流の流れるｐ型アノード拡散領域を取り巻く周辺部の表面層に設けられるエッジ耐圧領域６下にも広がっている少数キャリアの引き抜き（掃き出し）がほとんどこの部分に集中するためである。

【0005】

前述のように、アノード拡散領域の外周部の曲率部からの少数キャリアの引き抜きを緩和して逆回復電流ピークを下げるために、アノード拡散領域の外周部の表面に絶縁膜を介してアノード電極を形成する（言い換えると、ｐ型アノード拡散領域と接触する有効なアノード電極を外周部から後退させる）と共に、その平面方向の挟持距離を少数キャリアの拡散長以上とする記述がある（特許文献１）。また、ｐ型アノード拡散領域２の外周部８に電流が集中し難いように、局所的にキャリアのライフタイムを短くするという構造が知られている（特許文献２）。

【0006】

この逆回復電流の大きさは、前述のように、ｎ^-層１のコレクタ側での過剰少数キャリアの蓄積量が大きい程大きく、また、逆回復電流が大きい程、ハードリカバリー波形になる傾向が強い。逆回復電流の波形がハードリカバリーとなると、飛躍逆電圧が高くなる。この飛躍逆電圧が高くなりすぎると、素子の逆電圧定格を超えて破壊に至ることがある。

【0007】

前述のｐ型アノード拡散領域２の外周部８の表面に絶縁膜９を挟んでアノード電極３を積層する部分を有するアノード電極の外周部構造の断面図が示されている（特許文献３、４）。

【先行技術文献】

【特許文献】

【0008】

【特許文献1】特許第３４４４０８１号公報

【特許文献2】特開２００５−３４０５２８号公報

【特許文献3】特開平８−３０６９３７号公報

【特許文献4】特開２０００−１８３３６６号公報

【発明の概要】

【発明が解決しようとする課題】

【0009】

しかしながら、前記特許文献１に記載の構造のダイオード（ＦＷＤ）の場合、このダイオードの逆回復の際、ｐ型アノード拡散領域２の外周部８と、アノード電極３が接触している内側部分のｐ型アノード拡散領域２とでは電位差の発生することが問題となる。ｐ型アノード拡散領域２の外周部８上に絶縁膜９を介して形成される部分のアノード電極３は、絶縁膜９に何らかの欠陥でスルーホールが存在した場合や、部分的に絶縁膜９の厚さが薄いところがあると、絶縁破壊によりｐ型アノード拡散領域２の外周部８表面とアノード電極３とが短絡することがある。その場合、その短絡部分に、ダイオード内の外周（エッジ耐圧領域６）部分に広がっていた少数キャリアが集中するため、前記特許文献１に記載の逆回復電流のピークを緩和させる効果が充分でなくなり、素子破壊の惧れが再び高くなる。前述した絶縁膜９に生じる何らかの欠陥はウエハプロセス中に受けた異物や傷などに起因する。通常のウエハプロセスでは、このような欠陥の全く無い絶縁膜９を形成することは、通常、極めて困難と考えることの方が普通である。

【0010】

本発明は、以上説明したような点に鑑みてなされたものであり、本発明の目的は、ｐ型アノード拡散領域の外周部表面に絶縁膜を介してアノード電極が設けられる構造を有するｐｎ接合ダイオードであっても、該ダイオードを製造する際のウエハプロセスに起因する欠陥の有無に依らず、安定的に高い逆回復耐量を有する半導体装置を提供することである。

【課題を解決するための手段】

【0011】

前記本発明の目的を達成するために、
第一導電型半導体基板と、
該半導体基板の一方の主面の表面層に形成される第２導電型のアノード拡散領域と、
前記アノード拡散領域の表面で該アノード拡散領域とオーミック接触するアノード電極と、を備え、
前記アノード拡散領域が、前記アノード電極と接触するアノード拡散接触部と、該アノード拡散接触部と同じ不純物濃度および同じ拡散深さを保ちつつ、前記アノード拡散接触部よりも外周方向に延在してなるアノード拡散外延部と、を有し、
該アノード拡散外延部の表面には、該アノード拡散外延部を被覆するとともに該アノード拡散外延部よりもさらに外周方向に延在し、前記アノード電極に隣接する絶縁膜が形成され、
該絶縁膜の外周端下部の前記半導体基板表面層には、前記半導体基板の表面部を挟んで前記アノード拡散外延部と離間するとともに、該アノード拡散外延部および前記アノード拡散領域を取り巻く環状の第２導電型ガードリングが形成され、
該ガードリングの表面に接するとともに前記絶縁膜の表面上で該絶縁膜の外周端よりも内周側に延在し、前記アノード拡散外延部よりも外周側で該アノード拡散外延部と離間するフィールドプレート電極が形成され、
該フィールドプレート電極と前記アノード電極に挟まれた開口部には前記絶縁膜が露出し、
前記アノード拡散外延部上部の前記絶縁膜の面積より、該絶縁膜上面に外延する部分の前記アノード電極の面積が小さく、
前記絶縁膜上面に外延する部分の前記アノード電極の外周方向への幅が、前記アノード拡散外延部上部における前記絶縁膜の外周方向への幅の二分の一以下であり、
前記アノード拡散領域と前記半導体基板とのｐｎ接合は、前記アノード拡散外延部の外周端で前記半導体基板の表面に湾曲して露出するとともに、前記開口部にて露出する絶縁膜に接する半導体装置とする。

【0013】

前記アノード電極と電気的に分離された環状のフローティングメタルを前記絶縁膜の表面に有してもよい。
第一導電型半導体基板と、
該半導体基板の一方の主面の表面層に形成される第２導電型のアノード拡散領域と、
該アノード拡散領域の表面で該アノード拡散領域とオーミック接触するアノード電極と、
前記アノード拡散領域が前記アノード電極と接触するアノード拡散接触部と、
該アノード拡散接触部と同じ不純物濃度および同じ拡散深さを保ちつつ、前記アノード拡散領域が前記アノード拡散接触部よりも外周方向に延在してなるアノード拡散外延部と、
該アノード拡散外延部の表面に形成され、前記アノード拡散接触部よりも外周方向に延在し、前記アノード電極に隣接する第１の絶縁膜と、
該第１の絶縁膜を挟んで前記アノード電極と離間するように前記アノード拡散外延部の表面に形成され、該アノード拡散外延部の表面に接触し、前記アノード電極を取り巻く環状の第１金属膜と、
該第１金属膜に隣接し、前記アノード拡散外延部の表面に形成されるとともに該アノード拡散外延部よりもさらに外周方向に延在する第２の絶縁膜と、
該第２の絶縁膜の外周端下部の前記半導体基板表面層に形成され、前記半導体基板の表面部を挟んで前記アノード拡散外延部と離間するとともに、該アノード拡散外延部および前記アノード拡散領域を取り巻く環状の第２導電型ガードリングと、
該ガードリングの表面に形成され、該ガードリングと接触する浮遊電極と、を備え、
前記第１金属膜と前記アノード拡散外延部が接触する部分の外周方向の幅が、前記アノード拡散接触部端部から前記アノード拡散外延部端部までの幅の半分よりも長く、
前記第１金属膜は前記浮遊電極と離間し、
前記第１金属膜は、前記アノード拡散外延部の少なくとも内周側と接触している半導体装置とする。

【0014】

前記第１金属膜の外周方向の幅Ｗ_FFMが１０μｍ以上であり、
前記アノード拡散領域の前記一方の主面上における幾何学的な重心から、前記アノード拡散領域の外周端が表す多角形の各辺に垂直に線を伸ばしたときの外周端までの距離のうち最短の距離をＷ_ACTとして、Ｗ_FFM／Ｗ_ACT≦０．３であってもよい。

【0015】

前記第１金属膜が前記アノード拡散外延部と接触する部分の外周方向の幅Ｗ_CNTが、前記第１金属膜の幅Ｗ_FFMから前記開口部の幅Ｗ_CNTを引いた値Ｗ_R以上であってもよい。
前記アノード拡散外延部の下層であって、前記半導体基板と前記アノード拡散領域との間のｐｎ接合を含む近傍の領域に、少数キャリアのライフタイムを局所的に短くしたライフタイム制御領域を備えてもよい。

【0016】

第一導電型半導体基板と、
該半導体基板の一方の主面の表面層に形成される第２導電型のアノード拡散領域と、
前記アノード拡散領域の表面で該アノード拡散領域とオーミック接触するアノード電極と、
該アノード電極との接触部と同じ拡散深さで前記アノード拡散領域が前記接触部よりも外周方向に延在してなるアノード拡散外延部と、
該アノード拡散外延部の表面に形成され、前記アノード電極に隣接する第１の絶縁膜と、
該第１の絶縁膜の外周端に隣接し、前記アノード拡散外延部と接触するメタルフィールドプレートと、
該メタルフィールドプレートと外周方向に隣接し、前記アノード拡散外延部の表面に形成されるとともに該アノード拡散外延部よりもさらに外周方向に延在する第２の絶縁膜と、
該第２の絶縁膜の外周端下部の前記半導体基板表面層に形成され、前記半導体基板の表面部を挟んで前記アノード拡散外延部と離間するとともに、該アノード拡散外延部および前記アノード拡散領域を取り巻く環状の第２導電型ガードリングと、を備え、
前記アノード拡散外延部上部の前記第１の絶縁膜の面積より、該第１の絶縁膜上面に外延する部分の前記アノード電極の面積が小さく、
前記第１の絶縁膜上面に外延する部分の前記アノード電極の外周方向への幅が、前記アノード拡散外延部上部における前記第１の絶縁膜の外周方向への幅の二分の一以下であり、
前記アノード電極と電気的に分離された環状のフローティングメタルを前記第１の絶縁膜の表面に有する半導体装置とする。
また、第一導電型半導体基板と、
該半導体基板の一方の主面の表面層に形成される第２導電型のアノード拡散領域と、
前記アノード拡散領域の表面で該アノード拡散領域とオーミック接触するアノード電極と、
該アノード電極との接触部と同じ拡散深さで前記アノード拡散領域が前記接触部よりも外周方向に延在してなるアノード拡散外延部と、
該アノード拡散外延部の表面に形成され、前記アノード電極に隣接する第１の絶縁膜と、
該第１の絶縁膜の外周端に隣接し、前記アノード拡散外延部と接触するメタルフィールドと、
該メタルフィールドプレートと外周方向に隣接し、前記アノード拡散外延部の表面に形成されるとともに該アノード拡散外延部よりもさらに外周方向に延在する第２の絶縁膜と、
該第２の絶縁膜の外周端下部の前記半導体基板表面層に形成され、前記半導体基板の表面部を挟んで前記アノード拡散外延部と離間するとともに、該アノード拡散外延部および前記アノード拡散領域を取り巻く環状の第２導電型ガードリングと、を備え、
前記アノード拡散外延部上部の前記第１の絶縁膜の面積より、該第１の絶縁膜上面に外延する部分の前記アノード電極の面積が小さく、
前記第１の絶縁膜上面に外延する部分の前記アノード電極の外周方向への幅が、前記アノード拡散外延部上部における前記第１の絶縁膜の外周方向への幅の二分の一以下であり、
前記第１の絶縁膜が前記アノード拡散外延部上で環状に開口されてなる開口部を１つ以上備え、
該開口部にて前記アノード拡散外延部と接触する金属膜をさらに備える半導体装置とする。

【発明の効果】

【0018】

本発明によれば、ｐ型アノード拡散領域の外周部表面に絶縁膜を介してアノード電極が設けられる構造を有するｐｎ接合ダイオードであっても、該ダイオードを製造する際のウエハプロセスに起因する欠陥の有無に依らず、安定的に高い逆回復耐量を有する半導体装置を提供することができる。

【図面の簡単な説明】

【0019】

【図1】本発明の実施例１にかかるダイオードの要部斜視断面図である。

【図2】本発明の実施例２にかかるダイオードの要部断面図である。

【図3】本発明の実施例３にかかるダイオードの要部断面図である。

【図4】本発明の実施例４にかかるダイオードの要部断面図である。

【図5】本発明の実施例５にかかるダイオードの要部断面図である。

【図6】本発明の実施例６にかかるダイオードの要部断面図である。

【図7】本発明の実施例７にかかるダイオードの要部断面図である。

【図8】本発明の実施例８にかかるダイオードの要部断面図である。

【図9】本発明の実施例９にかかるダイオードの要部断面図である。

【図10】電力変換装置の主要部分の等価回路図である。

【図11】逆回復耐量を向上させた従来のダイオードの要部断面図である。

【図12】本発明の第１０の実施例を示す構成図で、（ａ）は要部斜視断面図および（ｂ）は平面図である。

【図13-1】本発明の第１０の実施例を示す要部断面図である。

【図13-2】本発明の第１０の実施例を示す要部断面図である。

【図13-3】本発明の第１０の実施例を示す要部断面図である。

【図14】本発明の第１０の実施例にかかる特性関係図である。

【図15】本発明の第１０の実施例にかかる特性関係図である。

【図16】本発明の第１０の実施例にかかる特性関係図である。

【図17】本発明の第１０の実施例における特性の関係を示す図であり、（ａ）は電流密度分布図、（ｂ）および（ｃ）は要部断面図である。

【図18】本発明の第１０の実施例の変形例を示す平面図である。

【発明を実施するための形態】

【0020】

以下、本発明の半導体装置について、図面を参照して詳細に説明する。本発明はその要旨を超えない限り、以下に説明する実施例の記載に限定されるものではない。
図１〜図９はそれぞれ番号順に対応する本発明の実施例１〜実施例９にかかるダイオードの要部斜視断面図または要部断面図である。図１０は電力変換装置を模式的に示す等価回路図である。図１１は逆回復耐量を向上させた従来のダイオードの要部斜視断面図である。

【実施例1】

【0021】

図１は、本発明の半導体装置の実施例１にかかるダイオード（ＦＷＤ）の要部斜視断面図である。一般的にＦＷＤではｎ型基板を使用し、一方の主面の表面層にｐ型アノード拡散領域２と、必要に応じて該ｐ型アノード拡散領域を取り巻く外周部に、前記ｐ型アノード拡散領域２と同時のプロセスによりガードリング６−１を形成する。このｐ型アノード拡散領域２の表面はオーミック接触が得られる程度の高濃度にされる。ｐ型アノード拡散領域２の表面にはＡｌ−Ｓｉ合金などを用いてアノード電極３（以下、の説明ではアノード電極の材料はＡｌ−Ｓｉ合金とする）が形成される。ｎ型基板の裏面にはオーミック接触が可能なようにｎ⁺拡散層４を形成した後、カソード電極５を形成する。カソード電極５としてはＴｉ／Ｎｉ／Ａｕの３層構造が一般的に用いられる。また、表面側のアノード電極３の周囲は、素子耐圧を確保できるように前記ガードリング構造やフィールドプレート構造が配置される。本実施例１ではｐ型アノード拡散領域２と同時形成のｐ拡散領域６−１をリング状に設けるガードリング構造を示しており、図１ではガードリング６−１を含む外周領域をエッジ耐圧領域６と記している。従来のダイオードの構造でも、アノード電極３のオーミック接触部の外周端より外側に位置するｐ型アノード拡散領域２の部分として定義される外周部８（以降、ｐ型アノード拡散領域２の外周部８と略記する）の表面では、絶縁膜９を介してアノード電極３を積層するように構成してｐ型アノード拡散領域２と電気的に分離することで、最も電界集中が置き易いｐ型アノード拡散領域２の外周部８の電流密度を減らして素子破壊を抑制することができる。

【0022】

しかしながら、前記アノード拡散領域２の外周部８において、絶縁膜９であるＰＳＧ（Ｐｈｏｓｐｈｏ Ｓｉｌｉｃａｔｅ Ｇｌａｓｓ）の欠陥が存在すると、絶縁不良により前記素子破壊の抑制効果が低下することが判明した。この素子破壊の抑制効果の低下を防ぐために、前記ＰＳＧ上のアノード電極の面積を減らすことにより、ＰＳＧにたとえ欠陥があっても、素子破壊が起きる確立を小さくして素子破壊を防止しようとすることが本発明の主眼とするところである。

【0023】

これは、絶縁膜９に何らかのプロセスに起因する欠陥があった場合でも、その欠陥部分でアノード電極３とｐ型アノード拡散領域２が短絡することを防ぐためである。ＰＳＧなどの絶縁膜９は一般にＣＶＤ（Ｃｈｅｍｉｃａｌ Ｖａｐｏｒ Ｄｅｐｏｓｉｔｉｏｎ）で成膜されるが、成膜処理を繰り返すと反応生成物が装置内に蓄積して、頻度は低いものの処理中のウエハにパーティクルとして付着してスルーホールなどの欠陥を生じることがある。特にチップサイズが大きい場合は、１チップあたりの欠陥存在確率が高くなり良品率が低下するなど問題となり易い。しかし、本発明によれば、このような場合でもアノード電極３の外周部８上の面積が小さくされた分、アノード電極３下の前記絶縁膜９に欠陥が存在する確立が小さくなるので、その分高い良品率で狙いどおりの電気的特性を得ることができる。

【0024】

具体的に説明すると、実施例１のアノード電極３は、ｐ型アノード拡散領域２の外周端１２の表面の絶縁膜９の外側にまで張り出させてメタルフィールドプレートとして機能させる場合である。この場合、通常は絶縁膜９上をシート状に覆うので、アノード電極３部分の面積は絶縁膜９の面積より大きくなる。このような場合、アノード電極３の面積を絶縁膜９の面積より小さくするには、図１に示すように、メタルフィールドプレート３−１の機能を有する張り出し電極部分と、その内周側のアノード電極３とを部分的に橋絡部３−２で接続する構成として、たとえば、表面から見て絶縁膜９上のアノード電極を中抜きするパターンに成形することにより、実質的にアノード電極３の面積を絶縁膜９の面積より小さくすることができる。この結果、アノード拡散領域２の表面上に絶縁膜９を介して形成されるアノード電極３部分の面積が実質的に少なくなり、アノード電極３下の絶縁膜９に欠陥が存在することによる短絡発生の確立が小さくなるので、良品率を高くすることができる。

【実施例2】

【0025】

図２は、本発明の半導体装置の実施例２にかかるダイオード（ＦＷＤ）の要部断面図である。実施例２のアノード電極３は、ｐ型アノード拡散領域２の外周端１２の上部に張り出させるメタルフィールドプレートを形成しない場合である。この場合、ｐ型アノード拡散領域２の外周部８の表面に絶縁膜９を介して形成されるアノード電極３部分をアノード電極３のオーミック接触部１０方向に極力後退させることで、アノード電極３下の絶縁膜９に欠陥が存在することによる短絡発生の確立を効果的に減少させることができる構造である。たとえば、アノード拡散領域２の外周部８の表面における絶縁膜９上のアノード電極を半減させると、欠陥にあたる確率は半分となり製品良品率が向上する。また、適用する製造プロセス上のデザインルールが許容できる、アノード電極３と絶縁膜９の重なり幅１４の最小値が、最大効果が得られる場合のアノード電極３となる。

【実施例3】

【0026】

図３は、本発明の半導体装置の実施例３にかかるダイオード（ＦＷＤ）の要部断面図である。実施例３は、前述の実施例１で説明したように、アノード拡散領域２の外周端１２の絶縁膜（ＰＳＧ）９上に設ける、エッジ耐圧領域６の電界緩和用メタルフィールドプレート３−１をアノード電極３と直接導電接続する必要がない場合の構造である。この場合のアノード電極３の構造は、絶縁膜（ＰＳＧ）９上を覆うメタルを極力減らすために、前記実施例２の図２と同様に、アノード電極３を後退させる構造とする。さらに、前記絶縁膜９上にアノード電極３とは直接的にメタルによっては接続されていないフィールドプレート機能を有する第一金属膜３−３を設ける。またさらに、この第一金属膜３−３をｐ型アノード拡散領域２表面にオーミック接触させるための開口部１５を絶縁膜９に設ける構造とする。この第一金属膜の材料としてはＡｌ−Ｓｉ合金が好ましい。この開口部１５により第一金属膜３−３の電位はアノード電極３の電位とアノード拡散領域２を介して実質的には同電位に近い電位とすることができフィールドプレートとしての有効な機能を備える。さらに、逆回復モード時には、ｐ型アノード拡散領域２の外周部８の面方向層抵抗（シート抵抗）による電位差により電界集中あるいは少数キャリアの引き抜きを抑制する効果を奏することができる。

【実施例4】

【0027】

図４は、本発明の半導体装置の実施例４にかかるダイオード（ＦＷＤ）の要部断面図である。この実施例４では、アノード電極３のｐ型アノード拡散領域２の表面へのオーミック接触部１０の外周端１１からｐ型アノード拡散領域２の外周端１２にかけてのアノード拡散領域２の外周部８における絶縁膜９上のアノード電極３の重なりを最小限にし、この外周部８の表面の絶縁膜９上に、アノード電極３とは電気的に分離されたフローティングメタル（環状の第二金属膜）１６を設けている。このフローティングメタル１６の目的は、このダイオードをパワーモジュールに組み立てた場合に、パワーモジュールを構成する材料などに起因する電荷が、絶縁膜９のみで覆われたｐ型アノード拡散領域２のシート抵抗に影響を及ぼすことを避けるためのシールド機能である。特にｐ型アノード拡散領域２の不純物濃度が低く、ｐ型アノード拡散領域２の表面が反転しやすい場合に有効となる。この場合、絶縁膜９に何らかの欠陥があってフローティングメタル１６とｐ型アノード拡散領域２表面との間に意図しない短絡部分があっても、フローティングメタル１６とアノード電極３とは電気的に分離されているため、良好な逆回復耐量が得られる。

【実施例5】

【0028】

図５は、本発明の半導体装置の実施例５にかかるダイオード（ＦＷＤ）の要部断面図である。この図５は前記実施例３で説明したｐ型アノード拡散領域２の外周部８の電位に固定されたメタルフィールドプレート（第一金属膜）３−３と、前記実施例４で説明したフローティングメタル１６を組み合わせた場合のダイオードである。ｐ型アノード拡散領域２の不純物濃度が低く、表面反転が起こりやすい構造で、かつｐ型アノード拡散領域２の外周端１２に、エッジ耐圧領域６のための電界緩和用メタルフィールドプレート構造が必要な場合に有効となる。

【実施例6】

【0029】

図６は、本発明の半導体装置の実施例６にかかるダイオード（ＦＷＤ）の要部断面図である。この図６に示すダイオードでは、実施例４と実施例５で用いた絶縁膜９上のフローティングメタル１６が何らかの原因でチャージアップした場合の特性変動を避けるための場合のダイオード構造である。このダイオードでは、実施例４のフローティングメタル１６と同様のシールド機能を有する環状の第三金属膜３−４を設け、さらに、ｐ型アノード拡散領域２の表面に開口部１５を介してオーミック接触させている。この場合でもこの環状の第三金属膜３−４はアノード電極３とは直接、電気的に接続されていないため、絶縁膜９の欠陥による影響を受け難い。

【実施例7】

【0030】

図７は、本発明の半導体装置の実施例７にかかるダイオード（ＦＷＤ）の要部断面図である。実施例７の図７に示すダイオードは、前記実施例３で説明したｐ型アノード拡散領域２の外周部８の電位に固定された環状のメタルフィールドプレート（第一金属膜）３−３と、前記実施例６で説明したｐ型アノード拡散領域２の外周部８の電位に固定された環状の第三金属膜３−４を組み合わせるだけでなく、さらに、環状の第三金属膜３−４を複数設けた構造を有するダイオードである。この構造のダイオードによると、逆回復時のｐ型アノード拡散領域２の電位に応じた電位がメタルフィールドプレート（第一金属膜）３−３、および複数の第三金属膜３−４に現れる。この実施例７では、アノード拡散領域２の外周部８の表面が概ねメタルに覆われることによりシールド効果が高くなるため、ｐ型アノード拡散領域２の濃度が低く、アノード表面が反転しやすい構造のダイオードに対して特に有効である。

【実施例8】

【0031】

図８は、本発明の半導体装置の実施例８にかかるダイオード（ＦＷＤ）の要部断面図である。ｐ型アノード拡散領域２と、絶縁膜９に形成される広い開口部１７面でオーミック接触する環状の第四金属膜３−５を有している。前記実施例６に示した環状の第三金属膜３−４のｐ型アノード拡散領域２の表面へのオーミック接触部となる開口部１５より外周方向の開口距離が大きく、面積も大きい。ｐ型アノード拡散領域２の外周端１２からアノード電極３へのオーミック接触部１０の外周端１１までの外周方向の距離（すなわち、ｐ型アノード拡散領域２の外周部８外周方向距離）をＬとすると、この広い開口部１７の外周方向の距離はＬ／２以上であることを特徴としている。

【0032】

その理由は、従来構造ではｐ型アノード拡散領域２に重なるアノード電極３の最大値を外周方向に向かってＬとすると、実施例８における環状の第四金属膜３−５のｐ型アノード拡散領域２の表面への広い開口部１７の外周方向の距離をＬ／２以上にすれば、ｐ型アノード拡散領域２上の絶縁膜９に重なる環状の第四金属膜３−５の外周方向の距離はＬ／２未満となる。その結果、環状の第四金属膜３−５に覆われた絶縁膜９部分の欠陥の存在確立に対するリスクを半分以下にすることができるからである。この実施例８の構造を有するダイオードでは、ｐ型アノード拡散領域２の外周部８のシート抵抗は、実際には環状の第四金属膜３−５を含めて考慮する必要があるので、シート抵抗が低下する。その結果、ＦＷＤは順方向動作時にｐ型アノード拡散領域２の外周部８からｎ^-層１へ注入されるホール密度が増加し、逆回復時にその部分の電界が高くなり逆回復電流ピークが高くなって破壊する惧れが高まる。その対策として、このｐ型アノード拡散領域２の外周部８に相当する箇所のｐｎ接合近傍部分に局所的にライフタイム制御を施すことでこの部分の破壊を抑制するという手段を併用することも好ましい。

【実施例9】

【0033】

図９は、本発明の半導体装置の実施例９にかかるダイオード（ＦＷＤ）の要部断面図である。この図９に示す実施例９のダイオードは、前記実施例８での環状の第四金属膜３−５と、前記実施例３の第一金属膜３−３を組み合わせた構造を有するダイオードである。ｐ型アノード拡散領域２の表面不純物濃度が低く、表面反転が起こりやすい場合にｐ型アノード拡散領域２の外周端１２上に第一金属膜３−３によるフィールドプレート構造を併用した例である。前記実施例８と同様に、絶縁膜９の欠陥の影響を受けにくく、かつエッジ耐圧領域６の電界緩和機能を維持した構造を実現することができる。図９には記載していないが、前記実施例８と同様に、ダイオードの順方向動作時にｐ型アノード拡散領域２の外周部８からｎ^-層１へ注入されるホール密度が増加し、逆回復時にはその部分の電界が高くなり逆回復電流ピークが高くなって破壊する惧れが高まる。そこで、電界集中の影響を受けにくくするために、ｐ型アノード拡散領域２の外周部８に相当する領域のｐｎ接合近傍部分に局所ライフタイム制御領域を設けることでこの部分の破壊を抑制するという手段を併用することができる。

【実施例10】

【0034】

図１２は、本発明の第１０の実施例の半導体装置の要部構成図で、（ａ）は要部斜視断面図、（ｂ）は平面図である。図１２（ａ）の要部斜視断面図は、前記実施例８である図８において記載している、局所的なライフタイム制御を施した部分を省略した構造と等価である。すなわち、ｐ型アノード拡散領域２と、絶縁膜９に形成される広い開口部１７でオーミック接触する環状の第四金属膜３−５を有している。もちろん前記局所ライフタイム制御を施しても構わない。さらに（a）の斜視断面図では、（ｂ）の平面図において、ｐ型アノード拡散領域２の表面（平面図（ｂ）の紙面表側）上における幾何学的な重心Ｏから、Ａの方向およびＢの方向に沿ってカットしたときの断面を示している。ここで幾何学的な重心とは、図形を一様の質量にて分布させたときの質量中心である。本発明の第１０の実施例はｐ−ｉ−ｎダイオードにて説明しているが、例えばこれをＩＧＢＴに用いることも容易であり、この場合、アノード電極３はエミッタ電極となる。このＩＧＢＴのような３端子素子の他にも、公知のデュアルゲートタイプのＩＧＢＴ、温度検出用ポリシリコンダイオード、ゲート制御用駆動回路などを、ＩＧＢＴ等と同一のチップ上に形成する場合がある。ｐ型アノード拡散領域２（ＩＧＢＴならばｐベース領域）は、できるだけ同領域の外周端２４のコーナー部における曲率を大きくして、ｎ^-ドリフト層１との接合に大きな逆バイアス電圧が印加されたときに、同コーナー部近傍への電界集中を緩和させる必要がある。そのため、可能な限り単純な形状、例えば長方形や正方形、円形、等が望ましい。従って以下では、重心といえば、ｐ型アノード拡散領域２の重心を意味する。本発明の実施例１０およびその変形例で言えば、例えば図１８に示すように、半導体チップの形状が概ね正方形の場合には、ｐ型アノード拡散領域２の重心は、２本の対角線が交差する位置Ｏとなる。

【0035】

重心Ｏから、前記ｐ型アノード拡散領域２の外周端２４が表す多角形の各辺に垂直に線を伸ばしたときの外周端までの距離のうち最短の距離をＷ_ACTと呼ぶことにする。例えば、図１２の平面図（ｂ）では、前記最短距離は重心Ｏから紙面に向かって左側にある点線２４の辺までの距離が、最短の距離Ｗ_ACTとなる。図１８についても同様である。

【0036】

本発明の第１０の実施例の製造方法について説明する。比抵抗が７０〜２５０Ωｃｍの範囲で、例えば１８０ΩｃｍのＦＺ-ｎ型シリコン基板の第一主面（表面）に、熱酸化膜を１１００℃で形成後、活性領域部分をパターニングおよびウェットエッチングにて開口し、残りの熱酸化膜をマスクとしてｐ型アノード拡散領域２とｐ型ガードリング６−１を硼素のイオン注入および熱拡散で形成する。例えばｐ型アノード拡散領域の構造は、表面濃度が５×１０¹⁶／ｃｍ³、表面からの拡散深さが４μｍである。ここで、外周部８は、ｐ型アノード拡散領域と同一のイオン注入および熱拡散で形成する。こうすることで、工程数を増やすことなくｐ型アノード拡散領域２の外周部８がつくれるので、コストの増加を抑えることができる。また、ｐ型ガードリング６−１は、ｐ型アノード拡散領域２とは別工程で、同層よりも濃度や拡散深さを大きくしてもよい。これは、逆バイアス時の電気的特性（耐圧、リーク電流等）を、より安定な値にすることができるためである。層間絶縁膜９（例えばＰＳＧ膜）を堆積し、パターニングおよびエッチングにて開口して、アルミニウム（シリコンを１％含有）をスパッタリングし、パターニングおよびエッチングを経てシンタリング（例えば４００℃）させて、下地のシリコン（本実施例ではｐ型アノード拡散領域、ｐ型ガードリング）とコンタクトさせる。その後、必要に応じて表面のエッジ耐圧領域６に、ポリイミド膜や絶縁性窒化シリコン膜等のパシベーション膜を形成する。続いて、表面もしくは裏面側から、電子線を１００ｋＧｙ、４．８ＭｅＶにて照射し、ｎ^-層１に点欠陥を生成させる。これは少数キャリアのライフタイムを減少させて逆回復電荷を減らし、逆回復過程を高速化するための工程であり、電子線照射後に３００〜４００℃の温度範囲、および１０分〜３時間程度の時間範囲で熱処理を行って点欠陥を所望の割合まで回復させて、ライフタイム値を制御する。続いて、ｎ型基板を裏面側から研削し、例えば最終の基板厚さ（表面と裏面間の最短距離）を１４０〜２３０μｍの範囲、例えば１７０μｍに仕上げて、裏面にリンをイオン注入し、同面をレーザーアニール、例えばＹＡＧ２ω（イットリウム・アルミニウム・ガーネット固体レーザーの第二高調波）にて注入したリンを活性化させて、ｎ⁺拡散層４を形成する。最後に裏面にアルミニウム、チタン、ニッケル、金の順で各金属膜をスパッタリングや蒸着にて形成し、所定の大きさにてチップ状にウェハーをダイシングする。このようにして、最終的に１７００Ｖ耐圧クラスのＦＷＤを製造する。ここで、ｎ型基板として、例えば２５０μｍ厚のウェハーの裏面側から、例えばｎ型不純物であるリンを、固体ソースを用いて１００μｍ深さまで拡散させて十分濃度の高いカソード層（ｎ⁺拡散層４）を形成させた、拡散ウェハーを用いても良く、この場合ｎ^-層１の厚さは、表面から１５０μｍとなる。

【0037】

図１３−１から図１３−３は、第１０の実施例における断面を示す図であり、前記ｐ型アノード拡散領域２の外周部８上の絶縁膜９に形成される開口部１７の幅Ｗ_CNTと、環状の第四金属膜３−５の環状の幅Ｗ_FFMとの相対関係を示す。前記環状の第四金属膜３−５において、前記アノード拡散領域２とオーミック接触していない部分の総幅Ｗ_Rは、Ｗ_R＝Ｗ_FFM−Ｗ_CNTとなる。図１３−１から図１３−３の各図における左端の部分は、図１２の斜視断面図（ａ）におけるＡ方向の半導体装置のチップ形状の端部であり、同右端は前述の重心Ｏである。

【0038】

図１３−１では、開口部１７の幅Ｗ_CNTは前記第四金属膜３−５の外周方向距離Ｗ_FFMとほぼ近い値であり、ｐ型アノード拡散領域２と広く接触している。図１３−２では、前記開口部１７の幅Ｗ_CNTは前記第四金属膜３−５の環状の幅Ｗ_FFMよりも小さく、かつ開口部１７は前記第四金属膜３−５内部の半導体装置内周側に設けられている。図１３−３は、同じく開口部１７が前記第四金属膜３−５内部の半導体装置外周側に設けられている。図１３−１、図１３−２、図１３−３のいずれの構成でも構わない。ただし、逆回復時におけるアノード電極３と前記第四金属膜３−５間の電位差は、アノード電極３と前記第四金属膜３−５間の距離の増加に対して大きくなる。よって望ましくは、この電位差が小さくなるように、前記第四金属膜３−５について、図１３−１に示す第四金属膜３−５内部のほぼ全面にてｐ型アノード拡散領域２とコンタクトさせるか、もしくは図１３−２のように半導体装置内周側にてコンタクトしている方がよい。

【0039】

本発明の半導体装置における順方向の電圧降下Ｖ_F（以下、単に順電圧と呼ぶ）は、ｐ型アノード拡散領域２の重心Ｏから前記ｐ型アノード拡散領域２の外周端２４が表す多角形の各辺に垂直に線を伸ばしたときの外周端までの距離のうち最短の距離Ｗ_ACTと、第四金属膜３−５の幅Ｗ_FFMとの相対関係、さらにはこれらＷ_ACTおよびＷ_FFMと第四金属膜３−５下の開口部１７の幅Ｗ_CNTとの相対関係に強く依存する。図１４は、本発明の半導体装置において、順方向電流密度が１５０Ａ／ｃｍ²における順電圧Ｖ_Fの、前記距離Ｗ_ACTに対するＷ_FFMの比α（α≡Ｗ_FFM／Ｗ_ACT）に対する依存性を示す、特性関係図（グラフ）である。ここで言う順方向電流密度とは、順方向に流れる電流を、半導体チップの表面の面積で割った、単位面積当たりの電流を示す。ここで、第四金属膜３−５の環状の幅Ｗ_FFMに対する開口部１７の幅Ｗ_CNTの割合β（β≡Ｗ_CNT／Ｗ_FFM）を導入しておく。図１４では、β＝０．５、すなわちＷ_CNTと前述のＷ_R（＝Ｗ_FFM−Ｗ_CNT）が等しい場合の特性を示す。本実施例では、Ｗ_FFM＝２６０μｍである。従ってα＝０．８７とはすなわちＷ_ACT＝３００μｍ、α＝０．３とはＷ_ACT＝８６７μｍであることを、それぞれ示している。図１４のグラフから、順電圧Ｖ_Fはαが増加すると増加し、α＞０．３で急激に増加して極めて大きい値となることがわかる。Ｗ_ACTの大小は活性部の面積（活性面積）の大小に影響するから、順電圧は、活性面積が小さくなるほどその値は大きくなることがわかる。ここで、これらのパラメータの寸法との対応について、αを表１に、およびβを表２にまとめている。例えば１７００Ｖクラスでは、第四金属膜の幅Ｗ_FFMの典型的な値の範囲は１５０〜４００μｍ程度であり、本実施例では２６０μｍである。

【0040】

【表1】

【0041】

【表2】

【0042】

さらに図１５に、同一のαに対して、各βにおける順電圧と、β＝０．０２、すなわちＷ_CNTが６μｍのときの順電圧との差分を△Ｖ_Fと定義して、△Ｖ_Fについてのα依存性をしめす。この図によると、α＝０．８７のとき、具体的にはＷ_ACTが第四金属膜３−５の環状の幅Ｗ_FFMと同じ長さ程度に十分小さいときは、βが１に近い値、つまり第四金属膜３−５下の開口部１７の幅Ｗ_CNTが同金属膜３−５の幅Ｗ_FFMに近いほど、順電圧差△Ｖ_Fが大きくなることが明らかになった。すなわち活性領域が狭いほど、第四金属膜３−５下部の静電ポテンシャル分布は活性領域の幅の影響を受けて変化し、その結果順電圧差△Ｖ_Fが変化するということである。この効果は、図１７に示すように、半導体デバイスシミュレーションにより得られた電流密度分布と等電位線分布の模式図を用いて説明できる。図１７は、半導体デバイスシミュレーションにより得られた電流密度分布と等電位線分布の模式図であり、（ｂ）の断面図と（ｃ）の断面図、および（ｂ）、（ｃ）図中の表面から深さ１０μｍにある×印の位置における電流密度分布図（ａ）からなる。（ｂ）の断面図は、β＝０．８８すなわちＷ_CNT＝２３０μｍの場合で、（ｃ）の断面図はβ＝０．０２すなわちＷ_CNT＝６μｍの場合に対応する。両断面図に、順方向導通時における１Ｖステップの４本の等電位線２３の分布を示す。（ｂ）の断面図のように、第四金属膜３−５下の開口部１７の幅Ｗ_CNTが十分大きいときは、導通時の開口部１７下（周辺部８）の電位（静電ポテンシャル）が、アノード電極よりも低い電位で広く固定される。そのためキャリア（電子、ホール）は、アノード電極３が前記アノード拡散領域２とオーミック接触をしている部分の外周端１１より外周部へ侵入することができなくなる。特にＷ_CNTが十分広くかつＷ_ACTが小さい場合（つまりαが小さい場合）、電流密度分布図（ａ）の（１）のように、Ｗ_CNTが十分狭い場合の（２）に比べて、電流経路の断面が狭くなり、その分だけ活性部分の電流密度が高くなる。その結果、（１）の順電圧降下が（２）の場合よりも高くなり、順電圧差△Ｖ_Fが発生する。一方、Ｗ_ACT（つまりα）が十分大きい場合は、Ｗ_CNTの影響は小さくなるため、電流密度分布図（ａ）の（３）もしくは（４）のように、活性領域の電流密度の差は無視できる程度に小さくなる。そのため、順電圧差△Ｖ_Fも十分小さくなる。

【0043】

図１６は、第１０の実施例における特性関係を示すグラフであり、図１５における順電圧差△Ｖ_Fの、第四金属膜３−５の環状の幅Ｗ_FFMに対する開口部１７の幅Ｗ_CNTの割合βの依存性を示すグラフである。各αの値別にプロットしている。αが０．３以上、つまり第四金属膜３−５の幅Ｗ_FFMがＷ_ACTの値に近くなると、順電圧差△Ｖ_Fは増加する。このとき、βが０．５以上、すなわち開口部１７の幅Ｗ_CNTが、前記第四金属膜３−５において前記アノード拡散領域２とオーミック接触していない部分の総幅Ｗ_Rよりも大きければ、順電圧差△Ｖ_Fはβによらずに安定していることがわかる。この効果についても、図１７を用いて説明できる。すなわち、図１７の断面図（ｂ）のように、第四金属膜３−５下の開口部１７の幅Ｗ_CNTがオーミック接触していない部分の総幅Ｗ_Rよりも十分大きいときは、導通時の開口部１７下（周辺部８）の静電ポテンシャルが、アノード電極よりも低い電位にて固定される幅を、大きくできる。そのために、開口部１７の幅Ｗ_CNTの変化に対しても、等電位線の分布が安定し、順電圧差△Ｖ_Fも安定する。このような順電圧差△Ｖ_Fの安定性は、半導体装置の製造プロセスにて発生するばらつき、例えばマスクパターニングにおける層間絶縁膜９と第四金属膜３−５間のアライメント誤差、開口部１７を形成するときのエッチング加工幅の精度、およびこれらのシリコンウェハ上の面内分布等の影響を受けないことを意味するため、本発明の実施例の特性安定上極めて重要な効果である。

【0044】

なお、Ｗ_FFMの最小幅については、１０μｍとするのがよい。これは、少数キャリアの拡散長は、前述のライフタイム制御を施す場合、およそ１μｍ程度となり、Ｗ_FFMがこの値より小さくなると、前述の静電ポテンシャルが固定される効果が無くなり、少数キャリアの外周端１１より外周部８への侵入を抑えることができなくなるからである。第四金属膜近傍の電位を広く固定して、安定的に少数のキャリアの外周部８への侵入を抑えるには、Ｗ_FFMは前記拡散長の１０倍以上あればよく、従ってＷ_FFMの最小幅を１０μｍ程度とすることが望ましい。

【0045】

以上の理由から、本発明の実施例１０においては、αは０．３以下であること、すなわち前記ｐ型アノード拡散領域の重心Ｏから、前記ｐ型アノード拡散領域の外周端２４が表す多角形の各辺に垂直に線を伸ばしたときの外周端２４までの距離のうち最短の距離Ｗ_ACTに対して、第四金属膜３−５の環状の幅Ｗ_FFMは、Ｗ_ACTの３０％以下の値であり、かつ同時に、βが０．５より高いこと、すなわち開口部１７の幅Ｗ_CNTが、前記第四金属膜３−５において前記アノード拡散領域２とオーミック接触していない部分の総幅Ｗ_Rよりも大きいとよい。

【0046】

また、本発明の第１０の実施例では、耐圧クラスを１７００Ｖとして説明してきた。本発明は、他の耐圧クラスでも容易に適用することができる。例えば６００Ｖクラスの場合は、シリコン半導体基板の比抵抗は１０〜５０Ωｃｍ程度、ｎ^-ドリフト層１の厚さは４０〜７０μｍ程度である。Ｗ_ACTは製品の定格電流密度の設定により変わるが、表１に記載の範囲と同様に、およそ３００〜１００００μｍ（＝１０ｍｍ）である。第四金属膜３−５の環状の幅Ｗ_FFMは、比抵抗が小さいことから、最小幅１０μｍ以上、典型的には５０〜２００μｍ程度となり、αは０．３以下が望ましいことはこれまでと同様である。従って開口部１７の幅を決めるβについても、０．５以上が望ましいことはこれまでと同様である。さらに１２００Ｖクラスについては、シリコン半導体基板の比抵抗は４０〜９０Ωｃｍ程度、ｎ^-ドリフト層１の厚さは１００〜１５０μｍ程度であり、第四金属膜３−５の環状の幅Ｗ_FFMは、１００〜３００μｍ程度となる。また３３００Ｖクラスについても、比抵抗は２００〜４００Ωｃｍ程度、ｎ^-ドリフト層１の厚さは２００〜４００μｍ程度であり、第四金属膜の環状の幅Ｗ_FFMは２００〜５００μｍ程度となる。上記のいずれの場合でも、αは０．３以下がよく、βは０．５以上であることがよい。

【0047】

以上説明した本発明の実施例１〜１０にかかる半導体装置によれば、絶縁膜にチップ製造上発生するプロセス欠陥があったとしても、逆回復破壊が起こりにくくなる。

【符号の説明】

【0048】

１ ｎ型半導体基板、ｎ型基板、ｎ^-層
２ ｐ型アノード拡散領域
３ アノード電極
３−１ メタルフィールドプレート
３−２ 橋絡部
３−３ メタルフィールドプレート（第一金属膜）
３−４ 環状の第三金属膜
３−５ 環状の第四金属膜
４ ｎ⁺拡散層
５ カソード電極
６ エッジ耐圧領域
７ 活性領域
８ 外周部
９ 絶縁膜
１０ アノード電極のオーミック接触部
１１ オーミック接触部の外周端
１２ ｐ型アノード拡散領域の外周端
１３ ｐ型アノード拡散領域の外周部の曲率部
１４ 重なり幅
１５ 開口部
１６ フローティングメタル（環状の第二金属膜）
１７ 広い開口部
１９ ダイオードチップ
２３ 等電位線
２４ ｐ型アノード拡散領域の外周端。

【図1】

【図2】

【図3】

【図4】

【図5】

【図6】

【図7】

【図8】

【図9】

【図10】

【図11】

【図12】

【図13-1】

【図13-2】

【図13-3】

【図14】

【図15】

【図16】

【図17】

【図18】