特許 5935135 低電力消費の弛張型オシレータ

(19)【発行国】日本国特許庁(JP)

(12)【公報種別】特許公報(B2)

(11)【特許番号】5935135

(24)【登録日】2016年5月20日

(45)【発行日】2016年6月15日

(54)【発明の名称】低電力消費の弛張型オシレータ

(51)【国際特許分類】

   H03K 7/08 20060101AFI20160602BHJP

   H03K 4/06 20060101ALI20160602BHJP

【ＦＩ】

   H03K7/08 G

   H03K4/06 066

【請求項の数】11

【全頁数】20

(21)【出願番号】特願2012-125197(P2012-125197)

(22)【出願日】2012年5月31日

(65)【公開番号】特開2013-128264(P2013-128264A)

(43)【公開日】2013年6月27日

【審査請求日】2015年4月3日

(31)【優先権主張番号】13/159,440

(32)【優先日】2011年6月14日

(33)【優先権主張国】US

(73)【特許権者】

【識別番号】504199127

【氏名又は名称】フリースケール セミコンダクター インコーポレイテッド

(74)【代理人】

【識別番号】100142907

【弁理士】

【氏名又は名称】本田 淳

(72)【発明者】

【氏名】サンジェイ ケイ．ワドゥワ

(72)【発明者】

【氏名】ディペンドラ ケイ．ジェイン

【審査官】 白井 亮

(56)【参考文献】

【文献】 実開平０４−０６９９２４（ＪＰ，Ｕ）

【文献】 特開平０９−３１２５５２（ＪＰ，Ａ）

【文献】 特開２００７−２４３９２２（ＪＰ，Ａ）

【文献】 特開平１１−２９８２９９（ＪＰ，Ａ）

【文献】 米国特許第０６０２０７９２（ＵＳ，Ａ）

(58)【調査した分野】（Int.Cl.，ＤＢ名）

Ｈ０３Ｋ ７／００−１１／００

Ｈ０３Ｋ ４／００−６／０４

(57)【特許請求の範囲】

【請求項1】

発振信号を生成するためのシステムにおいて、
ランプ電圧スイッチング信号に基づいて第１ランプおよび第２ランプ電圧を生成するランプ電圧生成回路と、
電圧源に接続され、少なくとも第１および第２基準電圧を生成する基準電圧生成回路と、
前記ランプ電圧生成回路および基準電圧生成回路に接続される基準電圧スイッチング回路であって、
前記ランプ電圧を受ける第１入力端子および少なくとも１つの基準電圧を受ける第２入力端子を有する少なくとも１つのコンパレータと、
前記少なくとも１つのコンパレータの出力端子に接続されて、基準電圧スイッチング信号、前記ランプ電圧スイッチング信号および前記発振信号を生成するデジタル論理回路と、
前記基準電圧生成回路と前記少なくとも１つのコンパレータの前記第２入力端子との間に接続され、前記基準電圧スイッチング信号に基づいて前記少なくとも１つのコンパレータの第２入力端子に前記少なくとも１つの基準電圧を与える少なくとも１つの基準電圧スイッチであって、前記基準電圧スイッチング信号、前記発振信号および前記ランプ電圧スイッチング信号は、前記ランプ電圧と前記少なくとも１つの基準電圧との間の所定の関係に基づいてトグルする、基準電圧スイッチとを備える、基準電圧スイッチング回路と、を備え、少なくとも１つの前記第１および第２ランプ電圧がそれぞれの第１および前記第２基準電圧と等しくなる時、前記基準電圧スイッチング信号、前記発振信号および前記ランプ電圧スイッチング信号をトグルする、発振信号を生成するためのシステム。

【請求項2】

前記所定の関係には、前記ランプ電圧が前記少なくとも１つの基準電圧と等しいことが含まれる、請求項１に記載のシステム。

【請求項3】

前記デジタル論理回路は、第１のセットおよび第２のセットの、２によって除算する２除算カウンタを備え、前記２除算カウンタの第１のセットおよび第２のセットの各々が、少なくとも２つの直列に接続される２除算カウンタを備え、２除算カウンタの第１のセットおよび第２のセットの出力端子はＸＯＲゲートの入力端子に接続され、前記ＸＯＲゲー
トが前記ランプ電圧スイッチング信号を生成する、請求項１に記載のシステム。

【請求項4】

前記２除算カウンタの前記第１のセットの前記少なくとも２つの直列に接続される２除算カウンタの第１の出力端子で前記基準電圧スイッチング信号および前記発振信号を取得される、請求項３に記載のシステム。

【請求項5】

前記基準電圧生成回路が、少なくとも１つの基準電圧を生成するバンドギャップ基準回路を備える、請求項１に記載のシステム。

【請求項6】

発振信号を生成するための弛張型オシレータにおいて、
ランプ電圧スイッチング信号に基づいて第１ランプおよび第２ランプ電圧を生成するランプ電圧生成回路と、
少なくとも第１および第２基準電圧を生成する基準電圧生成回路と、
前記ランプ電圧生成回路および前記基準電圧生成回路に接続される基準電圧スイッチング回路であって、
前記第１ランプ電圧を受ける負入力端子および前記第１基準電圧を受ける正入力端子を有する第１コンパレータと、
前記第２ランプ電圧を受ける負入力端子および前記第２基準電圧を受ける正入力端子を有する第２コンパレータと、
前記第１および第２コンパレータの出力端子に接続され、基準電圧スイッチング信号、前記ランプ電圧スイッチング信号および前記発振信号を生成するデジタル論理回路と、
前記基準電圧スイッチング信号に基づいてそれぞれの第１および第２基準電圧を前記第１および第２コンパレータの前記正端子に与えるための前記第１および前記第２コンパレータと前記基準電圧生成回路との間に接続される第１および第２基準電圧スイッチとを備える、基準電圧スイッチング回路と、
を備え、少なくとも１つの前記第１および第２ランプ電圧がそれぞれの第１および前記第２基準電圧と等しくなる時、前記基準電圧スイッチング信号、前記発振信号および前記ランプ電圧スイッチング信号をトグルする、弛張型オシレータ。

【請求項7】

前記デジタル論理回路は、
前記第１および前記第２コンパレータの前記出力端子に接続されるＡＮＤゲートと、
前記ＡＮＤゲートの出力端子に接続され、前記発振信号を生成する第１の２除算カウンタと、
前記第１の２除算カウンタに直列に接続され、前記ランプ電圧スイッチング信号を生成する第２の２除算カウンタと、
を備える、請求項６に記載の弛張型オシレータ。

【請求項8】

前記基準電圧スイッチング信号は前記発振信号を補うことによって取得される、請求項７に記載の弛張型オシレータ。

【請求項9】

前記基準電圧生成回路が、電圧源に接続されるレジスタラダーネットワークを備える、請求項６に記載の弛張型オシレータ。

【請求項10】

レジスタラダーネットワークが、少なくとも第１および第２基準電圧を生成する少なくとも第１および第２電圧タップを備える、請求項９に記載の弛張型オシレータ。

【請求項11】

前記基準電圧生成回路が、少なくとも第１および第２基準電圧を生成するバンドギャップ電圧基準回路を備える、請求項６に記載の弛張型オシレータ。

【発明の詳細な説明】

【技術分野】

【0001】

本発明は、概して弛張型オシレータに関する。より詳細には低電力オシレータに関するものである。

【背景技術】

【0002】

弛張型オシレータは、発振信号を生成するために、ラジオ、通信、コンピュータおよび他の電子システムなど、現在の電子システムに広く使用されている。発振信号は、通信システムでのメッセージ信号の変調および復調、電子回路の同期的動作などの、タイミングに厳しい要件を満たす必要がある。弛張型オシレータには、抵抗・キャパシタ（ＲＣ）回路がある。発振信号は、ＲＣ回路を介してキャパシタを充電および放電することによって生成される。発振信号の周波数は、ＲＣ回路の時間定数を変えることによって変化させる。例えば、発振信号の周波数を増加するために、レジスタの値が減少され得る。しかしながら、これがより高い電力消費を生じる。

【0003】

図１Ａを参照する。従来の弛張型オシレータ１００の概略図が示される。従来の弛張型オシレータ１００は、ランプ電圧生成回路１０２、基準電圧生成回路１０４、スイッチング信号生成回路１０６および発振信号生成回路１０８を含んでなる。ランプ電圧生成回路１０２は、充電レジスタ１１０（Ｒ_{ｃｈａｒｇｅ}）およびキャパシタ１１２ａ，１１２ｂ（それぞれＣ_１およびＣ_２）を含んでなる。基準電圧生成回路１０４は、レジスタ１１４ａ，１１４ｂ（それぞれＲ_１およびＲ_２）を含んでなる。スイッチング信号生成回路１０６は、コンパレータ１１６ａ，１１６ｂ、ＡＮＤゲート１１８および２によって除算する２除算カウンタ１２０を含む。発振信号生成回路１０８が、ＮＯＴゲート１２２ａ，１２２ｂを含む。

【0004】

充電レジスタ１１０は電圧源ＶＤＤに接続される。キャパシタ１２２ａは充電レジスタ１１０と接地との間に接続される。より具体的に、キャパシタ１２２ａの１つの端子はスイッチＤ２を介して充電レジスタ１１０に接続され、他の端子は接地に接続される。スイッチＳ１はキャパシタ１１２ａと並列に接続される。キャパシタ１１２ａの充電はスイッチＤ２を閉じて、スイッチＳ１を開けたままに維持することによって開始される。キャパシタ１１２ｂを充電および放電するために使用されるキャパシタ１１２ｂは、スイッチＤ１およびＤ２とキャパシタ１１２ａの構成と同様に、充電レジスタ１１０と接地との間に接続される。

【0005】

キャパシタ１１２ａ，１１２ｂもそれぞれのコンパレータ１１６ａ，１１６ｂの負端子に接続される。コンパレータ１１６ａおよび１１６ｂの正端子は、電圧タップＴ１で基準電圧生成回路１０４に接続される。電圧生成回路１０４のレジスタ１１４ａおよび１１４ｂは、レジスタ１１４ａと１１４ｂとの間のノードに配置される電圧タップＴ１とともに電圧源ＶＤＤと接地との間に直列に接続される。

【0006】

コンパレータ１１６ａ，１１６ｂの出力端子はＡＮＤゲート１１８の入力端子に接続される。ＡＮＤゲート１１８の出力は２除算カウンタ１２０に接続される。２によって除算する２除算カウンタ１２０の出力は、それぞれのスイッチＳ１、Ｄ１およびＳ２、Ｄ２を制御するために、ランプ電圧生成回路１０２へ送信されるランプ電圧スイッチング信号Ｄ１’およびＤ２’である。ランプ電圧スイッチングＤ２’はランプ電圧スイッチング信号Ｄ１’の相補的な信号である。

【0007】

図１Ｂを参照する。電圧ＶＲＡＭＰ１、ＶＲＡＭＰ２の電圧および従来の弛張型オシレータ１００のＡＮＤ＿ＯＵＴ信号の波形を示すタイミングチャートである。弛張型オシレータ１００の動作は今図１Ｂを参照して説明される。時間ｔ０でスイッチＤ２が閉じられ、スイッチＳ１が開けられ、充電レジスタ１１０を介してキャパシタ１１２ａの充電が開始される。さらに、スイッチＤ１が開けられ、スイッチＳ２が閉じられる。結果として、キャパシタ１１２ｂは接地電位にある。

【0008】

キャパシタ１１２ａの充電が、コンパレータ１１６ａの負端子（ＶＲＡＭＰ１）の電圧の増加を生じさせる。キャパシタ１１２ｂは接地電位であるので、電圧ＶＲＡＭＰ１が増加し、同時に、コンパレータ１１６ｂ（ＶＲＡＭＰ２）の負端子の電圧が接地電位に残る。コンパレータ１１６ａ，１１６ｂの正端子が、電圧タップＴ１を介して基準生成回路１０４によって生成される一定電圧を受ける。基準電圧生成回路１０４が、レジスタ１１４ａおよび１１４ｂから形成されるレジスタラダーを用いて一定電圧を生成する。レジスタ１１４ａおよび１１４ｂは同一であり、一定電圧ＶＤＤを供給するレジスタラダーの第１端部は電圧源ＶＤＤに接続され、第２端部は接地に接続される場合、電圧タップＴ１で取得される電圧はＶＤＤ／２である。この一定電圧はコンパレータ１１６ａ，１１６ｂの正端子に供給される。

【0009】

それぞれの出力信号ＸおよびＹを生成するために、コンパレータ１１６ａ，１１６ｂがそれぞれの電圧ＶＲＡＭＰ１およびＶＲＡＭＰ２を電圧ＶＤＤ／２と比較する。回路動作の開始において、ＶＲＡＭＰ１およびＶＲＡＭＰ２はＶＤＤ／２より少ない、よって、出力ＸおよびＹは高い。結果として、ＡＮＤゲート１１８、ＡＮＤ＿ＯＵＴ信号の出力も高い。ＡＮＤ＿ＯＵＴ信号の相補的な信号は入力クロック信号として２除算カウンタ１２０に与えられる。入力クロック信号が低状態にスイッチする時、２除算カウンタ１２０が出力信号の状態（ランプ電圧スイッチング信号Ｄ１’およびＤ２’）をトグルする。よって、ＶＲＡＭＰ１およびＶＲＡＭＰ２はＶＤＤ／２より少ない時、出力の状態は安定である。結果として、発振信号生成回路１０８によって生成されるＯＳＣ＿ＯＵＴ信号も高い。

【0010】

続いて、時間ｔ１において、出力信号Ｘが低になり、それによってＡＮＤ＿ＯＵＴ信号を低になるように引き起こるようにＶＲＡＭＰ１がＶＤＤ／２と等しくなる。これが、それぞれの状態をトグルするランプ電圧スイッチング信号Ｄ１’およびＤ２’を生じる。よって、ランプ電圧スイッチング信号Ｄ１’が高状態にスイッチングし、ランプ電圧スイッチング信号Ｄ２’が低状態にスイッチングする。結果として、スイッチＳ２およびＤ２が開口され、スイッチＳ１およびＤ１は閉じられる。これが、キャパシタ１１２ａの放電およびキャパシタ１１２ｂの充電の開始を生じる。結果として、ＶＲＡＭＰ１が接地電位にスイッチし、ＶＲＡＭＰ２が増加始める。コンパレータ１１６ａの出力信号Ｘが一時的に低になるが（ＶＲＡＭＰ１がＶＤＤ／２より高くなる時）、ＶＲＡＭＰ１を接地電位にスイッチングする後、出力信号Ｘが高くなる。また、キャパシタ１１２ｂが充電し始める時、ＶＲＡＭＰ２はＶＤＤ／２より少ないので、コンパレータ１１６ｂの出力Ｙも高い。よって、ＡＮＤ＿ＯＵＴ信号が一時的に低くなり、その後再び高くなる。上記のように、ＡＮＤ＿ＯＵＴ信号が低くなる時、ランプ電圧スイッチング信号Ｄ１’が状態を変化し、よって、ＡＮＤ＿ＯＵＴ信号が低くなるたびに、パルスはＯＳＣ＿ＯＵＴ信号に取得される。キャパシタ１１２ａおよび１１２ｂの充電および放電の上述記載されるシケンスは繰り返され、ＯＳＣ＿ＯＵＴ信号の生成を生じる。

【0011】

ＯＳＣ＿ＯＵＴ信号の生成のシステムは、Ｒ_{ｃｈａｒｇｅ}とＣ１およびＲ_{ｃｈａｒｇｅ}およびＣ２を含むＲＣ回路の継続的充電および放電に関するものである。よって、ＯＳＣ＿ＯＵＴ信号の周波数は、キャパシタ１１２ａおよび１１２ｂの充電を要する時間またはＲＣ回路の時間定数によって制御される。ＯＳＣ＿ＯＵＴ信号の周波数を増加するために、キャパシタ１１２ａおよび１１２ｂの充電を要する時間は減少しなければならない。キャパシタの充電時間の減少を達成するために、キャパシタを充電するために用いられる充電電流が増加されなければならない。よって、ＯＳＣ＿ＯＵＴ信号の周波数が高いほど、電流消費が高くなる。電流消費および周波数は関連するので、電流消費の減少がＯＳＣ＿ＯＵＴ信号の周波数の減少を意味する。

【先行技術文献】

【特許文献】

【0012】

【特許文献1】米国特許第７４４３２５４号明細書

【特許文献2】米国特許第７１０９８０４号明細書

【特許文献3】米国特許第７７３３１９１号明細書

【発明の概要】

【発明が解決しようとする課題】

【0013】

電流消費を増加せずにＯＳＣ＿ＯＵＴ信号の周波数の増加を可能にする弛張型オシレータを提供することによって、低電力で高周波数発振信号を与えることが有利である。

【課題を解決するための手段】

【0014】

第１の実施形態に係る発明は、発振信号を生成するためのシステムにおいて、
ランプ電圧スイッチング信号に基づいてランプ信号を生成するランプ電圧生成回路と、
電圧源に接続され、少なくとも１つの基準電圧を生成する基準電圧生成回路と、
前記ランプ電圧生成回路および基準電圧生成回路に接続される基準電圧スイッチング回路であって、
前記ランプ電圧を受ける第１入力端子および少なくとも１つの基準電圧を受ける第２入力端子を有する少なくとも１つのコンパレータと、
前記少なくとも１つのコンパレータの出力端子に接続されて、基準電圧スイッチング信号、前記ランプスイッチング信号および前記発振信号を生成するデジタル論理回路と、
前記基準電圧生成回路と前記少なくとも１つのコンパレータの前記第２入力端子との間に接続され、前記基準電圧スイッチング信号に基づいて前記少なくとも１つのコンパレータの第２入力端子に前記少なくとも１つの基準電圧を与える少なくとも１つの基準電圧スイッチであって、前記基準電圧スイッチング信号、前記発振信号および前記ランプ電圧スイッチング信号は、前記ランプ電圧と前記少なくとも１つの基準電圧との間の所定の関係に基づいてトグルする、基準電圧スイッチとを備える、基準電圧スイッチング回路と、
を備える、発振信号を生成するためのシステムを要旨とする。

【0015】

第１の実施形態に係る発明において、前記所定の関係には、前記ランプ電圧が前記少なくとも１つの基準電圧と等しいことが含まれるものであってもよい。
また、前記デジタル論理回路は、第１のセットおよび第２のセットの、２によって除算する２除算カウンタを備え、前記２除算カウンタの第１のセットおよび第２のセットの各々が、少なくとも２つの直列に接続される２除算カウンタを備え、２除算カウンタの第１のセットおよび第２のセットの出力端子はＸＯＲゲートの入力端子に接続され、前記ＸＯＲゲートが前記ランプ電圧スイッチング信号を生成するものであってもよい。この場合、前記２除算カウンタの前記第１のセットの前記少なくとも２つの直列に接続される２除算カウンタの第１の出力端子で前記基準電圧スイッチング信号および前記発振信号を取得されることもできる。

【0016】

第１の実施形態に係る発明において、前記ランプ電圧生成回路は、
前記第１ランプ電圧スイッチによって接地に接続される少なくとも１つのキャパシタと、
第２ランプ電圧スイッチによって少なくとも第１キャパシタに接続される第１端子および前記電圧源に接続される第２端子を有する少なくとも１つのレジスタであって、前記第１および前記第２ランプ電圧スイッチが前記ランプ電圧スイッチング信号に基づいてトグルする、レジスタとを備えるのでもよい。

【0017】

第１の実施形態に係る発明において、前記基準電圧生成回路は、前記電圧源に接続されるレジスタラダーネットワークを備えることもあり、この場合、前記レジスタラダーネットワークが、少なくとも１つの基準電圧を生成する少なくとも１つの電圧タップを備えるものであってもよい。

【0018】

第１の実施形態に係る発明において、前記基準電圧生成回路が、少なくとも１つの基準電圧を生成するバンドギャップ基準回路を備えるのでもよい。
第２の実施形態に係る発明は、発振信号を生成するための弛張型オシレータにおいて、
ランプ電圧スイッチング信号に基づいて第１ランプおよび第２ランプ電圧を生成するランプ電圧生成回路と、
少なくとも第１および第２基準電圧を生成する基準電圧生成回路と、
前記ランプ電圧生成回路および前記基準電圧生成回路に接続される基準電圧スイッチング回路であって、
前記第１ランプ電圧を受ける負入力端子および前記第１基準電圧を受ける正入力端子を有する第１コンパレータと、
前記第２ランプ電圧を受ける負入力端子および前記第２基準電圧を受ける正入力端子を有する第２コンパレータと、
前記第１および第２コンパレータの出力端子に接続され、基準電圧スイッチング信号、前記ランプ電圧スイッチング信号および前記発振信号を生成するデジタル論理回路と、
前記基準電圧スイッチング信号に基づいてそれぞれの第１および第２基準電圧を前記第１および第２コンパレータの前記正端子に与えるための前記第１および前記第２コンパレータと前記基準電圧生成回路との間に接続される第１および第２基準電圧スイッチとを備える、基準電圧スイッチング回路と、
を備える、弛張型オシレータを要旨とする。

【0019】

第２の実施形態に係る発明において、前記デジタル論理回路は、
前記第１および前記第２コンパレータの前記出力端子に接続されるＡＮＤゲートと、
前記ＡＮＤゲートの出力端子に接続され、前記発振信号を生成する第１の２除算カウンタと、
前記第１の２除算カウンタに直列に接続され、前記ランプ電圧スイッチング信号を生成する第２の２除算カウンタとを備えることができる。この場合、前記基準電圧スイッチング信号は前記発振信号を補うことによって取得されるものであってもよく、少なくとも１つの前記第１および第２ランプ電圧がそれぞれの第１および前記第２基準電圧と等しくなる時、前記基準電圧スイッチング信号、前記発振信号および前記ランプ電圧スイッチング信号をトグルするものであってもよい。

【0020】

第２の実施形態に係る発明において、前記ランプ電圧生成回路は、
第１ランプ電圧スイッチによって接地に接続される第１キャパシタと、
第２ランプ電圧スイッチによって接地に接続される第２キャパシタと、
第３ランプ電圧スイッチによって前記第１キャパシタに接続され、第４ランプ電圧スイッチによって前記第２キャパシタに接続される第１端子および電圧源に接続される第２端子を有するレジスタであって、前記第１、前記第２、前記第３および前記第４ランプ電圧スイッチは前記ランプ電圧スイッチング信号に基づいてトグルされる、レジスタと、
を備えることもできる。

【0021】

また、第２の実施形態に係る発明において、前記ランプ電圧生成回路は
それぞれの第１および第２ランプ電圧スイッチによって接地に接続される第１および第２キャパシタと、
前記第３および前記第４ランプ電圧スイッチによってそれぞれの前記第１および前記第２キャパシタに接続される電流源であって、前記第１、前記第２、前記第３および前記第３ランプ電圧スイッチが前記ランプ電圧スイッチング信号に基づいてトグルする、電流源とを備えることもある。

【0022】

第２の実施形態に係る発明において、前記基準電圧生成回路が、電圧源に接続されるレジスタラダーネットワークを備えることもでき、この場合、レジスタラダーネットワークが、少なくとも第１および第２基準電圧を生成する少なくとも第１および第２電圧タップを備えることがある。

【0023】

さらに第２の実施形態に係る発明において、前記基準電圧生成回路が、少なくとも第１および第２基準電圧を生成するバンドギャップ電圧基準回路を備えることもある。
第３の実施形態によると、発振信号を生成するための弛張型オシレータにおいて、
第１ランプ電圧および第２ランプ電圧を生成するランプ電圧生成回路であって、前記ランプ電圧生成回路は、
それぞれの第１および第２ランプ電圧スイッチによって接地に接続される第１および第２キャパシタと、
第３ランプ電圧スイッチによって前記第１キャパシタにおよび第４ランプ電圧スイッチによって前記第２キャパシタに接続される電流源であって、前記第１、前記第２、前記第３および前記第４ランプ電圧スイッチがランプ電圧スイッチング信号に基づいてトグルする、電流源とを備えているランプ電圧生成回路と、
電圧源に接続され、１つまたは複数の基準電圧を生成する基準電圧生成回路であって、レジスタラダーネットワークおよび前記レジスタラダーネットワークの１つまたは複数の電圧タップによって取得される１つまたは複数の基準電圧を備える、基準電圧生成回路と、
前記基準電圧生成回路に接続される基準電圧スイッチング回路であって、前記基準電圧スイッチング回路は、
第１ランプ電圧を受ける負端子および前記１つまたは複数の基準電圧の第１基準電圧を受ける正端子を有する第１コンパレータと、
第２ランプ電圧を受ける負端子および前記１つまたは複数の基準電圧の第２基準電圧を受ける正端子を有する第２コンパレータと、
前記第１および前記第２コンパレータの出力端子に接続され、基準電圧スイッチング信号、前記ランプ電圧スイッチング信号および前記発振信号を生成するデジタル論理回路と、
前記第１コンパレータに前記第１基準電圧を与えるために、前記基準電圧生成回路と前記第１コンパレータの正入力端子との間に接続される第１基準電圧スイッチと、前記第２コンパレータに前記第２基準電圧を与えるために、前記基準電圧生成回路と前記第２コンパレータの前記正端子との間に接続される第２基準電圧スイッチとを備える、基準電圧スイッチング回路とを含んでなる、弛張型オシレータを要旨とする。

【0024】

第３の実施形態に係る発明において、前記デジタル論理回路は、
前記第１および前記第２コンパレータの出力端子に接続されるＡＮＤゲートと、
前記ＡＮＤゲートの出力端子に接続され、前記発振信号を生成する第１の２除算カウンタと、
前記第１の２除算カウンタと直列に接続され、前記ランプ電圧スイッチング信号を生成する第２の２除算カウンタとを備えることがある。

【0025】

第３の実施形態に係る発明において、前記第１および前記第２ランプ電圧の少なくとも１つがそれぞれの前記第１および前記第２コンパレータに与えられる前記第１および前記第２基準電圧と等しくなる時、前記基準電圧スイッチング信号、前記発振信号および前記ランプ電圧スイッチング信号がトグルすることができる。

【図面の簡単な説明】

【0026】

【図1A】従来の弛張型オシレータの概略を示す回路図。

【図1B】図１Ａの従来の弛張型オシレータの波形ＶＲＡＭＰ１、ＶＲＡＭＰ２およびＡＮＤ＿ＯＵＴを示すタイミングチャート。

【図2A】本発明の一実施形態による弛張型オシレータの概略を示す概念図。

【図2B】本発明の一実施形態によって図２Ａに示される弛張型オシレータの詳細な回路図。

【図2C】図２Ｂ示される弛張型オシレータの波形ＶＲＡＭＰ１、ＶＲＡＭＰ２およびＡＮＤ＿ＯＵＴを示すタイミングチャート。

【図3】本発明の別の実施形態による弛張型オシレータの概略を示す回路図。

【図4】本発明の別のさらなる実施形態にしたがって、弛張型オシレータの概略を示す回路図。

【発明を実施するための形態】

【0027】

後述の好ましい実施形態の詳細な説明は、添付図面を伴って読むと、より良く理解される。本発明は例示の方法により説明されており、添付の図面により限定されるものではなく、図面において、同様の参照符号は類似の要素を示す。図中の要素は簡潔かつ明確に説明されており、必ずしも寸法通りに描かれていない。

【0028】

添付の図面の詳細な説明は、本発明の現時点での好適実施形態の説明であり、本発明を実施し得る唯一の形態を表すものではない。理解されるように、同一又は等価な機能が、本発明の主旨及び範囲の中に含まれる異なる実施形態によって達成されてもよい。

【0029】

本発明の一実施形態において、発振信号を生成するシステムが提供される。このシステムは、ランプ電圧スイッチング信号に基づいてランプ電圧を生成するランプ電圧生成回路、電圧に接続され、少なくとも１つの基準電圧を生成する基準電圧生成回路およびランプ電圧生成回路に接続される基準電圧スイッチング回路を備える。基準電圧スイッチング回路が、ランプ電圧を受ける第１入力端子および少なくとも１つの基準電圧を受ける第２入力端子を有するコンパレータを備える。さらに、基準電圧スイッチング回路が、コンパレータの出力端子に接続され、基準電圧スイッチング信号、ランプ電圧スイッチング信号および発振信号を生成するデジタル論理回路を備える。基準電圧スイッチング回路が、基準電圧生成回路とコンパレータの第２入力端子との間に接続され、基準電圧スイッチング信号に基づいてコンパレータの第２入力端子に少なくとも１つの基準電圧を与える規準電圧スイッチをさらに含む。基準電圧スイッチング信号、発振信号およびランプ電圧スイッチング信号は、ランプ電圧と少なくとも１つの基準電圧との間の所定関係に基づいてトグルする。

【0030】

本発明の別の実施形態において、発振信号を生成する弛張型オシレータが提供される。弛張型オシレータが、ランプ電圧スイッチング信号に基づいて第１および第２ランプ電圧を生成するランプ電圧生成回路および第１と第２基準電圧を生成する基準電圧生成回路を含む。さらに、弛張型オシレータが、ランプ電圧生成回路および基準電圧生成回路に接続される基準電圧スイッチング回路を含む。基準電圧スイッチング回路が、第１ランプ電圧を受ける負入力端子および第１基準電圧を受ける正入力端子を有する第１コンパレータを含む。基準電圧スイッチング回路が、第２ランプ電圧を受ける負入力端子および第２基準電圧を受ける正端子を有する第２コンパレータをさらに含む。基準電圧スイッチング回路が、第１および第２コンパレータの出力端子に接続され、基準電圧スイッチング信号、ランプ電圧スイッチング信号および発振信号を生成するデジタル論理回路をさらに含む。また、基準電圧スイッチング回路が、基準電圧生成回路とそれぞれの第１および第２コンパレータとの間に接続される第１および第２基準電圧スイッチを含む。第１および第２基準電圧スイッチが、基準電圧スイッチング信号に基づいて第１および第２コンパレータの正端子に第１および第２基準電圧を与える。

【0031】

本発明の別のさらなる実施形態において、発振信号を生成する弛張型オシレータが提供される。弛張型オシレータが、第１および第２ランプ電圧を生成するランプ電圧生成回路を含む。ランプ電圧生成回路が、それぞれの第１および第２ランプ電圧スイッチによって接地に接続される第１および第２キャパシタを含む。ランプ電圧生成回路が、第３ランプ電圧スイッチによって第１コンパレータに接続され、第４ランプ電圧スイッチによって第２コンパレータに接続される電流源をさらに含み、ここで、第１、第２、第３および第４ランプ電圧スイッチはランプ電圧スイッチング信号によってトグルされる。

【0032】

弛張型オシレータはさらに、電圧源に接続され、基準電圧を生成する基準電圧生成回路を含む。基準電圧生成回路が、レジスタラダーネットワークを含み、ここで、基準電圧はレジスタラダーネットワークの１つまたは複数の電圧タップから取得される。さらに、弛張型オシレータが、第１コンパレータおよび第２コンパレータを含む基準電圧生成回路に接続される基準電圧スイッチング回路を含む。第１コンパレータの負端子が第１ランプ電圧を受け、第１コンパレータの正端子が第１基準電圧を受ける。第２コンパレータの負端子が第２ランプ電圧を受け、第２コンパレータの正端子が第２基準電圧を受ける。基準電圧スイッチング回路が、第１および第２コンパレータの出力端子に接続され、基準電圧スイッチング信号、ランプ電圧スイッチング信号および発振信号を生成するデジタル論理回路をさらに含む。また、基準電圧スイッチング回路が、基準電圧生成回路と第１および第２コンパレータの正端子との間に接続される第１および第２基準電圧スイッチを含む。第１基準電圧スイッチが、第１コンパレータに１つまたは複数の基準電圧の第１基準電圧を与える。さらに、第２基準電圧スイッチが、第２コンパレータに１つまたは複数の基準電圧の第２基準電圧を与える。

【0033】

本発明の様々な実施形態が、基準電圧生成回路、ランプ電圧生成回路、基準電圧スイッチング回路およびデジタル回路を備える弛張型オシレータを提供する。ランプ電圧姿勢回路が、基準電圧生成回路によって生成される基準電圧のうちの１つに比較される少なくとも１つのランプ電圧を生成する。開始において、ランプ電圧は、基準電圧生成回路によって生成される最も低い基準電圧と比較される。ランプ電圧が最も低い基準電圧と等しい時、基準電圧は、前の基準電圧より高い値にスイッチングされる。比較のために複数の基準電圧のおかげで、複数のパルスは、ランプ電圧が基準電圧と等しい時いくつかの時点で取得され得る。このように取得されるパルスはデジタル回路を用いて発振信号に変換される。キャパシタの充電抵抗の相当減少がないまたはキャパシタによって消費される充電電流を減少せず、周波数を増加させ得る。発振の周波数を増加するために、基準電圧生成回路は、抵抗の実際値を増加せずに複数の基準電圧を生成するためにレジスタラダーネットワークの別のタップを加えることによって変化される。よって、発振の周波数が追加的基準電圧の生成旅に２倍になる。例えば、１つの基準電圧ＶＤＤ／２が生成される場合、追加的基準電圧ＶＤＤ／４すなわちＶＤＤ／２の半分が発振の周波数の２倍を生じる。さらに、別の基準電圧ＶＤＤ／８すなわちＶＤＤ／４の半分が生成される場合、発振の周波数が４倍になる。つまり、所与周波数において、上述記載されるように基準電圧を加えて電力消費は半分になる。よって、本発明の弛張型オシレータの発振の周波数は電力消費を増加せずに増加させ得る。

【0034】

図２Ａを参照すると、本発明の一実施形態にしたがって弛張型オシレータ２００の概略図が示されている。弛張型オシレータ２００は、ランプ電圧生成回路２０２、基準電圧生成回路２０４および基準電圧スイッチング回路２０６を含んでなる。基準電圧スイッチング回路２０６がデジタル論理回路２０８を含む。ランプ電圧生成回路２０２０が１つまたは複数のランプ電圧を生成する。基準電圧生成回路２０４が１つまたは複数の基準電圧を生成する。基準電圧スイッチング回路２０６は、スイッチＳ３およびＳ４を介して基準電圧生成回路２０４に接続され、ランプ電圧スイッチング信号Ｄ１’およびＤ２’を生成する。１つまたは複数の電圧を生成するために、ランプ電圧スイッチング信号Ｄ１’およびＤ２’はランプ電圧生成回路２０２に与えられる。デジタル論理回路２０８が基準電圧スイッチング信号Ｓ３’およびＳ４’（図示せず）を生成する。

【0035】

図２Ｂを参照する。本発明の一実施形態にしたがって図２Ａに示される弛張型オシレータ２００の詳細な回路図が示されている。弛張型オシレータ２００が、コンパレータ２１０ａ，２１０ｂ、ＡＮＤゲート２１２、２除算カウンタ２１４ａ，２１４ｂ、レジスタ２１６ａ，２１６ｂ，２１６ｃ，２１６ｄ（それぞれＲ_１，Ｒ_２，Ｒ_３，Ｒ_４で示される）、ＮＯＴゲート２１８ａおよび２１８ｄ、キャパシタ２２０ａ，２２０ｂ（Ｃ_１，Ｃ_２）および充電レジスタ２２２（Ｒ_{ｃｈａｒｇｅ}）を含んでなる。

【0036】

ランプ電圧生成回路２０２は、キャパシタ２２０ａ，２２０ｂ、充電レジスタ２２２およびスイッチＳ１、Ｓ２、Ｄ１およびＤ２を含んでなる。キャパシタ２２０ａは充電レジスタ２２２と接地との間に接続される。キャパシタ２２０ａの１つの端子はスイッチＤ２を介して充電レジスタ２２２に接続され、別の端子はスイッチＳ１とともに接地と並列に接続される。さらに、キャパシタ２２０ｂは、キャパシタ２２０ａと同様な構成で充電レジスタ２２と接地との間に接続される。充電レジスタ２２２は、それぞれのスイッチＤ２およびＤ１を介して電圧源ＶＤＤとキャパシタ２２０ａおよび２２０ｂとの間に接続される。キャパシタ２２０ａの充電は、スイッチＤ２を閉じてスイッチＳ１を開けるままにすることによって開始され得る。キャパシタ２２０ａは、スイッチＳ１を閉じてスイッチＤ２を開けることによって放電される。スイッチＤ１およびＳ２は、キャパシタ２２０ｂを充電および放電するために使用される。

【0037】

基準電圧生成回路２０４は、直列に接続されるレジスタ２１６ａ，２１６ｂ，２１６ｃ，２１６ｄを含むレジスタラダーネットワークを有する。レジスタラダーネットワークが４つより多くのレジスタを含んでもよいが、説明を簡潔にするために４つのレジスタのみが示されている。レジスタラダーネットワークの第１端部は電圧源ＶＤＤに接続され、第２端部は接地に接続される。本発明の一実施形態において、レジスタ２１６ａ，２１６ｂ，２１６ｃ，２１６ｄが同一抵抗値すなわち、Ｒ_１＝Ｒ_２＝Ｒ_３＝Ｒ_４を有してもよい。レジスタ２１６ｂの第１端子はレジスタ２１６ａに接続される。電圧タップＴ１を達成するために、レジスタ２１６ｂの第２端子はレジスタ２１６ｃの第１端子に接続される。電圧タップＴ２を達成するために、レジスタ２１６ｄの第１端子はレジスタ２１６ｃの第２端子に接続される。また、基準電圧生成回路２０４は電圧タップＴ１およびＴ２で基準電圧スイッチング回路２０６に接続される。

【0038】

基準電圧スイッチング回路２０６はコンパレータ２１０ａ，２１０ｂを含む。コンパレータ２１０ａ，２１０ｂの負端子はキャパシタ２２０ａ，２２０ｂに接続される。コンパレータ２１０ａ，２１０ｂの正端子は互いに、スイッチＳ４およびＳ３を介して電圧タップＴ１およびＴ２に接続される。スイッチＳ４およびＳ３を開けるおよび閉じることによってコンパレータ２１０ａ，２１０ｂの正端子はそれぞれの電圧タップＴ１またはＴ２に接続または切断される。これが、電圧ＶＤＤ／２またはＶＤＤ／４を基準電圧としてコンパレータ２１０ａおよび２１０ｂに与えられる。レジスタ２１６ａ，２１６ｂ，２１６ｃ，２１６ｄを含むレジスタラダーネットワークは、所定基準電圧（例えば、ＶＤＤ／２およびＶＤＤ／４）の一連を生成するようにプログラムされ得るバンドギャップ基準電圧生成器（図示せず）を交換してもよい。バンドギャップ基準電圧生成器は当技術分野で周知であり、さらなる説明は本発明の完全な理解のために必要ではない。

【0039】

コンパレータ２１０ａ，２１０ｂの出力端子はデジタル論理回路２０８に接続される。デジタル論理回路２０８が、ＡＮＤゲート２１２および２除算カウンタ２１４ａ，２１４ｂを含む。本発明の一実施形態において、２除算カウンタ２１４ａ，２１４ｂの各々が、入力クロック信号の半分の周波数を有する出力信号を生成するために、Ｄフリップフロップに入力信号として与えられるＤフリップフロップの反転される出力信号を有するＤフリップフロップを含む。ＡＮＤゲート２１２の入力端子はコンパレータ２１０ａ，２１０ｂに接続され、ＡＮＤゲート２１２の出力端子は２除算カウンタ２１４ａに接続される。２除算カウンタ２１４ａの出力端子は入力クロック信号として２除算カウンタ２１４ｂに与えられる。２除算カウンタ２１４ａの出力信号は発振信号（ＯＳＣ＿ＯＵＴ信号）である。２除算カウンタカウンタ２１４ｂの出力は、スイッチＤ１、Ｄ２、Ｓ１およびＳ２の動作を制御するためにランプ電圧生成回路２０２に与えられるランプ電圧スイッチング信号Ｄ１’およびＤ２’である。ランプ電圧スイッチング信号Ｄ２’はランプ電圧スイッチング信号Ｄ１’の相補的な信号である。ランプ電圧スイッチング信号Ｄ１’はスイッチＳ１およびＤ１に与えられ、ランプ電圧スイッチング信号Ｄ２’はスイッチＳ２およびＤ２に与えられる。スイッチＳ３を制御するために使用される基準電圧スイッチング信号Ｓ３’を生成するために、ＯＳＣ＿ＯＵＴ信号はＮＯＴゲート２１８ａによって補われる。スイッチＳ４を制御するために使用される基準電圧スイッチング信号Ｓ４’を取得するために、基準電圧スイッチング信号Ｓ３’はＮＯＴゲート２１８ｂによって補われる。

【0040】

図２Ｃを参照する。本発明の一実施形態による、図２Ｂに示される弛張型オシレータ２００の波形ＶＲＡＭＰ１、ＶＲＡＭＰ２およびＡＮＤ＿ＯＵＴを示すタイミングチャートが示される。時間ｔ０において、弛張型オシレータ２００の動作が、スイッチＤ２を閉じて（ランプ電圧スイッチング信号Ｄ２’は高いことを意味する）、スイッチＳ１が開ける（ランプ電圧スイッチング信号Ｄ１’は低いことを意味する）ことによって開始する。これが、充電レジスタ２２２を介して電圧源ＶＤＤによってキャパシタ２２０ａの充電を開始する。さらに、スイッチＤ１は開き、スイッチＳ２は閉じられる。結果として、キャパシタ２２０ｂが接地電位に残る。

【0041】

キャパシタ２２０ａの充電により、コンパレータ２１０ａ（ＶＲＡＭＰ１）の負端子の電圧が増加始める。キャパシタ２２０ｂは接地電位であることにより、コンパレータ２１０ｂ（ＶＲＡＭＰ２）の負端子が接地電位に残り、同時に、電圧ＶＲＡＭＰ１が増加する。

【0042】

コンパレータ２１０ａ，２１０ｂの正端子は、基準電圧生成回路２０４によって生成される基準電圧を受ける。本発明の一実施形態において、基準電圧生成回路２０４が２つの異なる基準電圧、すなわち、ＶＤＤ／２およびＶＤＤ／４を生成する。電圧ＶＤＤ／２は電圧タップＴ１で取得され、スイッチＳ４を閉じてスイッチＳ３を開けたままに残るようにコンパレータ２１０ａおよび２１０ｂの正端子に与えられる。電圧ＶＤＤ／４は電圧タップＴ２で取得され、スイッチＳ３を閉じてスイッチＳ４を開けるままに残るようにコンパレータ２１０ａおよび２１０ｂの正端子に与えられる。本発明の別の実施形態において、基準電圧生成回路２０４が３つの異なる基準電圧、すなわち、ＶＤＤ／２、ＶＤＤ／４およびＶＤＤ／８を生成する、このように実施形態において、追加的スイッチＳ５は基準電圧生成回路２０４とコンパレータ２１０ａおよび２１０ｂとの間に加えられ、スイッチＳ４およびＳ３と並列である。

【0043】

回路動作の開始において、電圧タップＴ２はコンパレータ２１０ａ，２１０ｂの正端子に接続するようにスイッチＳ３が閉じられ、（ＯＳＣ＿ＯＵＴは低いことを意味する）それによって、電圧ＶＤＤ／４をコンパレータ２１０ａ，２１０ｂの正端子に与えられることを生じる。それぞれの出力信号ＸおよびＹを生成するために、コンパレータ２１０ａ，２１０ｂが、それぞれの電圧ＶＲＡＭＰ１およびＶＲＡＭＰ２を電圧ＶＤＤ／４と比較する。電圧ＶＲＡＭＰ１およびＶＲＡＭＰ２は電圧ＶＤＤ／４より少ないので、出力信号ＸおよびＹは高い。結果として、ＡＮＤゲート２１２、ＡＮＤ＿ＯＵＴ信号の出力も高い。ＡＮＤ＿ＯＵＴ信号の相補的な信号は入力クロック信号として２除算カウンタ２１４ａに与えられる。入力クロック信号が低状態に移行する時、２除算カウンタ２１４ａが出力信号すなわちＯＳＣ＿ＯＵＴ信号をトグルする。よって、電圧ＶＲＡＭＰ１およびＶＲＡＭＰ２は電圧ＶＤＤ／４より少ない間ＯＳＣ＿ＯＵＴ信号の初期状態が維持される。本発明の一実施形態において、基準電圧スイッチング信号Ｓ３’を高荷なるようにイネーブルするために、ＯＳＣ＿ＯＵＴ信号は回路動作の開始で低いに構成され、よって、スイッチＳ３は閉じられる。さらに、ＯＳＣ＿ＯＵＴ信号は２除算カウンタ２１４ｂに与えられる。２除算カウンタ２１４ａと同様に、２除算カウンタ２１４ｂも、入力信号、すなわち、ＯＳＣ＿ＯＵＴ信号、が高状態から低状態に遷移する時、出力すなわちスイッチング信号Ｄ１’およびＤ２’の状態をトグルする特徴を有する。本発明の一実施形態において、ランプ電圧スイッチング信号Ｄ１’およびＤ２’は、回路動作の開始でそれぞれの低状態および高状態になるように構成され、よって、スイッチＤ１およびＳ１は開き、かつスイッチＤ２およびＳ２を閉じることを生じる。

【0044】

キャパシタ２２０ａの継続的充電のおかげで、時間ｔ１で電圧ＶＲＡＭＰ１が電圧ＶＤＤ／４と等しくなる。結果として、出力信号Ｘが低く、それによって、ＡＮＤ＿ＯＵＴ信号を低くする。本発明の一実施形態において、電圧ＶＲＡＭＰ１と電圧ＶＤＤ／４との間の所定の関係に基づいて出力信号Ｘが低くなる。例えば、所定の関係が電圧ＶＲＡＭＰ１と電圧ＶＤＤ／４との間の絶対差額が所定値と等しくなることを含み、次に、ＯＳＣ＿ＯＵＴ信号が低状態から高状態にトグルする場合、それによって、基準電圧スイッチング信号Ｓ４’およびＳ３’のトグルを生じる。よって、スイッチＳ４が閉じられ、スイッチＳ３が開ける。結果として、コンパレータ２１０ａおよび２１０ｂの正端子は電圧タップＴ１に接続され、よって、電圧ＶＤＤ／２を供給する。よって、出力信号Ｘは高状態に復元され、それによって、ＡＮＤ＿ＯＵＴ信号を高状態に復元されることを生じる。

【0045】

ＯＳＣ＿ＯＵＴ信号が低状態から高状態に遷移するので、ランプ電圧スイッチング信号Ｄ１’およびＤ２’が以前の状態を維持する。結果として、キャパシタ２２０ａが充電続いて、キャパシタ２２０ｂが接地電位に残る。よって、電圧ＶＲＡＭＰ１が電圧ＶＤＤ／４を超えて増加され、電圧ＶＲＡＭＰ２が接地電位で一定される。時間ｔ２において、電圧ＶＲＡＭＰ１が電圧ＶＤＤ／２に等しいになり、出力信号Ｘが低状態に遷移し、それによって、ＡＮＤ＿ＯＵＴ信号を低状態にスイッチングすることを生じ、ＯＳＣ＿ＯＵＴ信号を低状態にスイッチングすることをさらに生じる。本発明の一実施形態において、電圧ＶＲＡＭＰ１と電圧ＶＤＤ／２との間の所定関係に基づいて出力信号Ｘが低くなる。例において、所定関係が、電圧ＶＲＡＭＰ１と電圧ＶＤＤ／２との間の絶対差額が所定値に等しくなることを含む。これが、スイッチング信号Ｄ１’およびＤ２’がそれぞれの信号の状態をトグルすることを生じる。よって、ランプ電圧スイッチング信号Ｄ１’が高状態にスイッチングし、ランプ電圧スイッチング信号Ｄ２’が低状態にスイッチングする。結果として、スイッチＳ１およびＤ１が閉じられ、スイッチＳ２およびＤ２が開けられる。これが、キャパシタ２２０ａを放電子、充電レジスタ２２２を介してキャパシタ２２０ｂの充電を開始することを生じる。結果として、電圧ＶＲＡＭＰ１が接地電位にスイッチング氏、電圧ＶＲＡＭＰ２が増加始める。出力信号Ｘが一時的に低になるが（電圧ＶＲＡＭＰ１がＶＤＤ／２より高くになる）、電圧ＶＲＡＭＰ１を接地電位にスイッチングする後、出力Ｘが高になる。また、キャパシタ２２０ｂの充電の開始で電圧ＶＲＡＭＰ２は電圧ＶＤＤ／４より少ないので、コンパレータ２２０ｂの出力信号Ｙも高い。よって、キャパシタ２２０ａが放電され、キャパシタ２２０ｂが充電始めると、ＡＮＤ＿ＯＵＴ信号が高状態に戻る。キャパシタ２２０ｂは電圧ＶＤＤ／４に、次に電圧ＶＤＤ／２に充電され、２つのパルスを生成する。パルス生成後のステップはキャパシタ２２０ａに関連し上述の説明と同様である。時点ｔ０〜ｔ２の間ＡＮＤ＿ＯＵＴ信号に取得される２つのパルスが、ＯＳＣ＿ＯＵＴ信号の発振の周波数の２倍に移す。よって、キャパシタ２２０ａおよび２２０ｂを充電するために使用される充電電流の大きさを変化させずに、ＯＳＣ＿ＯＵＴ信号の周波数が増加される。

【0046】

本発明の一実施形態において、２つより多い基準電圧、すなわち、３つの基準電圧はコンパレータ２１０ａ，２１０ｂに順番に供給される。３つの基準電圧の例はＶＤＤ／８、ＶＤＤ／４およびＶＤＤ／２であってよい。第３電圧レベルをコンパレータ２１０ａおよび２１０ｂに供給するために、追加的スイッチＳ５は、基準電圧生成回路２０４とコンパレータ２１０ａおよび２１０ｂとの間に、スイッチＳ３およびＳ４に並列に加えられてもよい。このような場合において、電圧ＶＲＡＭＰ１がそれぞれのＶＤＤ／８、ＶＤＤ／４およびＶＤＤ／２と等しくなる時と相当する時点ｔ０〜ｔ２の間３つのパルスはＡＮＤ＿ＯＵＴ信号に取得される。これが、ＯＳＣ＿ＯＵＴ信号の発振の周波数の３場合増加に生じる。本発明の別の実施形態二おいて、４つの基準電圧、すなわち、ＶＤＤ／１６、ＶＤＤ／８、ＶＤＤ／４およびＶＤＤ／２はコンパレータ２１０ａおよび２１０ｂに与えられる。本発明の一実施形態において、レジスタラダーはバンドギャップ基準電圧生成器によって交換されてもよい。この場合において、バンドギャップ基準電圧生成器は、様々な基準電圧、すなわち、ＶＤＤ／８、ＶＤＤ／４およびＶＤＤ／２を生成するようにプログラムされる。様々な基準電圧は次にコンパレータ２１０ａおよび２１０ｂの正端子に供給される。本発明の別の実施形態二おいて、充電レジスタ２２２は図３に示される電流源によって交換される（以下に説明される）。

【0047】

図３を参照する。本発明の別の実施形態にしたがって弛張型オシレータ３００の概略図を示す。弛張型オシレータ２００の一部として示される素子を加えて、弛張型オシレータ３００が電流源３０２を含む。充電レジスタ２２２は電流源３０２によって交換される。電流源３０２がキャパシタ２２０ａおよび２２０ｂに充電する一定な電流を供給する。弛張型オシレータ３００の動作は弛張型オシレータ２００と同様である。

【0048】

図４を参照する。本発明の別のさらなる実施形態による弛張型オシレータ４００の概略図を示す。弛張型オシレータ４００が、２除算カウンタ４０２ａ，４０２ｂ，４０２ｃ，４０２ｄ，ＸＯＲゲート４０４、コンパレータ４０６、レジスタ４０８ａ，４０８ｂ，４０８ｃ，４０８ｄ、キャパシタ４１０、電流源４１２およびＮＯＴゲート４１４ａ，４１４ｂ，４１４ｃを含む。

【0049】

キャパシタ４１０は電流源４１２と接地との間に接続される。キャパシタ４１０の１つの端子はスイッチＤ２を介して電流源４１２に接続され、他の端子は並列でスイッチＳ１に接地に接続される。キャパシタ４１０の充電は、スイッチＤ２を閉じて、スイッチ１を開いたままに残ることによって開始される。キャパシタ４１０は、スイッチＳ１を閉じて、スイッチＤ２を開くことによって放電される。

【0050】

レジスタラダーネットワークを形成するために、レジスタ４０８ａ、４０８ｂ、４０８ｃおよび４０８ｄは直列に接続される。当業者が、レジスタラダーネットワークが４つより多いレジスタを含んでもよい、４つのレジスタのみは簡潔のために示されることを理解されるべきである。レジスタラダーネットワークの第１端部は電圧源ＶＤＤに接続され、第２端部は接地に接続される。レジスタ４０８ｂの第１端子はレジスタ４０８ａに接続される。電圧タップＴ１を達成するために、レジスタ４０８ｂの第２端子はレジスタ４０８ｃの第１端子に接続される。電圧タップＴ２を達成するために、レジスタ４０８ｃの第２端子はレジスタ４０８ｄの第１端子に接続される。

【0051】

電圧タップＴ１およびＴ２は、スイッチＳ３およびＳ４を介してコンパレータ４０６の正端子に接続される。スイッチＳ３およびＳ４の閉じるおよび開くことによって、正端子は電圧タップＴ１またはＴ２に接続されてもよく、よって、基準電圧として電圧ＶＤＤ／２または電圧ＶＤＤ／４をコンパレータ４０６の正端子に供給する。コンパレータ４０６の負端子はスイッチＤ２を介してキャパシタ４１０の第１端子におよびスイッチＳ１を介してキャパシタ４１０の第２端子に接続される。よって、スイッチＤ２はオンである時、負端子はキャパシタ４１０の第１端子で電圧を供給される。本発明の一実施形態において、電圧源ＶＤＤはバンドギャップ基準電圧生成器（図示せず）によって交換され得る。バンドギャップ基準電圧が、基準電圧ＶＤＤ／２およびＶＤＤ／４を生成するレジスタラダーネットワークに供給される一定基準電圧ＶＤＤを生成する。バンドギャップ基準電圧生成器は当技術分野で周知であるので、本明細書の簡潔ために、詳細な説明が記載されない。

【0052】

コンパレータ４０６の出力信号Ｘは、第１のセットおよび第２のセットの２除算カウンタに与えられる。第１のセットの２除算カウンタが、直列に接続される２除算カウンタ４０２ａ，４０２ｂを含んでなり、ここで、２除算カウンタ４０２ａが、スイッチＳ３を制御する基準電圧スイッチング信号Ｓ３’を生成する。基準電圧スイッチング信号Ｓ３’（Ｓ４’）の相補的な信号は入力クロック信号として２除算カウンタ４０２ｃに供給される。２除算カウンタ４０２ｂの出力端子は入力信号としてＸＯＲゲート４０４に与えられる。また、発振信号、ＯＳＣ＿ＯＵＴ信号、を生成するために、基準電圧スイッチング信号Ｓ３’はＮＯＴゲート４１４ａおよび４１４ｂを用いてバッファリングされる。

【0053】

第２のセットの２除算カウンタは、２除算カウンタ４０２ｃ，４０２ｄを含んでなり、ここで、２除算カウンタ４０２ｃによって生成される出力信号の相補的信号は入力クロック信号として２除算カウンタ４０２ｄ与えられ、２除算カウンタ４０２ｄの出力信号は入力信号としてＸＯＲゲート４０４に与えられる。スイッチＳ１を制御するためのランプ電圧スイッチング信号Ｄ１’を生成するためにＸＯＲゲート４０４が２除算カウンタ４０２ｂ，４０２ｄから受信される入力信号で動作する。スイッチＤ２を制御するためのランプ電圧スイッチング信号Ｄ２’を生成するために、ＮＯＴゲート４１４ｃがランプ電圧スイッチング信号Ｄ１’を補う。

【0054】

弛張型オシレータ３００の動作は図２Ｃに関連して詳細に説明される。また図２Ｃを参照して、弛張型オシレータ２００の波形ＶＲＡＭＰ１、ＶＲＡＭＰ２およびＡＮＤ＿ＯＵＴを示すタイミングチャートが示される。弛張型オシレータ３００が、１つのキャパシタ、すなわち、キャパシタ４１０および単一ランプ電圧、すなわち、電圧ＶＲＡＭＰ１、を含むので、電圧ＶＲＡＭＰ１は弛張型オシレータ３００の動作の間取得される。時間ｔ０において、弛張型オシレータ３００の動作が、スイッチＤ２を閉じて（よって、ランプ電圧スイッチング信号Ｄ２’は高い）、スイッチＳ１は開く（よって、ランプ電圧スイッチング信号Ｄ１’は低）ことによって開始される。これが、電流源４１２によってキャパシタ４１０の充電を開始する。

【0055】

キャパシタ４１０の充電が、コンパレータ４０６の負端子（ＶＲＡＭＰ１）の電圧を増加始めることを引き起こる。コンパレータ４０６の正端子が、上述のレジスタラダーネットワークによって生成される基準電圧を受ける。本発明の一実施形態において、レジスタラダーネットワークが２つの異なる基準電圧、電圧ＶＤＤ／２およびＶＤＤ／４を生成し、ここで、電圧ＶＤＤ／２は電圧タップＴ１で取得され、スイッチＳ４を閉じて、スイッチＳ３を開くままに残ることによってコンパレータ４０６の正端子に供給される。電圧ＶＤＤ／４は電圧タップＴ２で取得され、スイッチＳ３を閉じて、スイッチＳ４を開くままに残ることによってコンパレータ４０６の正端子に供給される。本発明の実施形態において、レジスタラダーネットワークが３つの異なる基準電圧、すなわち、電圧ＶＤＤ／２、ＶＤＤ／４およびＶＤＤ／８を生成し得る。このような場合において、追加的スイッチＳ５はレジスタラダーネットワークとコンパレータ４０６との間にスイッチＳ３およびＳ４と並列に加えられる。

【0056】

回路動作の開始において、スイッチＳ３が閉じられ（ＯＳＣ＿ＯＵＴ信号は高い）、よって、電圧タップＴ２はコンパレータ４０６の正端子に接続される。これが、電圧ＶＤＤ／４をコンパレータ４０６の正端子に供給されることを生じる。出力信号Ｘを生成するために、コンパレータ４０６が電圧ＶＲＡＭＰ１を電圧ＶＤＤ／４に比較する。電圧ＶＲＡＭＰ１は電圧ＶＤＤ／４より少ないので、出力Ｘは高である。出力信号Ｘは入力クロック信号として２除算カウンタ４０２ａに与えられる。

【0057】

２除算カウンタ４０２ａが出力信号の状態、すなわち、入力クロック信号、すなわち、出力クロック信号Ｘが低状態にスイッチングする時の基準電圧スイッチング信号Ｓ４’およびＳ３’、をトグルする。よって、基準電圧スイッチング信号Ｓ４’およびＳ３’の初期状態は、電圧ＶＲＡＭＰ１はＶＤＤ／４より少ない時維持される。本発明の一実施形態において、電圧タップＴ２をコンパレータ４０６の正端子に接続するようにイネーブルするために、動作の開始で基準電圧スイッチング信号Ｓ３’は高に構成される。これも、基準電圧スイッチング信号Ｓ４’を低いように構成される。さらに、動作の開始でＯＳＣ＿ＯＵＴ信号（基準電圧スイッチング信号Ｓ３’をバッファリングすることによって得られる）も高い。

【0058】

出力信号Ｘも入力クロック信号として２除算カウンタ４０２ｃに与えられる。入力信号、すなわち、出力信号Ｘ、が高状態にスイッチングする時、２除算カウンタ４０２ｃが出力信号ＵおよびＶの状態をトグルする。本発明の一実施形態において、それぞれの出力信号ＵおよびＶの初期状態は、それぞれ、低および高である。基準電圧スイッチング信号Ｓ４’および出力信号Ｕの相補的な信号は入力クロック信号として、２除算カウンタ４０２ｂ，４０２ｄのそれぞれに与えられる。よって、入力クロック信号、すなわち、Ｓ４’およびＵ、が低状態にスイッチングする時、２除算カウンタ４０２ｂ，４０２ｄもそれぞれの出力信号、すなわち、ＭおよびＮの状態をトグルする。出力信号ＭおよびＮは入力信号としてＸＯＲゲート４０４に与えられる。ＸＯＲゲート４０４が、ランプ電圧スイッチング信号Ｄ１’を生成し、入力信号、すなわち、ＭおよびＮは同一である時、該ランプ電圧スイッチング信号Ｄ１’低であり、入力信号が異なる時、高である。回路動作の開始でランプ電圧スイッチング信号Ｄ１’は低くしなければならないので、入力信号ＭおよびＮは同一に構成される。本発明の一実施形態において、入力信号ＭおよびＮの初期状態は高に構成される。

【0059】

キャパシタ４１０の継続的充電のおかげで、時間ｔ１で電圧ＶＲＡＭＰ１が電圧ＶＤＤ／４と等しくなる。結果として、出力Ｘが低になり、それによって、基準電圧スイッチング信号Ｓ４’を高状態にスイッチングし、基準電圧スイッチング信号Ｓ３’およびＯＳＣ＿ＯＵＴ信号を低状態にスイッチングすることを生じる。本発明の一実施形態二おいて、電圧ＶＲＡＭＰ１と電圧ＶＤＤ／４との間の所定関係に基づいて出力信号Ｘが低になる。例えば、所定関係が、電圧ＶＲＡＭＰ１と電圧ＶＤＤ／４との間の絶対差額を所定値に等しくなることを含む場合、スイッチＳ４が閉じられ、Ｓ３が開けられる。よって、電圧タップＴ２はコンパレータ４０６の正端子から切断され、電圧タップＴ１はコンパレータ４０６の正端子に接続し、よって、電圧ＶＤＤ／２をコンパレータ４０６の正端子に供給することを生じる。基準電圧スイッチング信号Ｓ４’スイッチが高状態にスイッチングするので、出力信号Ｍの状態は変化されない。また、出力信号Ｘが低状態にスイッチングするので、出力信号ＵおよびＶの状態も一定に維持する。これが、出力信号Ｎを以前の状態を維持することを生じる。よって、ランプ電圧スイッチング信号Ｄ１’が自体の状態を変化せず、すなわち、低いままである。これが、キャパシタ４１０を電圧ＶＤＤ／４を超えて充電されることを生じる。よって、出力信号Ｘ工状態にスイッチングし、これが、出力信号Ｕをトグルすることを生じる。出力信号Ｕの初期状態は低であるので、出力信号Ｕが高状態にスイッチングする。２除算カウンタ４０２ｄが、入力信号がいつ低状態にスイッチングすることをトグルするので、出力信号Ｎは変わらないままである。

【0060】

時間ｔ２において、電圧ＶＲＡＭＰ１が電圧ＶＤＤ／２と等しくなる。これが、出力信号Ｘを低状態にスイッチングすることを生じ、それによって、基準電圧スイッチング信号Ｓ３’およびＳ４’がそれぞれの信号状態をトグルすることを生じる。本発明の一実施形態において、出力信号Ｘが、電圧ＶＲＡＭＰ１と電圧ＶＤＤ／２との間の所定関係に基づいて低になる。一例おいて、所定関係が、電圧ＶＲＡＭＰ１と電圧ＶＤＤ／２との間の絶対差額が所定値と等しくなることを含む。よって、基準電圧スイッチング信号Ｓ４’が低状態にスイッチングし、基準電圧スイッチング信号Ｓ３’およびＯＳＣ＿ＯＵＴ信号が高状態にスイッチングする。これが、 出力信号Ｍを高から低に遷移することを生じる。２除算カウンタ４０２ｃ，４０２ｄの出力がトグルしないので、ＸＯＲゲート４０４の入力信号が異なることになる。これが、ランプ電圧スイッチング信号Ｄ１’を低から高状態に遷移する。これが、スイッチＳ１を閉じて、スイッチＤ２を開くことを寄与し、よって、キャパシタ４１０を放電するように引き起こる。放電のおかげで、電圧ＶＲＡＭＰ１はゼロに減少され、出力信号Ｘが高状態にスイッチングする。これが、出力信号Ｕのトグルを低状態になることを生じる。これが、出力信号Ｎを高状態から低状態にトグルすることを生じる。ＸＯＲゲート４０４へ入信号ＭおよびＮが同一になるので、ランプ電圧スイッチング信号Ｄ１’が低状態にトグルする。これが、スイッチＳ１開き、スイッチＤ２を閉じることを引き起こり、よって、時間ｔ０で開始する充電サイクルと同一キャパシタ４１０の充電サイクルを開始する。このサイクルが継続し、ＯＳＣ＿ＯＵＴ信号が高と低状態との間に発振続く。本発明の一実施形態において、２除算カウンタの第１のセットおよび第２のセットは、上述記載される信号と同一の基準電圧スイッチング信号Ｓ３’およびＳ４’かつランプ電圧スイッチング信号Ｄ１’を生成し得る論理部品を含む適切な論理回路で変換してもよい。本発明の様々な実施形態において、２除算カウンタがＤフリップフロップを含み、ここで、Ｄフリップフロップの反転される出力信号は入信号としてＤフリップフロップに与えられる。これが、入力クロック信号の発振の周波数の半分の出力信号を生じる。本発明の一実施形態において、レジスタラダーネットワークはバンドギャップ基準電圧生成器によって変換され得る。この場合において、バンドギャップ基準電圧生成器は、様々な基準電圧、すなわち、ＶＤＤ／８、ＶＤＤ／４およびＶＤＤ／２、を生成するようにプログラムされる。様々な基準電圧は次にコンパレータ４０６の正端子に与えられる。本発明の別実施形態において、電流源４１２は、上述の図２Ｂ示される充電レジスタによって変換され得る。

【0061】

本発明をそのある好ましいバージョンについてかなり詳細に記述したが、他のバージョン及び変更は可能でありかつ考えられる。当業者は、請求の範囲によって定義したような発明の精神及び範囲から逸脱せずに本発明の同一目的を提供するように他の構造を設計或いは修正する基礎として開示概念及び特定の実施の形態を容易に使用できることを理解するべきである。

【符号の説明】

【0062】

２００…弛張型オシレータ、２０２…ランプ電圧生成回路、２０４…基準電圧生成回路、２０６…基準電圧スイッチング回路、２０８…デジタル論理回路。

【図1A】

【図1B】

【図2A】

【図2B】

【図2C】

【図3】

【図4】