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特許第6073920号(P6073920)
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陳啓星
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6073920
対数コンパンディング比率複数同時実行式超高速ＡＤＣ及びＤＡＣの級電位アーキテクチャ（ｓｔａｇｅ−ｐｏｔｅｎｔｉａｌａｒｃｈｉｔｅｃｔｕｒｅ）
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