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公報発行日 2017年10月4
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【図1】本開示の例示的一実施形態によるダイレクトデコーダを含む装置のブロック図である。
【図2】本開示の例示的一実施形態によるデコーダの回路図である。
【図3(1)】本開示の例示的一実施形態による階層的デコーダのブロック図である。
【図3(2)】本開示の例示的一実施形態による階層的デコーダのブロック図である。
【図4】本開示の例示的一実施形態による階層的デコーダの回路図である。
【図5】本開示の例示的一実施形態によるデコーダを含むメモリシステムの図である。
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