特許6513701円形に配置された複数の縦型ホール素子のオフセット成分を減少させるための回路および方法

発明の名称　円形に配置された複数の縦型ホール素子のオフセット成分を減少させるための回路および方法

出願人　アレグロ・マイクロシステムズ・エルエルシー　（識別番号 501105602）

　　　　特許公開件数ランキング 2094 位（9件）（共同出願を含む）

　　　　特許取得件数ランキング 9401 位（2件）（共同出願を含む）

公報番号　特許-6513701

公報発行日　2019年5月15

公報URL　https://ipforce.jp/patent-jp-B9-6513701

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