特開2022-183603IP Force 特許公報全文掲載

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技術分野

集積回路及び電源回路

要約特許出願時に添付された[要約書]

【課題】電源回路の電力損失を抑制することが可能な集積回路を提供する。
【解決手段】集積回路は、交流電圧を整流した整流電圧が印加されるインダクタと、前記インダクタに流れるインダクタ電流を制御するトランジスタと、を備え、前記整流電圧を昇圧した出力電圧を生成する電源回路の前記トランジスタのスイッチングを制御する集積回路であって、前記トランジスタをスイッチングするための駆動信号のデューティ比に応じた第１電圧と、第１基準電圧との誤差に応じた第１誤差電圧を出力する第１誤差電圧生成回路と、前記インダクタ電流が所定の電流値となると、前記トランジスタをオンするための前記駆動信号を出力し、前記第１誤差電圧に基づいて、前記デューティ比が所定値となるよう、前記トランジスタをオフするための前記駆動信号を出力する信号出力回路と、を備える。
【選択図】図２

発明が解決しようとする課題[発明の詳細な説明]から抜粋

ところで、昇圧チョッパー型の昇圧回路は、交流電圧の実効値が低い場合、昇圧比を大きくして所定の電圧レベルの直流電圧を生成する必要がある。しかしながら、昇圧比を大きくすると、トランジスタの導通損失が増加する等の影響で、電力損失の増大をもたらす。

課題を解決するための手段[発明の詳細な説明]から抜粋

前述した課題を解決する本発明にかかる集積回路は、交流電圧を整流した整流電圧が印加されるインダクタと、前記インダクタに流れるインダクタ電流を制御するトランジスタと、を備え、前記整流電圧を昇圧した出力電圧を生成する電源回路の前記トランジスタのスイッチングを制御する集積回路であって、前記トランジスタをスイッチングするための駆動信号のデューティ比に応じた第１電圧と、第１基準電圧との誤差に応じた第１誤・・・　続きを知財ポータルサイト IP Force にログインして見る

発明の効果[発明の詳細な説明]から抜粋

本発明によれば、電源回路の電力損失を抑制することが可能な集積回路を提供することができる。

この発明についての権利主張の範囲[特許請求の範囲]

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この特許公報に記載されている図面[図面の簡単な説明]から抜粋

【図1】 ＡＣ－ＤＣコンバータ１０ａの一例を示す図である。
【図2】 集積回路３０ａの一例を示す図である。
【図3】 集積回路３０ａの動作波形の一例を示す図である。
【図4】 駆動信号Ｖｄｒのデューティ比が変化することにより生じる集積回路３０ａの動作の一例を示す図である。
【図5】 交流電圧Ｖａｃ（実効値）と、交流電圧Ｖａｃのピーク電圧、出力電圧及び昇圧比との関係を示す図である。
【図6】 ＡＣ－ＤＣコンバータ１０ｂの一例を示す図である。
【図7】 集積回路３０ｂの一例を示す図である。
【図8】 交流電圧Ｖａｃ（実効値）と、交流電圧Ｖａｃのピーク電圧、出力電圧及び昇圧比との関係を示す図である。
【図9】 集積回路３０ｂの動作波形の一例を示す図である。
【図10】 ＡＣ－ＤＣコンバータ１０ｃの一例を示す図である。
【図11】 集積回路３０ｃの一例を示す図である。
【図12】 集積回路３０ｄの一例を示す図である。

選択図 図2出願人が指定した本件の代表的な図

１０ａ，１０ｂ，１０ｃ ＡＣ－ＤＣコンバータ １１ 商用電源 １２ 負荷 ２０ 全波整流回路 ２１，２３，３３，３５，３６ コンデンサ ２２，３７，３８，６０，６１ ダイオード ２４ ＮＭＯＳトランジスタ ２５，２７，２８，３１，３２，３４ 抵抗 ２６ａ，２６ｂ，２６ｃ 制御ブロック ３０ａ，３０ｂ，３０ｃ，３０ｄ 集積回路 ４０ａ，４０ｂ，４０ｃ 信号出力回路 ４１，４２ 誤差電圧生成回路 ４３ 識別回路 ４４ イネーブル回路 ５０ 検出回路 ５１ 遅延回路 ５２ パルス回路 ５３ ＳＲフリップフロップ ５４ 発振回路 ５５ コンパレータ ５６ バッファ ５７ 選択回路 ５８ スイッチ回路 ６２ 定電流源

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