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公報発行日 2022年4月27
公報URL https://ipforce.jp/patent-jp-P_A1-2022-65374 ログイン済みの方はこのURLへ
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【課題】半導体装置の製造コストを抑制する。
【解決手段】プローブピンPBは、半導体装置PKGのリードLDに接触させるための複数のプランジャPR1と、テスト基板TBの電極ELに接触させるためのプランジャPR2と、複数のプランジャPR1とプランジャPR2との間に配置されたバネSPとを有している。複数のプランジャPR1は、プランジャPR2に設けられた孔部に挿入されている。複数のプランジャPR1の先端部ST1がリードLDと接触し、プランジャPR2の先端部ST2がテスト基板TBの電極ELと接触することにより、半導体装置PKGのリードLDとテスト基板TBの電極ELとがプローブピンPBを介して電気的に接続される。
【選択図】図4
一実施の形態によれば、半導体装置の電気的試験の信頼性を向上させることができる。
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