特許7043541IP Force 特許公報全文掲載

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ＬＰＨＣＳＬ伝送方式におけるドライバ

発明が解決しようとする課題[発明の詳細な説明]から抜粋

本発明は、従来技術に鑑み、スイッチングのタイミング調整が不要になり、構造も簡素化できるＬＰＨＣＳＬ伝送方式におけるドライバを提供することを目的とする。

課題を解決するための手段[発明の詳細な説明]から抜粋

目的を達成する本発明の第１の態様は、 ＬＰＨＣＳＬ伝送方式におけるドライバであって、 電源となる電圧レギュレータと、 ソース側が前記電圧レギュレータに接続されたＰＭＯＳトランジスタである第１のトランジスタのドレイン側と、ソース側がグランドに接続されたＮＭＯＳトランジスタである第２のトランジスタのドレイン側とが第１の接続点を介して直列に接続された・・・　続きを知財ポータルサイト IP Force にログインして見る

発明の効果[発明の詳細な説明]から抜粋

本発明によれば所定の伝送信号を生成する２個一組のトランジスタをＣＭＯＳ型トランジスタで形成したので、当該ＣＭＯＳ型トランジスタを形成するＰＭＯＳトランジスタとＮＭＯＳトランジスタを動作させるプリバッファは、１個で済む。この結果、プリバッファは、従来技術のように、2種類の動作信号が正確なタイミングで生成されるように、厳密なタイミング調整を行う必要はなく、これに伴う構成の簡素化も実現し得る。

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この特許公報に記載されている図面[図面の簡単な説明]から抜粋

【図1】 本発明の実施の形態に係るＬＰＨＣＳＬ伝送方式におけるドライバを示すブロック図である。
【図2】 図１に示すドライバのプリバッファ部分を抽出し、その具体例を示すブロック図である。
【図3】 図１に示すドライバのプリバッファ部分を抽出し、その他の具体例を示すブロック図である。
【図4】 従来技術に係るHCSL(High-speed current steering logic)方式の伝送系を概念的に示す説明図である。
【図5】 従来技術に係るLPHCSL(Low power high-speed current steering logic)方式の伝送系を概念的に示す説明図である。

代表図 図1本件の代表的な図

１ 電圧レギュレータ ３ 第1のプリバッファ ３Ａ ナンド回路 ３Ｂ インバータ ３Ｃ ＮＯＲ回路 ４ 第２のプリバッファ ５ 第1のＣＭＯＳ型トランジスタ ６ 第２のＣＭＯＳ型トランジスタ ７ 第３のＣＭＯＳ型トランジスタ ８ イネーブルライン Ｓ 伝送信号 Ｔｒ１ ＰＭＯＳトランジスタ Ｔｒ２ ＮＭＯＳトランジスタ Ｔｒ７ ＮＭＯＳトランジスタ ＯＵＴ１ 第１の出力端子 ＯＵＴ２ 第２の出力端子 Ｒ１ 第1の抵抗素子 Ｒ２ 第２の抵抗素子

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