特許7293163IP Force 特許公報全文掲載

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セキュアコンピューティング環境において、フラッシュエミュレーション機能を有するコントローラ及びコントロール方法に関わりに、特に、埋め込みセキュアモノトニックカウンター（ｅｍｂｅｄｄｅｄ ｓｅｃｕｒｅ ｍｏｎｏｔｏｎｉｃ ｃｏｕｎｔｅｒｓ（ＥＳＭＣ））を備えるフラッシュメモリのミュレーション機能を有するコントローラ及びコントロール方法

発明が解決しようとする課題[発明の詳細な説明]から抜粋

本発明の目的は、すべてのフラッシュ命令を実装するフラッシュを備えたコンピューティングシステムよりも安価なコンピューティングシステムでセキュアフラッシュ機能を実現できるコントローラ及びコントロール方法を提供することにある。

課題を解決するための手段[発明の詳細な説明]から抜粋

本発明のコントローラは、ホストと通信するためのホストインターフェースと、プロセッサと、を備え、前記プロセッサは、前記ホストインターフェイスを介して、不揮発性メモリ（ＮＶＭ）で実行するための複数の命令を前記ホストから受信し、前記複数の命令から、セキュアな単調カウンタに関係し、且つ、セキュアな単調カウンタが埋め込まれた不揮発性メモリでの実行しょうとする命令を識別し、前記識別された命令を・・・　続きを知財ポータルサイト IP Force にログインして見る

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この特許公報に記載されている図面[図面の簡単な説明]から抜粋

【図1】 図１は、本発明の１つの実施形態にかかる、ＲＰＭＣフラッシュエミュレーションを実行する、スレーブ接続フラッシュ（Ｓｌａｖｅ－Ａｔｔａｃｈｅｄ－Ｆｌａｓｈ）構成を有するコンピューティングシステムを概略的に示すブロック図である。
【図2】 図２は、本発明のもう１つの実施形態にかかる、ＲＰＭＣフラッシュエミュレーションを実行する、ホスト接続フラッシュ（ｈｏｓｔ－ａｔｔａｃｈｅｄ Ｆｌａｓｈ）構成を有するコンピューティングシステムを概略的に示すブロック図である。
【図3】 図３は、本発明のもう１つの実施形態にかかる、ＲＰＭＣフラッシュエミュレーションを実行する、スレーブ接続フラッシュ構成を有するコンピューティングシステムを概略的に示すブロック図である。
【図4】 図４は、本発明のもう１つの実施形態にかかる、ＲＰＭＣフラッシュエミュレーションを実行する、ホスト接続フラッシュ構成を有するコンピューティングシステムを概略的に示すブロック図である。
【図5】 図５は、本発明の第５実施形態にかかる、ＲＰＭＣフラッシュエミュレーションを実行する、スレーブ接続フラッシュ構成を有するコンピューティングシステムを概略的に示すブロック図である。

代表図 図1本件の代表的な図

１００、２００、３００、４００、５００…コンピューティングシステム １０２、２０２、３０２、４０２、５０２…ホスト １０４、２０４、３０４、４１４、５１４…ＴＰＭ １０６、２０６、３０６、４０６、５０６…フラッシュ １０８、２０８、３０８、４０８、５０８…コントローラ １１０、２１０、３１０、４１０、５１０…プロセッサ １１２、２１２、３１２、４１２、５１２…ホストインターフェース １１４、２１４、４１４、５１４…Ｉ２Ｃポート １１６、３１６、５１６…ＳＰＩポート ３１８…フラッシュアプリケーションドライバ ３２０…セキュリティサービスドライバ

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