特許 7369954 メモリコントローラおよびメモリアクセス制御方法

(19)【発行国】日本国特許庁(JP)

(12)【公報種別】特許公報(B2)

(11)【特許番号】

(24)【登録日】2023-10-19

(45)【発行日】2023-10-27

(54)【発明の名称】メモリコントローラおよびメモリアクセス制御方法

(51)【国際特許分類】

   G06F 12/06 20060101AFI20231020BHJP

   G06F 12/00 20060101ALI20231020BHJP

   G11C 7/10 20060101ALI20231020BHJP

   G11C 11/4096 20060101ALI20231020BHJP

【ＦＩ】

G06F12/06 550A

G06F12/00 597C

G06F12/00 597D

G06F12/06 540E

G11C7/10 460

G11C11/4096 550

【請求項の数】 14

(21)【出願番号】P 2021050871

(22)【出願日】2021-03-24

(65)【公開番号】P2022148977

(43)【公開日】2022-10-06

【審査請求日】2022-04-01

(73)【特許権者】

【識別番号】314012076

【氏名又は名称】パナソニックＩＰマネジメント株式会社

(74)【代理人】

【識別番号】100109210

【弁理士】

【氏名又は名称】新居 広守

(74)【代理人】

【識別番号】100137235

【弁理士】

【氏名又は名称】寺谷 英作

(74)【代理人】

【識別番号】100131417

【弁理士】

【氏名又は名称】道坂 伸一

(72)【発明者】

【氏名】田中 和人

【審査官】打出 義尚

(56)【参考文献】

【文献】米国特許出願公開第２０１７／０３６５３０９（ＵＳ，Ａ１）

【文献】特開２００８－２０４２５８（ＪＰ，Ａ）

(58)【調査した分野】(Int.Cl.，ＤＢ名)

Ｇ０６Ｆ １２／０６

Ｇ０６Ｆ １２／００

Ｇ１１Ｃ ７／１０

Ｇ１１Ｃ １１／４０９６

(57)【特許請求の範囲】

【請求項1】

複数のバンクを有するＳＤＲＡＭへのアクセスを制御するメモリコントローラであって、
アクセスマスターからメモリアクセス要求を受け付ける受付部と、
コマンド発行に関する第１発行モードおよび第２発行モードのうちの一方を選択する選択部と、
選択した発行モードに従って前記メモリアクセス要求に対応するコマンド列を前記ＳＤＲＡＭに発行する発行部と、を備え、
前記第１発行モードは、バンクを活性化するアクティベートコマンドを分割しないで連続するクロックサイクルで発行するモードであり、
前記第２発行モードは、バンクを活性化するアクティベートコマンドを分割して連続しないクロックサイクルで発行するモードであり、
前記選択部は、
受け付けたメモリアクセス要求の要求元が、複数のアクセスマスターのうちの第１アクセスマスターである場合は、前記第１発行モードを選択し、
受け付けたメモリアクセス要求の要求元が、前記複数のアクセスマスターのうちの第２アクセスマスターである場合は、前記第２発行モードを選択する、
メモリコントローラ。

【請求項2】

前記メモリアクセス要求を受け付けたとき、先行するメモリアクセス要求に対応する未発行のコマンドが存在するか否かを判定し、未発行のコマンドが存在すると判定した場合には、受け付けたメモリアクセス要求の対象となるバンクと、未発行のリードコマンドまたはライトコマンドの対象となるバンクとが異なるか否かを判定する判定部を備え、
前記判定部により異なると判定された場合には、前記選択部は、前記第１発行モードおよび前記第２発行モードのうちの一方を選択する
請求項１に記載のメモリコントローラ。

【請求項3】

前記判定部により未発行コマンドが存在しないと判定された場合に、前記選択部は前記第１発行モードを選択する
請求項２に記載のメモリコントローラ。

【請求項4】

複数のバンクを有するＳＤＲＡＭへのアクセスを制御するメモリコントローラであって、
アクセスマスターからメモリアクセス要求を受け付ける受付部と、
コマンド発行に関する第１発行モードおよび第２発行モードのうちの一方を選択する選択部と、
選択した発行モードに従って前記メモリアクセス要求に対応するコマンド列を前記ＳＤＲＡＭに発行する発行部と、を備え、
前記第１発行モードは、バンクを活性化するアクティベートコマンドを分割しないで連続するクロックサイクルで発行するモードであり、
前記第２発行モードは、バンクを活性化するアクティベートコマンドを分割して連続しないクロックサイクルで発行するモードであり、
前記第１発行モードまたは前記第２発行モードを指定するフラグ情報を保持するメモリを備え、
前記選択部は、前記メモリからフラグ情報を読み出し、読み出した前記フラグ情報に従って前記第１発行モードおよび前記第２発行モードの一方を選択し、
前記フラグ情報は、複数のアクセスマスターのそれぞれに対応して前記メモリに保存され、
前記選択部は、受け付けたメモリアクセス要求の要求元のアクセスマスターに対応するフラグ情報を読み出し、読み出した前記フラグ情報に従って前記第１発行モードおよび前記第２発行モードの一方を選択する
メモリコントローラ。

【請求項5】

前記メモリアクセス要求を受け付けたとき、先行するメモリアクセス要求に対応する未発行のコマンドが存在するか否かを判定し、未発行のコマンドが存在すると判定した場合には、受け付けたメモリアクセス要求の対象となるバンクと、未発行のリードコマンドまたはライトコマンドの対象となるバンクとが異なるか否かを判定する判定部を備え、
前記判定部により異なると判定された場合には、前記選択部は、前記第１発行モードおよび前記第２発行モードのうちの一方を選択する
請求項４に記載のメモリコントローラ。

【請求項6】

前記判定部により未発行コマンドが存在しないと判定された場合に、前記選択部は前記第１発行モードを選択する
請求項５に記載のメモリコントローラ。

【請求項7】

前記受付部は、前記第１発行モードまたは前記第２発行モードを指定するモード指定コマンドを受け付け、前記モード指定コマンドに従って前記フラグ情報を生成しメモリに保存する
請求項４から６のいずれか１項に記載のメモリコントローラ。

【請求項8】

複数のバンクを有するＳＤＲＡＭへのアクセスを制御するメモリアクセス制御方法であって、
アクセスマスターからメモリアクセス要求を受け付け、
コマンド発行に関する第１発行モードおよび第２発行モードのうちの一方を選択し、
選択した発行モードに従って前記メモリアクセス要求に対応するコマンド列を前記ＳＤＲＡＭに発行し、
前記第１発行モードは、バンクを活性化するアクティベートコマンドを分割しないで連続するクロックサイクルで発行するモードであり、
前記第２発行モードは、バンクを活性化するアクティベートコマンドを分割して連続しないクロックサイクルで発行するモードであり、
前記発行モードの選択において、
受け付けたメモリアクセス要求の要求元が、複数のアクセスマスターのうちの第１アクセスマスターである場合は、前記第１発行モードを選択し、
受け付けたメモリアクセス要求の要求元が、前記複数のアクセスマスターのうちの第２アクセスマスターである場合は、前記第２発行モードを選択する、
メモリアクセス制御方法。

【請求項9】

前記メモリアクセス要求が受け付けられたとき、先行するメモリアクセス要求に対応する未発行のコマンドが存在するか否かを判定し、
未発行のコマンドが存在すると判定した場合には、受け付けたメモリアクセス要求の対象となるバンクと、未発行のコマンドの対象となるバンクとが異なるか否かを判定し、
異なると判定した場合には、前記発行モードの選択において前記第１発行モードおよび前記第２発行モードのうちの一方を選択する
請求項８に記載のメモリアクセス制御方法。

【請求項10】

未発行のコマンドが存在しないと判定した場合には、前記選択において前記第１発行モードを選択する
請求項９に記載のメモリアクセス制御方法。

【請求項11】

複数のバンクを有するＳＤＲＡＭへのアクセスを制御するメモリアクセス制御方法であって、
アクセスマスターからメモリアクセス要求を受け付け、
コマンド発行に関する第１発行モードおよび第２発行モードのうちの一方を選択し、
選択した発行モードに従って前記メモリアクセス要求に対応するコマンド列を前記ＳＤＲＡＭに発行し、
前記第１発行モードは、バンクを活性化するアクティベートコマンドを分割しないで連続するクロックサイクルで発行するモードであり、
前記第２発行モードは、バンクを活性化するアクティベートコマンドを分割して連続しないクロックサイクルで発行するモードであり、
前記発行モードの選択において、前記第１発行モードまたは前記第２発行モードを指定するフラグ情報を保持するメモリからフラグ情報を読み出し、読み出した前記フラグ情報に従って前記第１発行モードおよび前記第２発行モードの一方を選択し、
前記フラグ情報は、複数のアクセスマスターのそれぞれに対応して前記メモリに保存され、
前記発行モードの選択において、受け付けたメモリアクセス要求の要求元のアクセスマスターに対応するフラグ情報を読み出し、
読み出した前記フラグ情報に従って前記第１発行モードおよび前記第２発行モードの一方を選択する
メモリアクセス制御方法。

【請求項12】

前記メモリアクセス要求が受け付けられたとき、先行するメモリアクセス要求に対応する未発行のコマンドが存在するか否かを判定し、
未発行のコマンドが存在すると判定した場合には、受け付けたメモリアクセス要求の対象となるバンクと、未発行のコマンドの対象となるバンクとが異なるか否かを判定し、
異なると判定した場合には、前記発行モードの選択において前記第１発行モードおよび前記第２発行モードのうちの一方を選択する
請求項１１に記載のメモリアクセス制御方法。

【請求項13】

未発行のコマンドが存在しないと判定した場合には、前記選択において前記第１発行モードを選択する
請求項１２に記載のメモリアクセス制御方法。

【請求項14】

前記第１発行モードまたは前記第２発行モードを指定するモード指定コマンドを受け付け、
前記モード指定コマンドに従って前記フラグ情報を生成しメモリに保存する
請求項１１から１３のいずれか１項に記載のメモリアクセス制御方法。

【発明の詳細な説明】

【技術分野】

【0001】

本発明は、ＳＤＲＡＭへのアクセスを制御するメモリコントローラおよびメモリアクセス制御方法に関する。

【背景技術】

【0002】

特許文献１は、ＳＤＲＡＭ（Synchronous Dynamic Random Access Memory）の同一のバンクに連続してアクセスすることを防止し処理時間を向上させるメモリ制御装置を提案している。

【0003】

特許文献２は、同じバンクの同じローに対する連続アクセスが発生した場合の、ＳＤＲＡＭに対するアクセスに要するクロックサイクルを削減して、効率の良いメモリアクセスをなし得るアクセス制御装置を提案している。

【先行技術文献】

【特許文献】

【0004】

【文献】特開２００４－２５２９６０号公報

【文献】特開２００４－０１３６１８号公報

【発明の概要】

【発明が解決しようとする課題】

【0005】

しかしながら、上記特許文献１および特許文献２のメモリコントローラには改善の余地がある。

【0006】

そこで、本開示では、さらなる改善を図ることが可能なメモリコントローラおよびメモリアクセス制御方法を提供する。

【課題を解決するための手段】

【0007】

本開示の一態様に係るメモリコントローラは、複数のバンクを有するＳＤＲＡＭへのアクセスを制御するメモリコントローラであって、アクセスマスターからメモリアクセス要求を受け付ける受付部と、コマンド発行に関する第１発行モードおよび第２発行モードのうちの一方を選択する選択部と、選択した発行モードに従って前記メモリアクセス要求に対応するコマンド列を前記ＳＤＲＡＭに発行する発行部と、を備え、前記第１発行モードは、バンクを活性化するアクティベートコマンドを分割しないで連続するクロックサイクルで発行するモードであり、前記第２発行モードは、バンクを活性化するアクティベートコマンドを分割して連続しないクロックサイクルで発行するモードである。

【0008】

また、本開示の一態様に係るメモリアクセス制御方法は、複数のバンクを有するＳＤＲＡＭへのアクセスを制御するメモリアクセス制御方法であって、アクセスマスターからメモリアクセス要求を受け付け、コマンド発行に関する第１発行モードおよび第２発行モードのうちの一方を選択し、選択した発行モードに従って前記メモリアクセス要求に対応するコマンド列を前記ＳＤＲＡＭに発行し、前記第１発行モードは、バンクを活性化するアクティベートコマンドを分割しないで連続するクロックサイクルで発行するモードであり、前記第２発行モードは、バンクを活性化するアクティベートコマンドを分割して連続しないクロックサイクルで発行するモードである。

【0009】

なお、これらの包括的または具体的な態様は、システム、方法、集積回路、コンピュータプログラムまたはコンピュータ読み取り可能なＣＤ－ＲＯＭなどの記録媒体で実現され
てもよく、システム、方法、集積回路、コンピュータプログラムおよび記録媒体の任意な組み合わせで実現されてもよい。

【発明の効果】

【0010】

本開示の一態様に係るメモリコントローラおよびメモリアクセス制御方法によれば、さらなる改善を図ることができる。

【図面の簡単な説明】

【0011】

【図1】図１は、実施の形態におけるメモリコントローラ、アクセスマスターおよびＳＤＲＡＭを含むシステムの構成例を示すブロック図である。

【図2】図２は、実施の形態におけるメモリコントローラの動作例を示すタイムチャートである。

【図3】図３は、実施の形態におけるメモリコントローラの動作例を示すフローチャートである。

【図4】図４は、実施の形態における選択部の動作例を示すフローチャートである。

【図5】図５は、実施の形態における選択部の他の動作例を示すフローチャートである。

【発明を実施するための形態】

【0012】

（本開示の一態様を得るに至った経緯）
本発明者は、「背景技術」の欄において記載したＳＤＲＡＭである半導体メモリデバイスに関し、以下の問題が生じることを見出した。

【0013】

ＬＰＤＤＲ５（Low Power Double Data Rate 5）と呼ばれるＳＤＲＡＭ規格では、新たなクロックシステムが導入され、それに伴い、コマンド発行の仕様も変更されている。

【0014】

各種コマンドは、クロックの両エッジ（立ち上がりエッジと立ち下りエッジ）に同期してメモリコントローラからＳＤＲＡＭに発行される。各種コマンドのうちアクティベートコマンドは、ＳＤＲＡＭ内の指定されたバンク上のローを活性化するためのコマンドであり、２サイクル長で構成される。このアクティベートコマンドは、１サイクル長の２つのコマンドに分割可能である。２つに分割された部分的なコマンドを、ＡＣＴ１コマンドとＡＣＴ２コマンドとする。ＡＣＴ１コマンドとＡＣＴ２コマンドは、不連続な２サイクルで発行可能である。ＡＣＴ１コマンドとＡＣＴ２コマンドとは、最大８サイクルの間を置くことができる。

【0015】

また、リードコマンド、ライトコマンド等は、１サイクル長で構成される。ＬＰＤＤＲ５のリードコマンドおよびライトコマンドの標準的な最小アクセス単位であるバースト長は１６ビートである。なお、データバスのクロック信号は、コマンドバスのクロック信号の４倍速である。上記の１６ビートは、データバスのクロック信号の８サイクルであり、コマンドバスのクロック信号の２サイクルである。

【0016】

１６ビートのバースト長のリードまたはライトを複数回連続実行するためには、コマンドバスの２サイクル毎に１回（つまり１サイクル置きに）リードコマンドまたはライトコマンドを発行すればよい。

【0017】

ところが、先行するアクセス要求のコマンド発行と、後行するアクセス要求のコマンド発行とが競合する場合には次の問題が生じ得る。例えば、先行するアクセス要求の連続アクセスの際中に、後行するアクセス要求に対応する新たなバンクにアクセスするためのアクティベートコマンド（２サイクル長）を発行すると、アクティベートコマンドを発行したタイミングの前後のリードコマンドまたはライトコマンドは、２サイクルの間が空くの
で、データバスにバブルが発生し、連続アクセスできなくなりデータバスの効率を悪化させる。

【0018】

この場合のバブルの発生は、１サイクル（データバスクロックでは４サイクル）であり、単発のアクセス要求では、わずかであるかもしれない。しかし、例えば動画のエンコードやデコードなど大量のデータアクセスを伴う処理で、頻繁に新たなバンクに対してアクティベートコマンドを発行する場合には、発生するバブルによるＳＤＲＡＭへのアクセスの効率劣化が発生する。

【0019】

そこで、本開示は、アクティベートコマンドが分割可能であることを利用して、ＳＤＲＡＭアクセス性能の最適化を図る。

【0020】

このような問題を解決するために、本開示の一態様に係るメモリコントローラは、（複数のバンクを有するＳＤＲＡＭへのアクセスを制御するメモリコントローラであって、アクセスマスターからメモリアクセス要求を受け付ける受付部と、コマンド発行に関する第１発行モードおよび第２発行モードのうちの一方を選択する選択部と、選択した発行モードに従って前記メモリアクセス要求に対応するコマンド列を前記ＳＤＲＡＭに発行する発行部と、を備え、前記第１発行モードは、バンクを活性化するアクティベートコマンドを分割しないで連続するクロックサイクルで発行するモードであり、前記第２発行モードは、バンクを活性化するアクティベートコマンドを分割して連続しないクロックサイクルで発行するモードである。

【0021】

これによれば、さらなる改善を図ることができる。例えば、アクティベートコマンドを分割しない第１発行モードとアクティベートコマンドを分割する第２発行モードとを選択可能にすることによりアクセス効率を最適化することが可能である。例えば、メモリデータを処理する用途に応じて第１発行モードと第２発行モードとを選択可能にすることにより最適化することが可能である。

【0022】

ここで、前記メモリアクセス要求を受け付けたとき、先行するメモリアクセス要求に対応する未発行のコマンドが存在するか否かを判定し、未発行のコマンドが存在すると判定した場合には、受け付けたメモリアクセス要求の対象となるバンクと、未発行のリードコマンドまたはライトコマンドの対象となるバンクとが異なるか否かを判定する判定部を備え、前記判定部により異なると判定された場合には、前記選択部は、前記第１発行モードおよび前記第２発行モードのうちの一方を選択してもよい。

【0023】

これによれば、第１発行モードおよび第２発行モードそれぞれのメリットとデメリットとを選択により最適化することができる。

【0024】

第１発行モードでは、先行するアクセス要求の連続アクセスにバブルが発生しバス効率が劣化する半面、後続するアクセス要求の異なるバンクのリードデータまたはライトデータは最小のレイテンシにすることができる。

【0025】

一方、第２発行モードでは、先行するアクセス要求の連続アクセスを保証できバス効率を劣化させない半面、後続するアクセス要求のリードデータまたはライトデータは最小のレイテンシに１サイクルの遅延が発生する。

【0026】

言い換えれば、第１発行モードでは、後続するアクセス要求のレイテンシの最小化を優先する。第２発行モードでは、先行するアクセス要求の連続アクセスを保証しデータバスの効率を優先する。

【0027】

ここで、前記判定部により未発行コマンドが存在しないと判定された場合に、前記選択部は前記第１発行モードを選択してもよい。

【0028】

これによれば、先行アクセス要求のコマンドと、後行アクセス要求のコマンドとが競合しない場合には、後行のアクセス要求を第１発行モードにするので、先行アクセス要求の連続アクセスを保証し、かつ、後行アクセス要求のレイテンシを最小にすることができる。

【0029】

ここで、前記選択部は、受け付けたメモリアクセス要求の要求元が、複数のアクセスマスターのうちの第１アクセスマスターである場合は、前記第１発行モードを選択し、受け付けたメモリアクセス要求の要求元が、前記複数のアクセスマスターのうちの第２アクセスマスターである場合は、前記第２発行モードを選択してもよい。

【0030】

これによれば、アクセスマスターと発行モードとを対応づけているので、それぞれのアクセスマスター個別に最適な発行モードを選択することができる。

【0031】

ここで、前記受付部は、前記第１発行モードまたは前記第２発行モードを指定するモード指定コマンドを受け付け、前記選択部は、前記モード指定コマンドに従って前記第１発行モードおよび前記第２発行モードの一方を選択してもよい。

【0032】

これによれば、モード指定コマンドにより最適な発行モードを選択することができる。

【0033】

ここで、前記第１発行モードまたは前記第２発行モードを指定するフラグ情報を保持するメモリを備え、前記選択部は、前記メモリからフラグ情報を読み出し、読み出した前記フラグ情報に従って前記第１発行モードおよび前記第２発行モードの一方を選択してもよい。

【0034】

これによれば、フラグ情報により最適な発行モードを高速に選択することができる。

【0035】

ここで、前記受付部は、前記第１発行モードまたは前記第２発行モードを指定するモード指定コマンドを受け付け、前記モード指定コマンドに従って前記フラグ情報を生成しメモリに保存してもよい。

【0036】

これによれば、モード指定コマンドによりフラグ情報を設定することができ、より最適な発行モードを選択することができる。

【0037】

ここで、前記受付部は、前記アクセスマスターまたは他の装置から前記モード指定コマンドを受け付けてもよい。

【0038】

これによれば、モード指定コマンドを発行可能な装置が複数あるので、システムの柔軟さを向上させることができる。

【0039】

ここで、前記フラグ情報は、複数のアクセスマスターのそれぞれに対応して前記メモリに保存され、前記選択部は、受け付けたメモリアクセス要求の要求元のアクセスマスターに対応するフラグ情報を読み出し、読み出した前記フラグ情報に従って前記第１発行モードおよび前記第２発行モードの一方を選択してもよい。

【0040】

これによれば、フラグ情報とアクセスマスターとを対応づけているので、それぞれのアクセスマスター個別に最適な発行モードを選択することができる。

【0041】

また、本開示の本開示の一態様に係るメモリアクセス制御方法は、複数のバンクを有するＳＤＲＡＭへのアクセスを制御するメモリアクセス制御方法であって、アクセスマスターからメモリアクセス要求を受け付け、コマンド発行に関する第１発行モードおよび第２発行モードのうちの一方を選択し、選択した発行モードに従って前記メモリアクセス要求に対応するコマンド列を前記ＳＤＲＡＭに発行し、前記第１発行モードは、バンクを活性化するアクティベートコマンドを分割しないで連続するクロックサイクルで発行するモードであり、前記第２発行モードは、バンクを活性化するアクティベートコマンドを分割して連続しないクロックサイクルで発行するモードである。

【0042】

これによれば、例えば、メモリデータを処理する用途に応じて第１発行モードと第２発行モードとを選択可能にすることにより最適化することが可能である。

【0043】

ここで、前記メモリアクセス要求が受け付けられたとき、先行するメモリアクセス要求に対応する未発行のコマンドが存在するか否かを判定し、未発行のコマンドが存在すると判定した場合には、受け付けたメモリアクセス要求の対象となるバンクと、未発行のコマンドの対象となるバンクとが異なるか否かを判定し、異なると判定した場合には、前記発行モードの選択において前記第１発行モードおよび前記第２発行モードのうちの一方を選択してもよい。

【0044】

これによれば、第１発行モードおよび第２発行モードそれぞれのメリットとデメリットとを選択により最適化することができる。

【0045】

第１発行モードでは、先行するアクセス要求の連続アクセスにバブルが発生しバス効率が劣化する半面、後続するアクセス要求の異なるバンクのリードデータまたはライトデータは最小のレイテンシにすることができる。

【0046】

一方、第２発行モードでは、先行するアクセス要求の連続アクセスを保証できバス効率を劣化させない半面、後続するアクセス要求のリードデータまたはライトデータは最小のレイテンシに１サイクルの遅延が発生する。

【0047】

言い換えれば、第１発行モードでは、後続するアクセス要求のレイテンシの最小化を優先する。第２発行モードでは、先行するアクセス要求の連続アクセスを保証しデータバスの効率を優先する。

【0048】

ここで、未発行のコマンドが存在しないと判定した場合には、前記選択において前記第１発行モードを選択してもよい。

【0049】

これによれば、先行アクセス要求のコマンドと、後行アクセス要求のコマンドとが競合しない場合には、後行のアクセス要求を第１発行モードにするので、先行アクセス要求の連続アクセスを保証し、かつ、後行アクセス要求のレイテンシを最小にすることができる。

【0050】

ここで、 前記発行モードの選択において、受け付けたメモリアクセス要求の要求元が、複数のアクセスマスターのうちの第１アクセスマスターである場合は、前記第１発行モードを選択し、受け付けたメモリアクセス要求の要求元が、前記複数のアクセスマスターのうちの第２アクセスマスターである場合は、前記第２発行モードを選択してもよい。

【0051】

これによれば、アクセスマスターと発行モードとを対応づけているので、それぞれのアクセスマスター個別に最適な発行モードを選択することができる。

【0052】

ここで、さらに、前記第１発行モードまたは前記第２発行モードを指定するモード指定コマンドを受け付け、前記発行モードの選択において、前記モード指定コマンドに従って前記第１発行モードおよび前記第２発行モードの一方を選択してもよい。

【0053】

これによれば、モード指定コマンドにより最適な発行モードを選択することができる。

【0054】

ここで、前記発行モードの選択において、前記第１発行モードまたは前記第２発行モードを指定するフラグ情報を保持するメモリからフラグ情報を読み出し、読み出した前記フラグ情報に従って前記第１発行モードおよび前記第２発行モードの一方を選択してもよい。

【0055】

これによれば、フラグ情報により最適な発行モードを選択することができる。

【0056】

ここで、 前記第１発行モードまたは前記第２発行モードを指定するモード指定コマンドを受け付け、前記モード指定コマンドに従って前記フラグ情報を生成しメモリに保存してもよい。

【0057】

これによれば、モード指定コマンドによりフラグ情報を設定することができ、より最適な発行モードを選択することができる。

【0058】

ここで、前記アクセスマスターまたは他の装置から前記モード指定コマンドを受け付けてもよい。

【0059】

これによれば、モード指定コマンドを発行可能な装置が複数あるので、システムの柔軟さを向上させることができる。

【0060】

ここで、前記フラグ情報は、複数のアクセスマスターのそれぞれに対応して前記メモリに保存され、前記発行モードの選択において、受け付けたメモリアクセス要求の要求元のアクセスマスターに対応するフラグ情報を読み出し、読み出した前記フラグ情報に従って前記第１発行モードおよび前記第２発行モードの一方を選択してもよい。

【0061】

これによれば、フラグ情報とアクセスマスターとを対応づけているので、それぞれのアクセスマスター個別に最適な発行モードを選択することができる。

【0062】

なお、これらの包括的または具体的な態様は、システム、方法、集積回路、コンピュータプログラムまたはコンピュータ読み取り可能なＣＤ－ＲＯＭなどの記録媒体で実現されてもよく、システム、方法、集積回路、コンピュータプログラムまたは記録媒体の任意な組み合わせで実現されてもよい。

【0063】

以下、実施の形態について、図面を参照しながら具体的に説明する。

【0064】

なお、以下で説明する実施の形態は、いずれも包括的または具体的な例を示すものである。以下の実施の形態で示される数値、形状、材料、構成要素、構成要素の配置位置及び接続形態、ステップ、ステップの順序などは、一例であり、本発明を限定する主旨ではない。

【0065】

（実施の形態）
［１．１ 構成例］
図１は、実施の形態におけるメモリコントローラ、アクセスマスターおよびＳＤＲＡＭを含むシステムの構成例を示すブロック図である。

【0066】

同図のシステムは、ＳＤＲＡＭ１、メモリコントローラ２および複数のアクセスマスター３を備える。

【0067】

ＳＤＲＡＭ１は、複数のメモリアレイ１１と、コマンド実行回路１２とを備える。

【0068】

複数のメモリアレイ１１は、バンク０からバンク（ｎー１）までのｎ個のバンクを構成する。複数のメモリアレイ１１のそれぞれは、行列状に配置されたメモリセルと、センスアンプとを含む。

【0069】

コマンド実行回路１２は、メモリコントローラ２から発行される各種コマンドを受信および実行する。

【0070】

ＳＤＲＡＭ１は、ＬＰＤＤＲ５に準拠するＳＤＲＡＭであるものとする。特に、ＳＤＲＡＭ１が実行可能な、アクティベートコマンドは２サイクル長であり、１サイクル長の２つに分割可能である。２サイクル長の分割されていないアクティベートコマンドをＡＣＴコマンドと記す。分割されたアクティベートコマンドを、ＡＣＴ１コマンド、ＡＣＴ２コマンドと記す。アクティベートコマンドは、バンクアドレスとローアドレスとを含み、バンク内のローを活性化するためのコマンドである。コマンド実行回路１２は、ＡＣＴコマンドを受信すると、バンクアドレスで指定されたバンクを選択し、当該バンク内のローアドレスで指定されたローに属するメモリセルのデータを、センスアンプに転送する。

【0071】

また、データバスのクロック信号は、コマンドバスのクロック信号の４倍速である。最小アクセス単位である連続バースト長は１６ビート（データ用のクロック信号の８サイクルであり、コマンド用のクロック信号で２サイクル）である。データ用のクロック信号は差動信号であり、コマンド用のクロック信号も差動信号である。

【0072】

また、リードコマンドは１サイクル長であり、ライトコマンドも１サイクル長である。

【0073】

メモリコントローラ２は、受付部２１、判定部２２、選択部２３、発行部２４、フラグメモリ２５を備える。

【0074】

受付部２１は、複数のアクセスマスター３のそれぞれからメモリアクセス要求を受け付ける。

【0075】

判定部２２は、受付部２１が受け付けたメモリアクセス要求に対応するコマンドを発行すべきタイミングと、先行するメモリアクセス要求に対応するコマンドを発行すべきタイミングとが競合するか否かを判定する。具体的には、判定部２２は、受付部２１がメモリアクセス要求を受け付けた時、先行するメモリアクセス要求に対応する未発行のリードコマンドまたはライトコマンドが発行部２４に存在するか否かを判定する。さらに、判定部２２は、未発行のリードコマンドまたはライトコマンドが存在すると判定した場合には、受け付けたメモリアクセス要求の対象となるバンクと、未発行のリードコマンドまたはライトコマンドの対象となるバンクとが異なるか否かを判定する。

【0076】

選択部２３は、判定部２２の判定結果に応じて、コマンド発行に関する第１発行モードおよび第２発行モードのうちの一方を選択する。ここで、第１発行モードは、バンクを活性化するアクティベートコマンドを分割しないで連続する２クロックサイクルで発行するモードである。第２発行モードは、バンクを活性化するアクティベートコマンドを分割して連続しない２クロックサイクルで発行するモードである。なお、選択部２３は、フラグメモリ２５からフラグ情報を読み出し、読み出したフラグ情報に従って第１発行モードお
よび第２発行モードの一方を選択してもよい。フラグ情報は、第１発行モードまたは第２発行モードを指定する情報である。なお、コマンドを分割する例として、アクティベートコマンドを２つに分割する例を取り上げるが、分割数は３以上であってもよいし、アクティベートコマンド以外のコマンドであってもよい。

【0077】

発行部２４は、受付部２１が受け付けたメモリアクセス要求を実現するために、ＳＤＲＡＭ１が解読および実行可能なコマンド列を生成し、コマンド列に含まれる各コマンドをＳＤＲＡＭ１の仕様として規定されたタイミングで順次ＳＤＲＡＭ１に発行する。このとき、発行部２４は、選択部２３で選択された発行モードに従ってコマンド列を発行する。つまり、選択部２３が第１発行モードを選択している場合は、発行部２４は、アクティベートコマンドを分割しないで連続する２クロックサイクルで発行する。一方、選択部２３が第２発行モードを選択している場合は、発行部２４は、アクティベートコマンドを分割して連続しない２以上のクロックサイクルで発行する。

【0078】

フラグメモリ２５は、第１発行モードまたは第２発行モードを指定するフラグ情報を保持する。なお、フラグメモリ２５は、工場出荷時に書き込まれるフラグ情報を記憶する不揮発メモリであってもよい。また、フラグメモリ２５は、システムの電源オン時、および、リセット時に、初期化処理で書き込まれるフラグ情報を保持するレジスタであってもよい。レジスタのフラグ情報は、外部の装置からの書き換え可能であってもよい。

【0079】

複数のアクセスマスター３のそれぞれは、具体的には、ビデオデコーダ、ビデオエンコーダ、オーディオデコーダ、オーディオエンコーダ、ＣＰＵ、キャッシュメモリ、ＤＭＡＣ（Direct Memory Access Controller）、グラフィックスコントローラ、ＤＳＰ（Digital Signal Processor）などである。各アクセスマスター３は、メモリアクセス要求をメモリコントローラ２に送信する。

【0080】

［２．１ 全体動作例］
以上のように構成されたメモリコントローラ２の動作について説明する。

【0081】

図２は、実施の形態におけるメモリコントローラ２の動作例を示すタイムチャートである。図中のクロック信号ＣＬＫｐは、コマンドバスの差動クロック信号に含まれるプラス側の信号を示す。マイナス側のクロック信号ＣＬＫｎは図示を省略している。

【0082】

コマンド欄は、コマンド名を示している。バンク欄は、コマンド中のバンクアドレスで指定されるバンク名を示す。データバス欄は、リードコマンドに対応するリードデータを示す。

【0083】

同図中の白背景の黒文字のコマンド、バンクは、先行するメモリアクセス要求に対応するコマンド、バンクを示す。黒背景の白文字の各コマンドは後行するメモリアクセス要求に対応するコマンドを示す。

【0084】

リードコマンドＲＤ０～ＲＤ３は、先行するメモリアクセス要求に対応し、バンクＭへのリードコマンドである。ＲＬ（Read Latency）は、リードコマンドのサイクルからリードデータが主力されるサイクルまでの遅延サイクル数を示す。

【0085】

リードデータＤ０～Ｄ３は、リードコマンドＲＤ０～ＲＤ３に従ってバンクＭから読み出されたリードデータである。リードデータＤ０～Ｄ３のそれぞれは、最小アクセス単位である連続バースト長の１６ビートのデータを示している。

【0086】

同図上段の（ａ）は、第１発行モードに従うコマンド列を示している。また、同図の（
ｂ）は、第２発行モードに従うコマンド列を示している。

【0087】

アクティベートコマンドＡＣＴは、後行するメモリアクセス要求に対応し、分割されていない２サイクル長のコマンドであり、バンクＮの活性化を示す。このアクティベートコマンドＡＣＴは、先行メモリアクセス要求の未発行のリードコマンドＲＤ３と競合する。

【0088】

同図の（ａ）の第１発行モードでは、アクティベートコマンドＡＣＴは、先行するアクセス要求のリードコマンドＲＤ３よりも優先的に発行される。リードコマンドＲＤ３は、アクティベートコマンドＡＣＴの次に発行される。

【0089】

このように、第１発行モードでは、先行するアクセス要求の連続アクセスにバブルが発生し、先行するアクセス要求でのバス効率が劣化する。その半面、後行するアクセス要求の異なるバンクのリードデータまたはライトデータは最小のレイテンシにすることができる。

【0090】

同図の（ｂ）の第２発行モードでは、アクティベートコマンドはＡＣＴ１とＡＣＴ２に分割される。先行するアクセス要求のリードコマンドＲＤ３は、リードコマンドＲＤ２の発行から１サイクル置いたサイクルで発行され、アクティベートコマンドＡＣＴ１とＡＣＴ２の間に発行される。リードコマンドＲＤ３も、１サイクル置きの発行間隔が維持される。その結果、最小アクセス単位を途切れさせないでリードデータＤ２とＤ３とを連続させることができる。

【0091】

このように、第２発行モードでは、先行するアクセス要求の連続アクセスを維持でき、先行するアクセス要求でのバス効率を劣化させない。その半面、後行するアクセス要求のリードデータまたはライトデータは最小のレイテンシに１サイクルの遅延が発生する。これはＡＣＴ２が、第１発行モードと比べて、１サイクルだけ後ろにずれるからである。

【0092】

図２に示すように、第１発行モードでは、後続するアクセス要求のレイテンシの最小化を優先する。第２発行モードでは、先行するアクセス要求の連続アクセスを保証しデータバスの効率を優先する。こうして、メモリコントローラ２は、第１発行モードおよび第２発行モードそれぞれのメリットとデメリットとを選択により最適化することができる。

【0093】

図３は、実施の形態におけるメモリコントローラ２の動作例を示すフローチャートである。図３において、受付部２１は、いずれかのアクセスマスター３からメモリアクセス要求を付け付ける（Ｓ１）。判定部２２は、受付部２１でメモリアクセス要求が受け付けられたとき、先行するメモリアクセス要求に対応する未発行のコマンドが存在するか否かを判定し（Ｓ２）、未発行のコマンドが存在すると判定した場合には、受け付けたメモリアクセス要求の対象となるバンクと、未発行のリードコマンドまたはライトコマンドの対象となるバンクとが異なるか否かを判定する（Ｓ３）。なお、ここでいう未発行のコマンドは、未発行のリードコマンドまたは未発行のライトコマンドでよい。

【0094】

判定部２２によりバンクが異なると判定された場合には（Ｓ３でｙｅｓ）、選択部２３は、フラグメモリ２５のフラグ情報等に基づいて第１発行モードおよび前記第２発行モードのうちの一方を選択する（Ｓ４）。

【0095】

つづいて、発行部２４は、選択部２３が第１発行モードを選択している場合は、アクティベートコマンドＡＣＴを分割しないで連続する２クロックサイクルで発行し（Ｓ１１）、先行するメモリアクセス要求の未発行のコマンドを次の１サイクルで発行する（Ｓ１２）。さらに、発行部２４は、後行するメモリアクセス要求のコマンド列に含まれる残りのリードコマンドまたはライドコマンドを順次発行する（Ｓ１３）。

【0096】

一方、発行部２４は、選択部２３が第２発行モードを選択している場合は、アクティベートコマンドをＡＣＴ１とＡＣＴ２とに分割し（Ｓ２１）、連続しない２以上のクロックサイクルで発行する。つまり、発行部２４は、まずアクティベートコマンドＡＣＴ１を1サイクルで発行し（Ｓ２２）、先行するメモリアクセス要求の未発行のコマンドを次の１サイクルで発行し（Ｓ２３）する。さらに、発行部２４は、アクティベートコマンドＡＣＴ２を1サイクルで発行する（Ｓ２４）。その後、発行部２４は、後行するメモリアクセス要求のコマンド列に含まれる残りのリードコマンドまたはライドコマンドを順次発行する（Ｓ２５）。

【0097】

このように、図３のフローチャートによれば、メモリコントローラ２は、図２のタイムチャートと同様に動作することができる。第１発行モードでは、後行するアクセス要求のレイテンシの最小化を優先する。第２発行モードでは、先行するアクセス要求の連続アクセスを保証しデータバスの効率を優先する。こうして、メモリコントローラ２は、第１発行モードおよび第２発行モードそれぞれのメリットとデメリットとを選択により最適化することができる。

【0098】

また、判定部２２により未発行コマンドが存在しないと判定された場合（Ｓ２でｎｏ）、、選択部２３はデフォルトとして第１発行モードを選択する。

【0099】

これによれば、先行アクセス要求のコマンドと、後行アクセス要求のコマンドとが競合しない場合には、後行のアクセス要求を第１発行モードにするので、先行アクセス要求の連続アクセスを保証し、かつ、後行アクセス要求のレイテンシを最小にすることができる。

【0100】

また、判定部２２によりバンクが異ならないと判定された場合には（Ｓ３でｎｏ）、受け付けたメモリアクセス要求の対象となるローと、未発行のリードコマンドまたはライトコマンドの対象となるローとが同じか否かを判定する（Ｓ３１）。同じであると判定した場合には（Ｓ３１でｙｅｓ）、ステップＳ２５に進む。この場合、先行するメモリアクセス要求の未発行コマンドは、ステップＳ２５における後行するメモリアクセス要求のコマンド列の発行の前後または合間に、発行すればよい。一方、ローが異なると判定した場合には（Ｓ３１でｎｏ）、先行するメモリアクセス要求の未発行コマンドを発行し（Ｓ３２）、プリチャージコマンドを発行して（Ｓ３３）当該バンクを一旦閉じてから、当該バンク内の異なるローに対するＡＣＴコマンドを発行し（Ｓ３４）、ステップＳ２５に進む。

【0101】

［２．２ 選択動作例］
次に、図３のステップＳ４の動作例について説明する。

【0102】

図４は、実施の形態における選択部の動作例を示すフローチャートである。判定部２２によりバンクが異なると判定された場合に、選択部２３は、フラグメモリ２５のフラグ情報を読み出し（Ｓ４１）、フラグ情報に含まれるフラグＦ１が１であるか否かを判定する（Ｓ４２）。選択部２３は、フラグＦ１が１である場合は第１発行モードを選択し（Ｓ４３）、フラグＦ１が１でない場合は第２発行モードを選択する（Ｓ４４）。

【0103】

これによれば、選択部２３は、フラグ情報により最適な発行モードを高速に選択することができる。

【0104】

次に、図３のステップＳ４の他の動作例について説明する。

【0105】

図５は、実施の形態における選択部の他の動作例を示すフローチャートである。判定部
２２によりバンクが異なると判定された場合に、選択部２３は、メモリアクセス要求の要求元が、複数のアクセスマスター３のうちの第２アクセスマスターであるか否かを判定する（Ｓ５１）。選択部２３は、要求元が第２アクセスマスターであると判定したとき（Ｓ５１でｙｅｓ）、第２発行モードを選択する（Ｓ５２）。

【0106】

また、選択部２３は、メモリアクセス要求の要求元が第１アクセスマスターであるか否かを判定する（Ｓ５３）。選択部２３は、要求元が第１アクセスマスターであると判定したとき（Ｓ５３でｙｅｓ）、第１発行モードを選択する（Ｓ５４）。

【0107】

さらに、選択部２３は、要求元が第１アクセスマスターでも第２アクセスマスターでもないとき（Ｓ５３でｎｏ）、第１発行モードを選択する（Ｓ５５）。

【0108】

これによれば、アクセスマスターと発行モードとを対応付けているので、それぞれのアクセスマスター個別に最適な発行モードを選択することができる。

【0109】

なお、ステップＳ５５では、選択部２３は第２発行モードを選択してもよい。

【0110】

また、図２、図３では、メモリアクセス要求がメモリリードを要求する場合を説明したが、メモリアクセス要求がメモリライトを要求する場合も同様である。

【0111】

以上のように実施の形態におけるメモリコントローラ２によれば、アクティベートコマンドを分割しない第１発行モードと、アクティベートコマンドを分割する第２発行モードとを選択可能にすることによりアクセス効率を最適化することが可能である。

【0112】

以上説明してきたように、本開示に係るメモリコントローラ２は、複数のバンクを有するＳＤＲＡＭ１へのアクセスを制御するメモリコントローラであって、アクセスマスター３からメモリアクセス要求を受け付ける受付部２１と、コマンド発行に関する第１発行モードおよび第２発行モードのうちの一方を選択する選択部２３と、選択した発行モードに従ってメモリアクセス要求に対応するコマンド列をＳＤＲＡＭ１に発行する発行部２４と、を備え、第１発行モードは、バンクを活性化するアクティベートコマンドを分割しないで連続するクロックサイクルで発行するモードであり、第２発行モードは、バンクを活性化するアクティベートコマンドを分割して連続しないクロックサイクルで発行するモードである。

【0113】

これによれば、さらなる改善を図ることができる。例えば、アクティベートコマンドを分割しない第１発行モードとアクティベートコマンドを分割する第２発行モードとを選択可能にすることによりアクセス効率とレイテンシーとを最適化することが可能である。例えば、メモリデータを処理する用途に応じて第１発行モードと第２発行モードとを選択可能にすることにより最適化することが可能である。

【0114】

たとえば、メモリアクセス要求を受け付けたとき、先行するメモリアクセス要求に対応する未発行のコマンドが存在するか否かを判定し、未発行のコマンドが存在すると判定した場合には、受け付けたメモリアクセス要求の対象となるバンクと、未発行のリードコマンドまたはライトコマンドの対象となるバンクとが異なるか否かを判定する判定部２２を備え、判定部２３により異なると判定された場合には、選択部２３は、第１発行モードおよび第２発行モードのうちの一方を選択してもよい。

【0115】

これによれば、第１発行モードおよび第２発行モードそれぞれのメリットとデメリットとを選択により最適化することができる。

【0116】

第１発行モードでは、先行するアクセス要求の連続アクセスにバブルが発生しバス効率が劣化する半面、後続するアクセス要求の異なるバンクのリードデータまたはライトデータは最小のレイテンシにすることができる。

【0117】

一方、第２発行モードでは、先行するアクセス要求の連続アクセスを保証できバス効率を劣化させない半面、後続するアクセス要求のリードデータまたはライトデータは最小のレイテンシに１サイクルの遅延が発生する。

【0118】

言い換えれば、第１発行モードでは、後続するアクセス要求のレイテンシの最小化を優先する。第２発行モードでは、先行するアクセス要求の連続アクセスを保証しデータバスの効率を優先する。

【0119】

たとえば、判定部２２により未発行コマンドが存在しないと判定された場合に、選択部２３は第１発行モードを選択してもよい。

【0120】

これによれば、先行アクセス要求のコマンドと、後行アクセス要求のコマンドとが競合しない場合には、後行のアクセス要求を第１発行モードにするので、先行アクセス要求の連続アクセスを保証し、かつ、後行アクセス要求のレイテンシを最小にすることができる。

【0121】

たとえば、選択部２３は、受け付けたメモリアクセス要求の要求元が、複数のアクセスマスターのうちの第１アクセスマスターである場合は、第１発行モードを選択し、受け付けたメモリアクセス要求の要求元が、複数のアクセスマスターのうちの第２アクセスマスターである場合は、第２発行モードを選択してもよい。

【0122】

これによれば、アクセスマスターと発行モードとを対応づけているので、それぞれのアクセスマスター個別に最適な発行モードを選択することができる。

【0123】

たとえば、受付部２１は、第１発行モードまたは第２発行モードを指定するモード指定コマンドを受け付け、選択部２３は、モード指定コマンドに従って第１発行モードおよび第２発行モードの一方を選択してもよい。

【0124】

これによれば、モード指定コマンドにより最適な発行モードを選択することができる。

【0125】

たとえば、第１発行モードまたは第２発行モードを指定するフラグ情報を保持するメモリを備え、選択部２３は、メモリからフラグ情報を読み出し、読み出したフラグ情報に従って第１発行モードおよび第２発行モードの一方を選択してもよい。

【0126】

これによれば、フラグ情報により最適な発行モードを高速に選択することができる。

【0127】

たとえば、受付部２１は、第１発行モードまたは第２発行モードを指定するモード指定コマンドを受け付け、モード指定コマンドに従ってフラグ情報を生成しメモリに保存してもよい。

【0128】

これによれば、モード指定コマンドによりフラグ情報を設定することができ、より最適な発行モードを選択することができる。

【0129】

たとえば、受付部２１は、アクセスマスターまたは他の装置からモード指定コマンドを受け付けてもよい。

【0130】

これによれば、モード指定コマンドを発行可能な装置が複数あるので、システムの柔軟さを向上させることができる。

【0131】

たとえば、フラグ情報は、複数のアクセスマスターのそれぞれに対応してメモリに保存され、選択部２３は、受け付けたメモリアクセス要求の要求元のアクセスマスターに対応するフラグ情報を読み出し、読み出したフラグ情報に従って第１発行モードおよび第２発行モードの一方を選択してもよい。

【0132】

これによれば、フラグ情報とアクセスマスターとを対応づけているので、それぞれのアクセスマスター個別に最適な発行モードを選択することができる。

【0133】

以上説明してきたように、本開示に係るメモリアクセス制御方法は、複数のバンクを有するＳＤＲＡＭ１へのアクセスを制御するメモリアクセス制御方法であって、アクセスマスター３からメモリアクセス要求を受け付け、コマンド発行に関する第１発行モードおよび第２発行モードのうちの一方を選択し、選択した発行モードに従ってメモリアクセス要求に対応するコマンド列をＳＤＲＡＭに発行し、第１発行モードは、バンクを活性化するアクティベートコマンドを分割しないで連続するクロックサイクルで発行するモードであり、第２発行モードは、バンクを活性化するアクティベートコマンドを分割して連続しないクロックサイクルで発行するモードである。

【0134】

これによれば、さらなる改善を図ることができる。例えば、アクティベートコマンドを分割しない第１発行モードとアクティベートコマンドを分割する第２発行モードとを選択可能にすることによりアクセス効率とレイテンシーを最適化することが可能である。例えば、メモリデータを処理する用途に応じて第１発行モードと第２発行モードとを選択可能にすることにより最適化することが可能である。

【0135】

たとえば、メモリアクセス要求が受け付けられたとき、先行するメモリアクセス要求に対応する未発行のコマンドが存在するか否かを判定し、未発行のコマンドが存在すると判定した場合には、受け付けたメモリアクセス要求の対象となるバンクと、未発行のコマンドの対象となるバンクとが異なるか否かを判定し、異なると判定した場合には、発行モードの選択において第１発行モードおよび第２発行モードのうちの一方を選択してもよい。

【0136】

これによれば、第１発行モードおよび第２発行モードそれぞれのメリットとデメリットとを選択により最適化することができる。

【0137】

第１発行モードでは、先行するアクセス要求の連続アクセスにバブルが発生しバス効率が劣化する半面、後続するアクセス要求の異なるバンクのリードデータまたはライトデータは最小のレイテンシにすることができる。

【0138】

一方、第２発行モードでは、先行するアクセス要求の連続アクセスを保証できバス効率を劣化させない半面、後続するアクセス要求のリードデータまたはライトデータは最小のレイテンシに１サイクルの遅延が発生する。

【0139】

言い換えれば、第１発行モードでは、後続するアクセス要求のレイテンシの最小化を優先する。第２発行モードでは、先行するアクセス要求の連続アクセスを保証しデータバスの効率を優先する。

【0140】

たとえば、未発行のコマンドが存在しないと判定した場合には、、選択において第１発行モードを選択してもよい。

【0141】

これによれば、先行アクセス要求のコマンドと、後行アクセス要求のコマンドとが競合しない場合には、後行のアクセス要求を第１発行モードにするので、先行アクセス要求の連続アクセスを保証し、かつ、後行アクセス要求のレイテンシを最小にすることができる。

【0142】

たとえば、発行モードの選択において、受け付けたメモリアクセス要求の要求元が、複数のアクセスマスターのうちの第１アクセスマスターである場合は、第１発行モードを選択し、受け付けたメモリアクセス要求の要求元が、複数のアクセスマスターのうちの第２アクセスマスターである場合は、第２発行モードを選択してもよい。

【0143】

これによれば、アクセスマスターと発行モードとを対応づけているので、それぞれのアクセスマスター個別に最適な発行モードを選択することができる。

【0144】

たとえば、さらに、第１発行モードまたは第２発行モードを指定するモード指定コマンドを受け付け、発行モードの選択において、モード指定コマンドに従って第１発行モードおよび第２発行モードの一方を選択してもよい。

【0145】

これによれば、モード指定コマンドにより最適な発行モードを選択することができる。

【0146】

たとえば、発行モードの選択において、第１発行モードまたは第２発行モードを指定するフラグ情報を保持するメモリからフラグ情報を読み出し、読み出したフラグ情報に従って第１発行モードおよび第２発行モードの一方を選択してもよい。

【0147】

これによれば、フラグ情報により最適な発行モードを高速に選択することができる。

【0148】

たとえば、第１発行モードまたは第２発行モードを指定するモード指定コマンドを受け付け、モード指定コマンドに従ってフラグ情報を生成しメモリに保存してもよい。

【0149】

これによれば、モード指定コマンドによりフラグ情報を設定することができ、より最適な発行モードを選択することができる。

【0150】

たとえば、アクセスマスターまたは他の装置からモード指定コマンドを受け付けてもよい。

【0151】

これによれば、モード指定コマンドを発行可能な装置が複数あるので、システムの柔軟さを向上させることができる。

【0152】

たとえば、フラグ情報は、複数のアクセスマスターのそれぞれに対応してメモリに保存され、発行モードの選択において、受け付けたメモリアクセス要求の要求元のアクセスマスターに対応するフラグ情報を読み出し、読み出したフラグ情報に従って第１発行モードおよび第２発行モードの一方を選択してもよい。

【0153】

これによれば、フラグ情報とアクセスマスターとを対応づけているので、それぞれのアクセスマスター個別に最適な発行モードを選択することができる。

【0154】

以上、メモリコントローラ２およびメモリアクセス制御方法について、実施の形態に基づいて説明したが、本開示は、この実施の形態に限定されるものではない。本開示の趣旨を逸脱しない限り、当業者が思いつく各種変形を本実施の形態に施したものも、本開示の範囲内に含まれてもよい。

【0155】

なお、上記各実施の形態において、各構成要素は、専用のハードウェアで構成されるか、各構成要素に適したソフトウェアプログラムを実行することによって実現されてもよい。各構成要素は、ＣＰＵまたはプロセッサなどのプログラム実行部が、ハードディスクまたは半導体メモリなどの記録媒体に記録されたソフトウェアプログラムを読み出して実行することによって実現されてもよい。

【符号の説明】

【0156】

１ ＳＤＲＡＭ
２ メモリコントローラ
３ アクセスマスター
１１ メモリアレイ
１２ コマンド実行回路
２１ 受付部
２２ 判定部
２３ 選択部
２４ 発行部
２５ フラグメモリ

【図1】

【図2】

【図3】

【図4】

【図5】