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(19)【発行国】日本国特許庁(JP)
(12)【公報種別】特許公報(B2)
(11)【特許番号】
(24)【登録日】2024-01-15
(45)【発行日】2024-01-23
(54)【発明の名称】アレイ基板及び表示装置
(51)【国際特許分類】
G09F 9/30 20060101AFI20240116BHJP
H10K 50/814 20230101ALI20240116BHJP
H10K 50/88 20230101ALI20240116BHJP
H10K 59/131 20230101ALI20240116BHJP
H10K 77/10 20230101ALI20240116BHJP
【ＦＩ】
G09F9/30 338
G09F9/30 330
G09F9/30 365
H10K50/814
H10K50/88
H10K59/131
H10K77/10
【請求項の数】
21
【外国語出願】
(21)【出願番号】P 2022186013
(22)【出願日】2022-11-21
(62)【分割の表示】P 2021538351の分割
【原出願日】2019-11-15
(65)【公開番号】P2023037627
(43)【公開日】2023-03-15
【審査請求日】2022-11-21
(73)【特許権者】
【識別番号】510280589
【氏名又は名称】京東方科技集團股▲ふん▼有限公司
【氏名又は名称原語表記】ＢＯＥ ＴＥＣＨＮＯＬＯＧＹ ＧＲＯＵＰ ＣＯ．，ＬＴＤ．
【住所又は居所原語表記】Ｎｏ．１０ Ｊｉｕｘｉａｎｑｉａｏ Ｒｄ．，Ｃｈａｏｙａｎｇ Ｄｉｓｔｒｉｃｔ，Ｂｅｉｊｉｎｇ １０００１５，ＣＨＩＮＡ
(73)【特許権者】
【識別番号】511121702
【氏名又は名称】成都京東方光電科技有限公司
【氏名又は名称原語表記】ＣＨＥＮＧＤＵ ＢＯＥ ＯＰＴＯＥＬＥＣＴＲＯＮＩＣＳ ＴＥＣＨＮＯＬＯＧＹ ＣＯ．，ＬＴＤ．
【住所又は居所原語表記】Ｎｏ．１１８８，Ｈｅｚｕｏ Ｒｄ．，（Ｗｅｓｔ Ｚｏｎｅ），Ｈｉ－ｔｅｃｈ Ｄｅｖｅｌｏｐｍｅｎｔ Ｚｏｎｅ，Ｃｈｅｎｇｄｕ，Ｓｉｃｈｕａｎ，６１１７３１，Ｐ．Ｒ．ＣＨＩＮＡ
(74)【代理人】
【識別番号】110002000
【氏名又は名称】弁理士法人栄光事務所
(72)【発明者】
【氏名】ファン ヤオ
(72)【発明者】
【氏名】ファン ウェイユン
(72)【発明者】
【氏名】ロン ユエ
(72)【発明者】
【氏名】ツォン チャオ
(72)【発明者】
【氏名】リー モン
【審査官】石本 努
(56)【参考文献】
【文献】特開２００８－２１８３９５（ＪＰ，Ａ）
【文献】特開２００８－０６６２６６（ＪＰ，Ａ）
【文献】特開２００７－１６４１６１（ＪＰ，Ａ）
【文献】特開２００６－０６５２８１（ＪＰ，Ａ）
【文献】米国特許出願公開第２００８／０１９１６０３（ＵＳ，Ａ１）
(58)【調査した分野】(Int.Cl.，ＤＢ名)
Ｇ０９Ｆ９／３０－９／４６
Ｈ０５Ｂ３３／００－３３／２８
４４／００
４５／６０
Ｈ１０Ｋ５０／００－９９／００
(57)【特許請求の範囲】
【請求項1】
アレイ基板であって、第１境界、第２境界、第３境界及び第４境界を含む表示領域と、少なくとも一部が前記表示領域を取り囲む周辺領域とを含むベース基板と、
前記表示領域に位置する複数のサブ画素であって、前記複数のサブ画素のうちの少なくとも１つが発光素子を含み、前記発光素子が積層される第１電極、発光層、及び第２電極を含む複数のサブ画素と、
前記表示領域に位置し、前記複数のサブ画素に電気的に接続される複数の正電源線と、
前記周辺領域に位置しかつ前記第１境界に沿って延びており、前記複数の正電源線に電気的に接続される正電源バスと、
前記正電源バスの前記表示領域から離れた側の前記周辺領域に位置する第１正電源アクセス端子、第２正電源アクセス端子、及び第３正電源アクセス端子であって、前記第２正電源アクセス端子が前記第１正電源アクセス端子と前記第３正電源アクセス端子との間に位置し、前記第１正電源アクセス端子、前記第２正電源アクセス端子、及び前記第３正電源アクセス端子がそれぞれ前記正電源バスに電気的に接続される第１正電源アクセス端子、第２正電源アクセス端子、及び第３正電源アクセス端子と、
前記周辺領域に位置しかつ少なくとも一部が前記第２境界、前記第３境界、及び前記第４境界を取り囲む負電源線と、
前記周辺領域に位置しかつ少なくとも一部が前記第１境界、前記第２境界、前記第３境界、及び前記第４境界を取り囲み、前記負電源線及び前記第２電極にそれぞれ電気的に接続される補助電極と、
前記正電源バスの前記表示領域から離れた側の前記周辺領域に位置する第１負電源アクセス端子、第２負電源アクセス端子、第３負電源アクセス端子、及び第４負電源アクセス端子であって、前記第１負電源アクセス端子が前記第１正電源アクセス端子の前記第２正電源アクセス端子から離れた側に位置し、前記第２負電源アクセス端子が前記第１正電源アクセス端子と前記第３正電源アクセス端子との間に位置し、前記第３負電源アクセス端子が前記第３正電源アクセス端子の前記第２正電源アクセス端子から離れた側に位置し、前記第４負電源アクセス端子が前記第２負電源アクセス端子と前記第３正電源アクセス端子との間に位置し、前記第１負電源アクセス端子及び前記第３負電源アクセス端子がそれぞれ前記負電源線に電気的に接続される第１負電源アクセス端子、第２負電源アクセス端子、及び第３負電源アクセス端子と、
前記周辺領域に位置し、第１方向に沿って前記第２負電源アクセス端子と前記第４負電源アクセス端子との間に位置し、第２方向に沿って前記正電源バスと前記第２負電源アクセス端子との間に位置する負電源補助線とを含み、
前記負電源補助線、前記第２負電源アクセス端子、及び前記第４負電源アクセス端子は一体となっている構造であり、前記第１方向と前記第２方向とが交差し、
前記負電源補助線は、前記補助電極に電気的に接続され、前記負電源補助線の前記ベース基板での正投影と前記補助電極の前記ベース基板での正投影は、少なくとも一部が重なり、
前記補助電極は、前記ベース基板から離れた前記負電源線の側に位置し、前記補助電極は、負電源補助ビアを介して前記負電源補助線に電気的に接続され、
前記第２正電源アクセス端子は、前記第１正電源アクセス端子と前記第２負電源アクセス端子の間に位置し、前記第４負電源アクセス端子は、前記第２正電源アクセス端子に対して前記第３正電源アクセス端子の側に位置する、アレイ基板。
【請求項2】
前記第１正電源アクセス端子、前記第２正電源アクセス端子、及び前記第３正電源アクセス端子は、前記正電源バスと前記正電源線を介して前記発光素子の前記第１電極に正電圧信号を伝送するように構成され、前記第１負電源アクセス端子と前記第３負電源アクセス端子は、前記負電源線と前記補助電極を介して負電圧信号を前記発光素子の前記第２電極に伝送するように構成され、
前記第２負電源アクセス端子と前記第４負電源アクセス端子は、前記負電源補助線と前記補助電極を介して負電圧信号を前記発光素子の前記第２電極に伝送するように構成される請求項１に記載のアレイ基板。
【請求項3】
前記正電源バスの前記表示領域から離れた側の前記周辺領域に位置しかつ前記第４負電源アクセス端子と前記第３正電源アクセス端子との間に位置し、前記正電源バスに電気的に接続される第４正電源アクセス端子をさらに含み、前記第４正電源アクセス端子は、前記正電源バスと前記正電源線を介して前記発光素子の前記第１電極に正電圧信号を伝送するように構成される、請求項１に記載のアレイ基板。
【請求項4】
前記第１正電源アクセス端子と前記第３正電源アクセス端子は、前記負電源補助線に対して対称に設けられ、及び/または、前記第１負電源アクセス端子と前記第３負電源アクセス端子は、前記負電源補助線に対して対称に設けられ、及び/または、
前記第２正電源アクセス端子と前記第４正電源アクセス端子は、前記負電源補助線に対して対称に設けられ、及び/または、
前記第２負電源アクセス端子と前記第４負電源アクセス端子は、前記負電源補助線に対して対称に設けられる、請求項３に記載のアレイ基板。
【請求項5】
前記正電源バスは、前記第１正電源アクセス端子、前記第２正電源アクセス端子、前記第３正電源アクセス端子、および前記第４正電源アクセス端子の少なくとも一つと一体となっている構造である、請求項３又は４に記載のアレイ基板。
【請求項6】
前記第１正電源アクセス端子、前記第２正電源アクセス端子、前記第３正電源アクセス端子、前記第４正電源アクセス端子、前記第１負電源アクセス端子、前記第２負電源アクセス端子、前記第３負電源アクセス端子、及び前記第４負電源アクセス端子の少なくとも一つは、前記正電源バスとの角度は直角である、請求項３～５のいずれか一項に記載のアレイ基板。
【請求項7】
前記第１正電源アクセス端子、前記第２正電源アクセス端子、前記第３正電源アクセス端子、前記第４正電源アクセス端子、前記第１負電源アクセス端子、前記第２負電源アクセス端子、前記第３負電源アクセス端子、及び前記第４負電源アクセス端子の少なくとも一つは、前記ベース基板での正投影の形状が折れ線状である、請求項３～６のいずれか一項に記載のアレイ基板。
【請求項8】
前記第１負電源アクセス端子、前記第３負電源アクセス端子、及び前記負電源線は、一体となっている構造である、請求項１～７のいずれか一項に記載のアレイ基板。
【請求項9】
前記補助電極の構成は、閉リングであり、前記補助電極は、前記表示領域を取り囲む、請求項１～８のいずれか一項に記載のアレイ基板。
【請求項10】
前記複数のサブ画素のうちの少なくとも１つは、薄膜トランジスタ及び接続電極を含み、前記薄膜トランジスタは、前記ベース基板上に位置する活性層と、前記活性層の前記ベース基板から離れた側に位置するゲートと、前記ゲートの前記ベース基板から離れた側に位置するソース及びドレインとを含む、請求項１～９のいずれか一項に記載のアレイ基板。
【請求項11】
前記正電源バスは、電気的に接続されている、正電源バス第１サブ層と、正電源バス第２サブ層とを含み、前記正電源バス第１サブ層は前記ソース又は前記ドレインと同一層に位置し、前記正電源バス第２サブ層は前記接続電極と同一層に位置する、請求項１０に記載のアレイ基板。
【請求項12】
前記正電源バス第１サブ層と前記正電源バス第２サブ層は、正電源バスのビアを介して電気的に接続される、請求項１１に記載のアレイ基板。
【請求項13】
前記負電源線は、電気的に接続されている、負電源線第１サブ層と、負電源線第２サブ層とを含み、前記負電源補助線は、電気的に接続されている、負電源補助線第１サブ層と、負電源補助線第２サブ層とを含み、
前記負電源線第１サブ層及び前記負電源補助線第１サブ層はいずれも前記ソース又は前記ドレインと同一層に位置し、前記負電源線第２サブ層及び前記負電源補助線第２サブ層はいずれも前記接続電極と同一層に位置する、請求項１０に記載のアレイ基板。
【請求項14】
前記負電源線第１サブ層と前記負電源線第２サブ層は、負電源線ビアを介して電気的に接続され、前記負電源補助線第１サブ層と前記負電源補助線第２サブ層は負電源補助線ビアを介して電気的に接続される、請求項１３に記載のアレイ基板。
【請求項15】
前記複数のサブ画素のうちの少なくとも１つは、薄膜トランジスタを含み、前記薄膜トランジスタは、前記ベース基板上に位置する活性層と、前記活性層の前記ベース基板から離れた側に位置するゲートと、前記ゲートの前記ベース基板から離れた側に位置するソース及びドレインとを含み、
前記第１正電源アクセス端子、前記第２正電源アクセス端子、前記第３正電源アクセス端子、及び前記第４正電源アクセス端子は、いずれも前記ソース又は前記ドレインと同一層に位置する、請求項３～７のいずれか一項に記載のアレイ基板。
【請求項16】
前記複数のサブ画素のうちの少なくとも１つは、薄膜トランジスタを含み、前記薄膜トランジスタは、前記ベース基板上に位置する活性層と、前記活性層の前記ベース基板から離れた側に位置するゲートと、前記ゲートの前記ベース基板から離れた側に位置するソース及びドレインとを含み、
前記第１負電源アクセス端子、前記第２負電源アクセス端子、前記第３負電源アクセス端子、及び前記第４負電源アクセス端子は、いずれも前記ソース又は前記ドレインと同一層に位置する、請求項１～９のいずれか一項に記載のアレイ基板。
【請求項17】
前記負電源補助線は、電気的に接続されている、負電源補助線第１サブ層と、負電源補助線第２サブ層とを含み、前記負電源補助線第２サブ層は、前記負電源補助線第１サブ層の前記ベース基板から離れた側に位置し、前記第２負電源アクセス端子、前記第４負電源アクセス端子、及び前記負電源補助線第１サブ層は一体となっている構造である、請求項１～９のいずれか一項に記載のアレイ基板。
【請求項18】
前記第１正電源アクセス端子、前記第２正電源アクセス端子、前記第３正電源アクセス端子、前記第４正電源アクセス端子、前記第１負電源アクセス端子、前記第２負電源アクセス端子、前記第３負電源アクセス端子、及び前記第４負電源アクセス端子の、前記表示領域から離れた側の前記周辺領域に位置する回路基板であって、前記第１正電源アクセス端子、前記第２正電源アクセス端子、前記第３正電源アクセス端子、前記第４正電源アクセス端子、前記第１負電源アクセス端子、前記第２負電源アクセス端子、前記第３負電源アクセス端子、及び前記第４負電源アクセス端子がそれぞれ電気的に接続される回路基板をさらに含む、請求項５～７のいずれか一項に記載のアレイ基板。
【請求項19】
前記補助電極は、前記負電源線の前記ベース基板から離れた側に位置し、負電源補助ビアを介して前記負電源補助線に電気的に接続される、請求項１～１８のいずれか１項に記載のアレイ基板。
【請求項20】
前記発光素子は有機発光ダイオードであり、前記第１電極は陽極であり、前記第２電極は陰極である、請求項１～１９のいずれか１項に記載のアレイ基板。
【請求項21】
請求項１～２０のいずれか１項に記載のアレイ基板を含む、表示装置。
【発明の詳細な説明】
【技術分野】
【0001】
本願は、表示技術分野に関し、特にアレイ基板及び表示装置に関する。
【背景技術】
【0002】
アレイ基板のサイズが大きくなるに伴い、アレイ基板の表示領域外の信号伝送線の長さ及び負荷も大きくなる。正電圧信号（ＶＤＤ）を伝送するための信号伝送線又は負電圧信号（ＶＳＳ）を伝送するための信号伝送線のインピーダンスが大きすぎると、アレイ基板に表示される画面には輝度むらが発生しやすい。
【発明の概要】
【課題を解決するための手段】
【0003】
本願は、アレイ基板及び表示装置を提供する。本願の技術案は以下のとおりである。
【0004】
一態様では、アレイ基板を提供し、
第１境界、第２境界、第３境界、及び第４境界を含む表示領域と、少なくとも一部が前記表示領域を取り囲む周辺領域とを含むベース基板と、
前記表示領域に位置する複数のサブ画素であって、前記複数のサブ画素のうちの少なくとも１つが発光素子を含み、前記発光素子が積層される第１電極、発光層、及び第２電極を含む複数のサブ画素と、
前記表示領域に位置し、前記複数のサブ画素に電気的に接続される複数の正電源線と、
前記周辺領域に位置しかつ前記第１境界に沿って延びており、前記複数の正電源線に電気的に接続される正電源バスと、
前記正電源バスの前記表示領域から離れた側の前記周辺領域に位置する第１正電源アクセス端子、第２正電源アクセス端子、及び第３正電源アクセス端子であって、前記第２正電源アクセス端子が前記第１正電源アクセス端子と前記第３正電源アクセス端子との間に位置し、前記第１正電源アクセス端子、前記第２正電源アクセス端子、及び前記第３正電源アクセス端子がそれぞれ前記正電源バスに電気的に接続される第１正電源アクセス端子、第２正電源アクセス端子、及び第３正電源アクセス端子と、
前記周辺領域に位置しかつ少なくとも一部が前記第２境界、前記第３境界、及び前記第４境界を取り囲む負電源線と、
前記周辺領域に位置しかつ少なくとも一部が前記第１境界、前記第２境界、前記第３境界、及び前記第４境界を取り囲み、前記負電源線及び前記第２電極にそれぞれ電気的に接続される補助電極と、
前記正電源バスの前記表示領域から離れた側の前記周辺領域に位置する第１負電源アクセス端子、第２負電源アクセス端子、第３負電源アクセス端子及び第４負電源アクセス端子であって、前記第１負電源アクセス端子が前記第１正電源アクセス端子の前記第２正電源アクセス端子から離れた側に位置し、前記第２負電源アクセス端子が前記第１正電源アクセス端子と前記第３正電源アクセス端子との間に位置し、前記第３負電源アクセス端子が前記第３正電源アクセス端子の前記第２正電源アクセス端子から離れた側に位置し、前記第４負電源アクセス端子が前記第２負電源アクセス端子と前記第３正電源アクセス端子の間に位置し、前記第１負電源アクセス端子及び前記第３負電源アクセス端子がそれぞれ前記負電源線に電気的に接続される第１負電源アクセス端子、第２負電源アクセス端子、第３負電源アクセス端子及び第４負電源アクセス端子と、
前記周辺領域に位置し、第１方向に沿って前記第２負電源アクセス端子と前記第４負電源アクセス端子との間に位置し、第２方向に沿って前記正電源バスと前記第２負電源アクセス端子との間に位置する負電源補助線とを含み、
前記負電源補助線、前記第２負電源アクセス端子、及び前記第４負電源アクセス端子は一体となっている構造であり、前記第１方向と前記第２方向とが交差し、
前記負電源補助線は、前記補助電極に電気的に接続され、前記負電源補助線の前記ベース基板での正投影と前記補助電極の前記ベース基板での正投影は、少なくとも一部が重なる、アレイ基板。
第１境界、第２境界、第３境界、及び第４境界を含む表示領域と、少なくとも一部が前記表示領域を取り囲む周辺領域とを含むベース基板と、
前記表示領域に位置する複数のサブ画素であって、前記複数のサブ画素のうちの少なくとも１つが発光素子を含み、前記発光素子が積層される第１電極、発光層、及び第２電極を含む複数のサブ画素と、
前記表示領域に位置し、前記複数のサブ画素に電気的に接続される複数の正電源線と、
前記周辺領域に位置しかつ前記第１境界に沿って延びており、前記複数の正電源線に電気的に接続される正電源バスと、
前記正電源バスの前記表示領域から離れた側の前記周辺領域に位置する第１正電源アクセス端子、第２正電源アクセス端子、及び第３正電源アクセス端子であって、前記第２正電源アクセス端子が前記第１正電源アクセス端子と前記第３正電源アクセス端子との間に位置し、前記第１正電源アクセス端子、前記第２正電源アクセス端子、及び前記第３正電源アクセス端子がそれぞれ前記正電源バスに電気的に接続される第１正電源アクセス端子、第２正電源アクセス端子、及び第３正電源アクセス端子と、
前記周辺領域に位置しかつ少なくとも一部が前記第２境界、前記第３境界、及び前記第４境界を取り囲む負電源線と、
前記周辺領域に位置しかつ少なくとも一部が前記第１境界、前記第２境界、前記第３境界、及び前記第４境界を取り囲み、前記負電源線及び前記第２電極にそれぞれ電気的に接続される補助電極と、
前記正電源バスの前記表示領域から離れた側の前記周辺領域に位置する第１負電源アクセス端子、第２負電源アクセス端子、第３負電源アクセス端子及び第４負電源アクセス端子であって、前記第１負電源アクセス端子が前記第１正電源アクセス端子の前記第２正電源アクセス端子から離れた側に位置し、前記第２負電源アクセス端子が前記第１正電源アクセス端子と前記第３正電源アクセス端子との間に位置し、前記第３負電源アクセス端子が前記第３正電源アクセス端子の前記第２正電源アクセス端子から離れた側に位置し、前記第４負電源アクセス端子が前記第２負電源アクセス端子と前記第３正電源アクセス端子の間に位置し、前記第１負電源アクセス端子及び前記第３負電源アクセス端子がそれぞれ前記負電源線に電気的に接続される第１負電源アクセス端子、第２負電源アクセス端子、第３負電源アクセス端子及び第４負電源アクセス端子と、
前記周辺領域に位置し、第１方向に沿って前記第２負電源アクセス端子と前記第４負電源アクセス端子との間に位置し、第２方向に沿って前記正電源バスと前記第２負電源アクセス端子との間に位置する負電源補助線とを含み、
前記負電源補助線、前記第２負電源アクセス端子、及び前記第４負電源アクセス端子は一体となっている構造であり、前記第１方向と前記第２方向とが交差し、
前記負電源補助線は、前記補助電極に電気的に接続され、前記負電源補助線の前記ベース基板での正投影と前記補助電極の前記ベース基板での正投影は、少なくとも一部が重なる、アレイ基板。
【0005】
選択的に、前記第１正電源アクセス端子、前記第２正電源アクセス端子、及び前記第３正電源アクセス端子は、前記正電源バスと前記正電源線を介して前記発光素子の前記第１電極に正電圧信号を伝送するように構成され、
前記第１負電源アクセス端子と前記第３負電源アクセス端子は、前記負電源線と前記補助電極を介して負電圧信号を前記発光素子の前記第２電極に伝送するように構成され、
前記第２負電源アクセス端子と前記第４負電源アクセス端子は、前記負電源補助線と前記補助電極を介して負電圧信号を前記発光素子の前記第２電極に伝送するように構成される。
前記第１負電源アクセス端子と前記第３負電源アクセス端子は、前記負電源線と前記補助電極を介して負電圧信号を前記発光素子の前記第２電極に伝送するように構成され、
前記第２負電源アクセス端子と前記第４負電源アクセス端子は、前記負電源補助線と前記補助電極を介して負電圧信号を前記発光素子の前記第２電極に伝送するように構成される。
【0006】
選択的に、前記アレイ基板は、
前記正電源バスの前記表示領域から離れた側の前記周辺領域に位置しかつ前記第４負電源アクセス端子と前記第３正電源アクセス端子との間に位置し、前記正電源バスに電気的に接続される第４正電源アクセス端子をさらに含み、
前記第４正電源アクセス端子は、前記正電源バスと前記正電源線を介して前記発光素子の前記第１電極に正電圧信号を伝送するように構成される。
前記正電源バスの前記表示領域から離れた側の前記周辺領域に位置しかつ前記第４負電源アクセス端子と前記第３正電源アクセス端子との間に位置し、前記正電源バスに電気的に接続される第４正電源アクセス端子をさらに含み、
前記第４正電源アクセス端子は、前記正電源バスと前記正電源線を介して前記発光素子の前記第１電極に正電圧信号を伝送するように構成される。
【0007】
選択的に、前記第１正電源アクセス端子と前記第３正電源アクセス端子は、前記負電源補助線に対して対称に設けられ、及び/または、
前記第１負電源アクセス端子と前記第３負電源アクセス端子は、前記負電源補助線に対して対称に設けられ、及び/または、
前記第２正電源アクセス端子と前記第４正電源アクセス端子は、前記負電源補助線に対して対称に設けられ、及び/または、
前記第２負電源アクセス端子と前記第４負電源アクセス端子は、前記負電源補助線に対して対称に設けられる。
前記第１負電源アクセス端子と前記第３負電源アクセス端子は、前記負電源補助線に対して対称に設けられ、及び/または、
前記第２正電源アクセス端子と前記第４正電源アクセス端子は、前記負電源補助線に対して対称に設けられ、及び/または、
前記第２負電源アクセス端子と前記第４負電源アクセス端子は、前記負電源補助線に対して対称に設けられる。
【0008】
選択的に、前記正電源バスは、前記第１正電源アクセス端子、前記第２正電源アクセス端子、前記第３正電源アクセス端子、および前記第４正電源アクセス端子の少なくとも一つと一体となっている構造である。
【0009】
選択的に、前記第１正電源アクセス端子、前記第２正電源アクセス端子、前記第３正電源アクセス端子、前記第４正電源アクセス端子、前記第１負電源アクセス端子、前記第２負電源アクセス端子、前記第３負電源アクセス端子、及び前記第４負電源アクセス端子の少なくとも一つは、前記正電源バスとの角度は直角である。
【0010】
選択的に、前記第１正電源アクセス端子、前記第２正電源アクセス端子、前記第３正電源アクセス端子、前記第４正電源アクセス端子、前記第１負電源アクセス端子、前記第２負電源アクセス端子、前記第３負電源アクセス端子、及び前記第４負電源アクセス端子の少なくとも一つは、前記ベース基板での正投影の形状が折れ線状である。
【0011】
選択的に、前記第１負電源アクセス端子、前記第３負電源アクセス端子、及び前記負電源線は、一体となっている構造である。
【0012】
選択的に、前記補助電極の構成は、閉リングであり、前記補助電極は、前記表示領域を取り囲む。
【0013】
選択的に、前記複数のサブ画素のうちの少なくとも１つは、薄膜トランジスタ及び接続電極を含み、
前記薄膜トランジスタは、前記ベース基板上に位置する活性層と、前記活性層の前記ベース基板から離れた側に位置するゲートと、前記ゲートの前記ベース基板から離れた側に位置するソース及びドレインとを含む。
前記薄膜トランジスタは、前記ベース基板上に位置する活性層と、前記活性層の前記ベース基板から離れた側に位置するゲートと、前記ゲートの前記ベース基板から離れた側に位置するソース及びドレインとを含む。
【0014】
選択的に、前記正電源バスは、電気的に接続されている、正電源バス第１サブ層と、正電源バス第２サブ層とを含み、
前記正電源バス第１サブ層は前記ソース又は前記ドレインと同一層に位置し、前記正電源バス第２サブ層は前記接続電極と同一層に位置する。
前記正電源バス第１サブ層は前記ソース又は前記ドレインと同一層に位置し、前記正電源バス第２サブ層は前記接続電極と同一層に位置する。
【0015】
選択的に、前記正電源バス第１サブ層と前記正電源バス第２サブ層は、正電源バスのビアを介して電気的に接続される。
【0016】
選択的に、前記負電源線は、電気的に接続されている、負電源線第１サブ層と、負電源線第２サブ層とを含み、
前記負電源補助線は、電気的に接続されている、負電源補助線第１サブ層と、負電源補助線第２サブ層とを含み、
前記負電源線第１サブ層及び前記負電源補助線第１サブ層はいずれも前記ソース又は前記ドレインと同一層に位置し、前記負電源線第２サブ層及び前記負電源補助線第２サブ層はいずれも前記接続電極と同一層に位置する。
前記負電源補助線は、電気的に接続されている、負電源補助線第１サブ層と、負電源補助線第２サブ層とを含み、
前記負電源線第１サブ層及び前記負電源補助線第１サブ層はいずれも前記ソース又は前記ドレインと同一層に位置し、前記負電源線第２サブ層及び前記負電源補助線第２サブ層はいずれも前記接続電極と同一層に位置する。
【0017】
選択的に、前記負電源線第１サブ層と前記負電源線第２サブ層は、負電源線ビアを介して電気的に接続され、前記負電源補助線第１サブ層と前記負電源補助線第２サブ層は負電源補助線ビアを介して電気的に接続される。
【0018】
選択的に、前記複数のサブ画素のうちの少なくとも１つは、薄膜トランジスタを含み、
前記薄膜トランジスタは、前記ベース基板上に位置する活性層と、前記活性層の前記ベース基板から離れた側に位置するゲートと、前記ゲートの前記ベース基板から離れた側に位置するソース及びドレインとを含み、
前記第１正電源アクセス端子、前記第２正電源アクセス端子、前記第３正電源アクセス端子、及び前記第４正電源アクセス端子は、いずれも前記ソース又は前記ドレインと同一層に位置する。
前記薄膜トランジスタは、前記ベース基板上に位置する活性層と、前記活性層の前記ベース基板から離れた側に位置するゲートと、前記ゲートの前記ベース基板から離れた側に位置するソース及びドレインとを含み、
前記第１正電源アクセス端子、前記第２正電源アクセス端子、前記第３正電源アクセス端子、及び前記第４正電源アクセス端子は、いずれも前記ソース又は前記ドレインと同一層に位置する。
【0019】
選択的に、前記複数のサブ画素のうちの少なくとも１つは、薄膜トランジスタを含み、
前記薄膜トランジスタは、前記ベース基板上に位置する活性層と、前記活性層の前記ベース基板から離れた側に位置するゲートと、前記ゲートの前記ベース基板から離れた側に位置するソース及びドレインとを含み、
前記第１負電源アクセス端子、前記第２負電源アクセス端子、前記第３負電源アクセス端子、及び前記第４負電源アクセス端子は、いずれも前記ソース又は前記ドレインと同一層に位置する。
前記薄膜トランジスタは、前記ベース基板上に位置する活性層と、前記活性層の前記ベース基板から離れた側に位置するゲートと、前記ゲートの前記ベース基板から離れた側に位置するソース及びドレインとを含み、
前記第１負電源アクセス端子、前記第２負電源アクセス端子、前記第３負電源アクセス端子、及び前記第４負電源アクセス端子は、いずれも前記ソース又は前記ドレインと同一層に位置する。
【0020】
選択的に、前記負電源補助線は、電気的に接続されている、負電源補助線第１サブ層と、負電源補助線第２サブ層とを含み、前記負電源補助線第２サブ層は、前記負電源補助線第１サブ層の前記ベース基板から離れた側に位置し、
前記第２負電源アクセス端子、前記第４負電源アクセス端子、及び前記負電源補助線第１サブ層は一体となっている構造である。
前記第２負電源アクセス端子、前記第４負電源アクセス端子、及び前記負電源補助線第１サブ層は一体となっている構造である。
【0021】
選択的に、前記アレイ基板は、
前記第１正電源アクセス端子、前記第２正電源アクセス端子、前記第３正電源アクセス端子、前記第４正電源アクセス端子、前記第１負電源アクセス端子、前記第２負電源アクセス端子、前記第３負電源アクセス端子、及び前記第４負電源アクセス端子の、前記表示領域から離れた側の前記周辺領域に位置する回路基板であって、前記第１正電源アクセス端子、前記第２正電源アクセス端子、前記第３正電源アクセス端子、前記第４正電源アクセス端子、前記第１負電源アクセス端子、前記第２負電源アクセス端子、前記第３負電源アクセス端子、及び前記第４負電源アクセス端子がそれぞれ電気的に接続される回路基板をさらに含む。
前記第１正電源アクセス端子、前記第２正電源アクセス端子、前記第３正電源アクセス端子、前記第４正電源アクセス端子、前記第１負電源アクセス端子、前記第２負電源アクセス端子、前記第３負電源アクセス端子、及び前記第４負電源アクセス端子の、前記表示領域から離れた側の前記周辺領域に位置する回路基板であって、前記第１正電源アクセス端子、前記第２正電源アクセス端子、前記第３正電源アクセス端子、前記第４正電源アクセス端子、前記第１負電源アクセス端子、前記第２負電源アクセス端子、前記第３負電源アクセス端子、及び前記第４負電源アクセス端子がそれぞれ電気的に接続される回路基板をさらに含む。
【0022】
選択的に、前記補助電極は、前記負電源線の前記ベース基板から離れた側に位置し、負電源補助ビアを介して前記負電源補助線に電気的に接続される。
【0023】
選択的に、前記発光素子は有機発光ダイオードであり、前記第１電極は陽極であり、前記第２電極は陰極である。
【0024】
他の態様では、上記態様のいずれか１つのアレイ基板を含む表示装置を提供する。
【図面の簡単な説明】
【0025】
本願の実施例の技術案をより明瞭に説明するために、以下は、実施例の記述に必要がある図面を簡単に紹介しする。以下の記述における図面は、ただ本願に記載のいくつかの実施例に過ぎず、当業者にとって、創造的な労力を払わない前提で、それらの図面に基づき、他の図面を取得することもできるとは言うまでもない。
【発明を実施するための形態】
【0026】
本願の原理、技術案、及びメリットをより明瞭にするために、以下、図面を参照して本願の実施形態をさらに詳細に説明する。
【0027】
本願の実施例は、アレイ基板を提供し、該アレイ基板において、正電圧信号をサブ画素に伝送するための信号伝送線及び負電圧信号をサブ画素に伝送するための信号伝送線のインピーダンスをともに小さくして、アレイ基板に表示される画面には輝度むらが発生しやすいという状況を改善するのに有利であり、アレイ基板に表示される画面の輝度の均一性を確保するようにする。本願の解決手段の詳細は以下のとおりである。
【0028】
本願の実施例では、前記アレイ基板は、第１境界、第２境界、第３境界、及び第４境界を含む表示領域と、少なくとも一部が前記表示領域を取り囲む周辺領域とを含むベース基板と、
前記表示領域に位置する複数のサブ画素であって、前記複数のサブ画素のうちの少なくとも１つが発光素子を含み、前記発光素子が積層される第１電極、発光層、及び第２電極を含む複数のサブ画素と、
前記表示領域に位置し、前記複数のサブ画素に電気的に接続される複数の正電源線と、
前記周辺領域に位置しかつ前記第１境界に沿って延びており、前記複数の正電源線に電気的に接続される正電源バスと、
前記正電源バスの前記表示領域から離れた側の前記周辺領域に位置する第１正電源アクセス端子、第２正電源アクセス端子、及び第３正電源アクセス端子であって、前記第２正電源アクセス端子が前記第１正電源アクセス端子と前記第３正電源アクセス端子との間に位置し、前記第１正電源アクセス端子、前記第２正電源アクセス端子、及び前記第３正電源アクセス端子がそれぞれ前記正電源バスに電気的に接続される第１正電源アクセス端子、第２正電源アクセス端子、及び第３正電源アクセス端子と、
前記周辺領域に位置しかつ少なくとも一部が前記第２境界、前記第３境界、及び前記第４境界を取り囲む負電源線と、
前記周辺領域に位置しかつ少なくとも一部が前記第１境界、前記第２境界、前記第３境界、及び前記第４境界を取り囲み、前記負電源線及び前記第２電極にそれぞれ電気的に接続される補助電極と、
前記正電源バスの前記表示領域から離れた側の前記周辺領域に位置する第１負電源アクセス端子、第２負電源アクセス端子、第３負電源アクセス端子及び第４負電源アクセス端子であって、前記第１負電源アクセス端子が前記第１正電源アクセス端子の前記第２正電源アクセス端子から離れた側に位置し、前記第２負電源アクセス端子が前記第１正電源アクセス端子と前記第３正電源アクセス端子との間に位置し、前記第３負電源アクセス端子が前記第３正電源アクセス端子の前記第２正電源アクセス端子から離れた側に位置し、前記第４負電源アクセス端子が前記第２負電源アクセス端子と前記第３正電源アクセス端子の間に位置し、前記第１負電源アクセス端子及び前記第３負電源アクセス端子がそれぞれ前記負電源線に電気的に接続される第１負電源アクセス端子、第２負電源アクセス端子、第３負電源アクセス端子及び第４負電源アクセス端子と、
前記周辺領域に位置し、第１方向に沿って前記第２負電源アクセス端子と前記第４負電源アクセス端子との間に位置し、第２方向に沿って前記正電源バスと前記第２負電源アクセス端子との間に位置する負電源補助線とを含み、
前記負電源補助線、前記第２負電源アクセス端子、及び前記第４負電源アクセス端子は一体となっている構造であり、前記第１方向と前記第２方向とが交差し、
前記負電源補助線は、前記補助電極に電気的に接続され、前記負電源補助線の前記ベース基板での正投影と前記補助電極の前記ベース基板での正投影は、少なくとも一部が重なる。
前記表示領域に位置する複数のサブ画素であって、前記複数のサブ画素のうちの少なくとも１つが発光素子を含み、前記発光素子が積層される第１電極、発光層、及び第２電極を含む複数のサブ画素と、
前記表示領域に位置し、前記複数のサブ画素に電気的に接続される複数の正電源線と、
前記周辺領域に位置しかつ前記第１境界に沿って延びており、前記複数の正電源線に電気的に接続される正電源バスと、
前記正電源バスの前記表示領域から離れた側の前記周辺領域に位置する第１正電源アクセス端子、第２正電源アクセス端子、及び第３正電源アクセス端子であって、前記第２正電源アクセス端子が前記第１正電源アクセス端子と前記第３正電源アクセス端子との間に位置し、前記第１正電源アクセス端子、前記第２正電源アクセス端子、及び前記第３正電源アクセス端子がそれぞれ前記正電源バスに電気的に接続される第１正電源アクセス端子、第２正電源アクセス端子、及び第３正電源アクセス端子と、
前記周辺領域に位置しかつ少なくとも一部が前記第２境界、前記第３境界、及び前記第４境界を取り囲む負電源線と、
前記周辺領域に位置しかつ少なくとも一部が前記第１境界、前記第２境界、前記第３境界、及び前記第４境界を取り囲み、前記負電源線及び前記第２電極にそれぞれ電気的に接続される補助電極と、
前記正電源バスの前記表示領域から離れた側の前記周辺領域に位置する第１負電源アクセス端子、第２負電源アクセス端子、第３負電源アクセス端子及び第４負電源アクセス端子であって、前記第１負電源アクセス端子が前記第１正電源アクセス端子の前記第２正電源アクセス端子から離れた側に位置し、前記第２負電源アクセス端子が前記第１正電源アクセス端子と前記第３正電源アクセス端子との間に位置し、前記第３負電源アクセス端子が前記第３正電源アクセス端子の前記第２正電源アクセス端子から離れた側に位置し、前記第４負電源アクセス端子が前記第２負電源アクセス端子と前記第３正電源アクセス端子の間に位置し、前記第１負電源アクセス端子及び前記第３負電源アクセス端子がそれぞれ前記負電源線に電気的に接続される第１負電源アクセス端子、第２負電源アクセス端子、第３負電源アクセス端子及び第４負電源アクセス端子と、
前記周辺領域に位置し、第１方向に沿って前記第２負電源アクセス端子と前記第４負電源アクセス端子との間に位置し、第２方向に沿って前記正電源バスと前記第２負電源アクセス端子との間に位置する負電源補助線とを含み、
前記負電源補助線、前記第２負電源アクセス端子、及び前記第４負電源アクセス端子は一体となっている構造であり、前記第１方向と前記第２方向とが交差し、
前記負電源補助線は、前記補助電極に電気的に接続され、前記負電源補助線の前記ベース基板での正投影と前記補助電極の前記ベース基板での正投影は、少なくとも一部が重なる。
【0029】
選択的に、前記第１正電源アクセス端子、前記第２正電源アクセス端子、及び前記第３正電源アクセス端子は、前記正電源バスと前記正電源線を介して前記発光素子の前記第１電極に正電圧信号を伝送するように構成され、
前記第１負電源アクセス端子と前記第３負電源アクセス端子は、前記負電源線と前記補助電極を介して負電圧信号を前記発光素子の前記第２電極に伝送するように構成され、
前記第２負電源アクセス端子と前記第４負電源アクセス端子は、前記負電源補助線と前記補助電極を介して負電圧信号を前記発光素子の前記第２電極に伝送するように構成される。
前記第１負電源アクセス端子と前記第３負電源アクセス端子は、前記負電源線と前記補助電極を介して負電圧信号を前記発光素子の前記第２電極に伝送するように構成され、
前記第２負電源アクセス端子と前記第４負電源アクセス端子は、前記負電源補助線と前記補助電極を介して負電圧信号を前記発光素子の前記第２電極に伝送するように構成される。
【0030】
例示的に、図１～図４を参照して、図１～図４は、本願の実施例による４つのアレイ基板の正面図である。該アレイ基板は、図１～図４に示すように、ベース基板１０と、複数のサブ画素１１と、複数の正電源線１２と、正電源バス１３と、第１正電源アクセス端子１４と、第２正電源アクセス端子１５、及び第３正電源アクセス端子１６と、負電源線１７と、補助電極１８と、第１負電源アクセス端子１９、第２負電源アクセス端子２０、及び第３負電源アクセス端子２１と、負電源補助線２２とを含む。
ベース基板１０は、表示領域Ｂ１と、少なくとも一部が表示領域Ｂ１を取り囲む周辺領域Ｂ２とを含むベース基板１０であって、表示領域Ｂ１は、第１境界（図１～図４には図示せず）、第２境界（図１～図４には図示せず）、第３境界（図１～図４には図示せず）、及び第４境界（図１～図４には図示せず）を含む。なお、本願の実施例では、周辺領域Ｂ２が表示領域Ｂ１の４辺の周りを取り込む場合を例として説明し、周辺領域Ｂ２は、表示領域Ｂ１を取り囲む閉リングであってもよい。
複数のサブ画素１１は、表示領域Ｂ１に位置する複数のサブ画素１１であって、該複数のサブ画素１１のうちの少なくとも１つは発光素子（図１～図４には図示せず）を含み、該発光素子は、積層される第１電極（図１～図４には図示せず）、発光層（図１～図４には図示せず）、及び第２電極（図１～図４には図示せず）を含み、例えば、該発光素子は、順に積層される第１電極、発光層、及び第２電極を含む。該複数のサブ画素１１は、表示機能を実現するように発光することができる。
複数の正電源線１２は、表示領域Ｂ１に位置しかつサブ画素１１に電気的に接続され、例えば、該複数の正電源線１２は、該サブ画素１１における発光素子の第１電極に接続される。
正電源バス１３は、周辺領域Ｂ２に位置しかつ表示領域Ｂ１の第１境界に沿って延びており、上記複数の正電源線１２に電気的に接続される。
第１正電源アクセス端子１４、第２正電源アクセス端子１５、及び第３正電源アクセス端子１６は、正電源バス１３の表示領域Ｂ１から離れた側の周辺領域Ｂ２に位置する第１正電源アクセス端子１４、第２正電源アクセス端子１５、及び第３正電源アクセス端子１６であって、第２正電源アクセス端子１５が第１正電源アクセス端子１４と第３正電源アクセス端子１６との間に位置し、第１正電源アクセス端子１４、第２正電源アクセス端子１５、及び第３正電源アクセス端子１６がそれぞれ正電源バス１３に電気的に接続される。
負電源線１７は、周辺領域Ｂ２に位置しかつ少なくとも一部が表示領域Ｂ１の第２境界、第３境界、及び第４境界を取り囲み、例えば、負電源線１７は、表示領域Ｂ１の第２境界、第３境界、及び第４境界に沿って延びる。
補助電極１８は、周辺領域Ｂ２に位置しかつ少なくとも一部が表示領域Ｂ１の第１境界、第２境界、第３境界、及び第４境界を取り囲む。該補助電極１８は、負電源線１７及び発光素子の第２電極にそれぞれ電気的に接続され、例えば、図１～図４は、補助電極１８が表示領域Ｂ１の第１境界、第２境界、第３境界、及び第４境界を取り囲むのを例として説明する。
第１負電源アクセス端子１９、第２負電源アクセス端子２０、第３負電源アクセス端子２１、及び第４負電源アクセス端子２４（図３及び図４を参考）は、正電源バス１３の表示領域Ｂ１から離れた側の周辺領域Ｂ２に位置する第１負電源アクセス端子１９、第２負電源アクセス端子２０、及び第３負電源アクセス端子２１であって、第１負電源アクセス端子１９が第１正電源アクセス端子１４の第２正電源アクセス端子１５から離れた側に位置し、第２負電源アクセス端子２０が第１正電源アクセス端子１４と第３正電源アクセス端子１６との間に位置し、第３負電源アクセス端子２１が第３正電源アクセス端子１６の第２正電源アクセス端子１５から離れた側に位置し、第４負電源アクセス端子２４が第２負電源アクセス端子２０と第３正電源アクセス端子１６との間（図３及び図４を参考）に位置し、第１負電源アクセス端子１９及び第３負電源アクセス端子２１がそれぞれ負電源線１７に電気的に接続される。なお、本願の実施例では、第２負電源アクセス端子２０が第２正電源アクセス端子１５と第３正電源アクセス端子１６との間に位置する場合を例として説明する。
負電源補助線２２は、周辺領域Ｂ２に位置し、第１方向ｘに沿って第２負電源アクセス端子２０と第４負電源アクセス端子２４との間に位置し、第２方向ｙに沿って正電源バス１３と第２負電源アクセス端子２０との間に位置し、負電源補助線２２、第２負電源アクセス端子２０、及び第４負電源アクセス端子２４は一体となっている構造であり、第１方向ｘと第２方向ｙとが交差し、例えば、第１方向ｘと第２方向ｙとが直交である。
負電源補助線２２は、補助電極１８に電気的に接続され、負電源補助線２２のベース基板１０での正投影と補助電極１８のベース基板１０での正投影は、少なくとも一部が重なる。
ベース基板１０は、表示領域Ｂ１と、少なくとも一部が表示領域Ｂ１を取り囲む周辺領域Ｂ２とを含むベース基板１０であって、表示領域Ｂ１は、第１境界（図１～図４には図示せず）、第２境界（図１～図４には図示せず）、第３境界（図１～図４には図示せず）、及び第４境界（図１～図４には図示せず）を含む。なお、本願の実施例では、周辺領域Ｂ２が表示領域Ｂ１の４辺の周りを取り込む場合を例として説明し、周辺領域Ｂ２は、表示領域Ｂ１を取り囲む閉リングであってもよい。
複数のサブ画素１１は、表示領域Ｂ１に位置する複数のサブ画素１１であって、該複数のサブ画素１１のうちの少なくとも１つは発光素子（図１～図４には図示せず）を含み、該発光素子は、積層される第１電極（図１～図４には図示せず）、発光層（図１～図４には図示せず）、及び第２電極（図１～図４には図示せず）を含み、例えば、該発光素子は、順に積層される第１電極、発光層、及び第２電極を含む。該複数のサブ画素１１は、表示機能を実現するように発光することができる。
複数の正電源線１２は、表示領域Ｂ１に位置しかつサブ画素１１に電気的に接続され、例えば、該複数の正電源線１２は、該サブ画素１１における発光素子の第１電極に接続される。
正電源バス１３は、周辺領域Ｂ２に位置しかつ表示領域Ｂ１の第１境界に沿って延びており、上記複数の正電源線１２に電気的に接続される。
第１正電源アクセス端子１４、第２正電源アクセス端子１５、及び第３正電源アクセス端子１６は、正電源バス１３の表示領域Ｂ１から離れた側の周辺領域Ｂ２に位置する第１正電源アクセス端子１４、第２正電源アクセス端子１５、及び第３正電源アクセス端子１６であって、第２正電源アクセス端子１５が第１正電源アクセス端子１４と第３正電源アクセス端子１６との間に位置し、第１正電源アクセス端子１４、第２正電源アクセス端子１５、及び第３正電源アクセス端子１６がそれぞれ正電源バス１３に電気的に接続される。
負電源線１７は、周辺領域Ｂ２に位置しかつ少なくとも一部が表示領域Ｂ１の第２境界、第３境界、及び第４境界を取り囲み、例えば、負電源線１７は、表示領域Ｂ１の第２境界、第３境界、及び第４境界に沿って延びる。
補助電極１８は、周辺領域Ｂ２に位置しかつ少なくとも一部が表示領域Ｂ１の第１境界、第２境界、第３境界、及び第４境界を取り囲む。該補助電極１８は、負電源線１７及び発光素子の第２電極にそれぞれ電気的に接続され、例えば、図１～図４は、補助電極１８が表示領域Ｂ１の第１境界、第２境界、第３境界、及び第４境界を取り囲むのを例として説明する。
第１負電源アクセス端子１９、第２負電源アクセス端子２０、第３負電源アクセス端子２１、及び第４負電源アクセス端子２４（図３及び図４を参考）は、正電源バス１３の表示領域Ｂ１から離れた側の周辺領域Ｂ２に位置する第１負電源アクセス端子１９、第２負電源アクセス端子２０、及び第３負電源アクセス端子２１であって、第１負電源アクセス端子１９が第１正電源アクセス端子１４の第２正電源アクセス端子１５から離れた側に位置し、第２負電源アクセス端子２０が第１正電源アクセス端子１４と第３正電源アクセス端子１６との間に位置し、第３負電源アクセス端子２１が第３正電源アクセス端子１６の第２正電源アクセス端子１５から離れた側に位置し、第４負電源アクセス端子２４が第２負電源アクセス端子２０と第３正電源アクセス端子１６との間（図３及び図４を参考）に位置し、第１負電源アクセス端子１９及び第３負電源アクセス端子２１がそれぞれ負電源線１７に電気的に接続される。なお、本願の実施例では、第２負電源アクセス端子２０が第２正電源アクセス端子１５と第３正電源アクセス端子１６との間に位置する場合を例として説明する。
負電源補助線２２は、周辺領域Ｂ２に位置し、第１方向ｘに沿って第２負電源アクセス端子２０と第４負電源アクセス端子２４との間に位置し、第２方向ｙに沿って正電源バス１３と第２負電源アクセス端子２０との間に位置し、負電源補助線２２、第２負電源アクセス端子２０、及び第４負電源アクセス端子２４は一体となっている構造であり、第１方向ｘと第２方向ｙとが交差し、例えば、第１方向ｘと第２方向ｙとが直交である。
負電源補助線２２は、補助電極１８に電気的に接続され、負電源補助線２２のベース基板１０での正投影と補助電極１８のベース基板１０での正投影は、少なくとも一部が重なる。
【0031】
選択的に、第１正電源アクセス端子１４、第２正電源アクセス端子１５、及び第３正電源アクセス端子１６は、正電源バス１３、及び正電源線１２を介して正電圧信号を発光素子の第１電極に伝送するように構成され、正電圧信号を該発光素子に伝送し、ひいては正電圧信号を該発光素子のサブ画素１１に伝送する。第１負電源アクセス端子１９、及び第３負電源アクセス端子２１は、負電源線１７、及び補助電極１８を介して負電圧信号を発光素子の第２電極に伝送するように構成され、負電圧信号を該発光素子に伝送し、ひいては負電圧信号を該発光素子のサブ画素１１に伝送する。第２負電源アクセス端子２０、及び第４負電源アクセス端子２４は、負電源補助線２２、及び補助電極１８を介して負電圧信号を発光素子の第２電極に伝送するように構成され、これにより負電圧信号を該発光素子に伝送し、ひいては負電圧信号を該発光素子が位置するサブ画素１１に伝送する。
【0032】
例えば、図１～図４に示すように、第１正電源アクセス端子１４、第２正電源アクセス端子１５、及び第３正電源アクセス端子１６において、各正電源アクセス端子は、正電源バス１３、及び正電源線１２を介して該正電源線１２に電気的に接続される第１電極に正電圧信号を伝送するように構成され、これにより該第１電極の位置する発光素子に正電圧信号を伝送する。各正電源アクセス端子における正電圧信号は、正電源バス１３を介して該正電源アクセス端子に近い正電源線１２に伝送されて、該正電源線１２に電気的に接続される発光素子に伝送される。例えば、第１正電源アクセス端子１４及び第３正電源アクセス端子１６における正電圧信号は、正電源バス１３を介して左右両側（図１～図４に示す配置位置の左右両側）の正電源線１２に電気的に接続される発光素子に伝送され、第２正電源アクセス端子１５における正電圧信号は、正電源バス１３を介して中央領域（図１～図４に示す配置位置の中央領域）の正電源線１２に電気的に接続される発光素子に伝送される。このようにして、正電源アクセス端子によって発光素子に伝送される正電圧信号の通過経路が短くなって、正電圧信号を発光素子に伝送するための信号伝送線が短くなり、インピーダンスが小さくなるため、アレイ基板に表示される画面の輝度の均一性を確保するのに有利である。
【0033】
当業者であれば容易に理解できるように、第１正電源アクセス端子１４、第２正電源アクセス端子１５、及び第３正電源アクセス端子１６は、正電圧信号をアレイ基板におけるすべてのサブ画素の発光素子に同時に伝送する。ただし、第１正電源アクセス端子１４及び第３正電源アクセス端子１６が左右両側の発光素子に近いため、左右両側の発光素子に第１正電源アクセス端子１４及び第３正電源アクセス端子１６からの正電圧信号が伝送されるのは通過経路が短く、インピーダンスが小さく、第２正電源アクセス端子１５が中央領域の発光素子に近いため、中央領域の発光素子に第２正電源アクセス端子１５からの正電圧信号が伝送されるのは通過経路が短く、インピーダンスが小さい。
【0034】
例えば、図１～図４に示すように、第１負電源アクセス端子１９及び第３負電源アクセス端子２１のうち、各負電源アクセス端子は、負電源線１７、及び補助電極１８を介して負電圧信号を該補助電極１８に電気的に接続される第２電極に伝送するように構成され、該第２電極の位置する発光素子に負電圧信号を伝送する。第２負電源アクセス端子２０は、負電源補助線２２、及び補助電極１８を介して負電圧信号を該補助電極１８に電気的に接続される第２電極に伝送するように構成され、該第２電極の位置する発光素子に負電圧信号を伝送する。第１負電源アクセス端子１９及び第３負電源アクセス端子２１における負電圧信号は、負電源線１７及び補助電極１８を介して左右両側（図１～図４に示す配置位置の左右両側）の発光素子に伝送され、第２負電源アクセス端子２０における負電圧信号は、負電源補助線２２及び補助電極１８を介して中央領域（図１～図４に示す配置位置の中央領域）の発光素子に伝送される。このようにして、負電源アクセス端子から発光素子に伝送される負電圧信号の通過経路が短くなって、発光素子に負電圧信号を伝送するための信号伝送線が短くなり、インピーダンスが小さいため、アレイ基板に表示される画面の輝度の均一性を確保するのに有利である。図３及び図４に示すように、第４負電源アクセス端子２４も、負電源補助線２２、及び補助電極１８を介して負電圧信号を該補助電極１８に電気的に接続される第２電極に伝送するように構成され、該第２電極の位置する発光素子に負電圧信号を伝送する。第４負電源アクセス端子２４における負電圧信号は、負電源補助線２２、及び補助電極１８を介して中央領域（図４に示す配置位置の中央領域）の発光素子に伝送するできる。このようにして、第４負電源アクセス端子２４から発光素子に伝送されたる負電圧信号の通過経路が短く、発光素子に伝送されたる負電圧信号の信号伝送線が短く、インピーダンスが小さくなるため、アレイ基板に表示される画面の輝度の均一性を確保するのに有利である。
【0035】
当業者であれば容易に理解できるように、図１及び図２に示すアレイ基板において、第１負電源アクセス端子１９、第２負電源アクセス端子２０、及び第３負電源アクセス端子２１は、負電圧信号をアレイ基板におけるすべてのサブ画素の発光素子に同時に伝送する。ただし、第１負電源アクセス端子１９及び第３負電源アクセス端子２１が左右両側の発光素子に近いため、左右両側の発光素子に第１負電源アクセス端子１９及び第３負電源アクセス端子２１からの負電圧信号が伝送されるのは通過経路が短く、インピーダンスが小さく、第２負電源アクセス端子２０が中央領域の発光素子に近いため、中央領域の発光素子に第２負電源アクセス端子２０からの負電圧信号が伝送されるのは通過経路が短く、インピーダンスが小さい。図３及び図４に示すアレイ基板において、第１負電源アクセス端子１９、第２負電源アクセス端子２０、第３負電源アクセス端子２１、及び第４負電源アクセス端子２４は、負電圧信号をアレイ基板におけるすべてのサブ画素の発光素子に同時に伝送する。ただし、第１負電源アクセス端子１９及び第３負電源アクセス端子２１が左右両側の発光素子に近いため、左右両側の発光素子に第１負電源アクセス端子１９及び第３負電源アクセス端子２１からの負電圧信号が伝送されるのは通過経路が短く、インピーダンスが小さく、第２負電源アクセス端子２０、及び第４負電源アクセス端子２４が中央領域の発光素子に近いため、中央領域の発光素子に第２負電源アクセス端子２０、及び第４負電源アクセス端子２４からの負電圧信号が伝送されるのは通過経路が短く、インピーダンスが小さい。
図１～図４は、単なる本願の例示的な実施形態であり、いくつかの実施形態において、アレイ基板は、第４負電源アクセス端子２４を含まず、第２負電源アクセス端子２０を介して中央領域の発光素子に負電圧信号を伝送してもよい。例えば、図１及び図２に示すアレイ基板は、第４負電源アクセス端子２４を含まず、第２負電源アクセス端子２０を介して中央領域の発光素子に負電圧信号を伝送する。
図１～図４は、単なる本願の例示的な実施形態であり、いくつかの実施形態において、アレイ基板は、第４負電源アクセス端子２４を含まず、第２負電源アクセス端子２０を介して中央領域の発光素子に負電圧信号を伝送してもよい。例えば、図１及び図２に示すアレイ基板は、第４負電源アクセス端子２４を含まず、第２負電源アクセス端子２０を介して中央領域の発光素子に負電圧信号を伝送する。
【0036】
以上のように、本願の実施例によるアレイ基板は、第１正電源アクセス端子と、第２正電源アクセス端子と、第３正電源アクセス端子と、第１負電源アクセス端子と、第２負電源アクセス端子と、第３負電源アクセス端子とを含み、第２正電源アクセス端子及び第２負電源アクセス端子はいずれも第１正電源アクセス端子と第３正電源アクセス端子との間に位置し、各正電源アクセス端子は正電源バス及び正電源線を介してそれに近いサブ画素の発光素子に正電圧信号を伝送することができ、各負電源アクセス端子は、負電源線、負電源補助線、及び補助電極を介してそれに近いサブ画素の発光素子に負電圧信号を伝送することができ、それにより、発光素子に正電圧信号を伝送するための信号伝送線の長さ及び発光素子に負電圧信号を伝送するための信号伝送線はいずれも短く、インピーダンスが小さいため、アレイ基板に表示される画面の輝度の均一性を確保するのに有利である。
【0037】
選択的に、本願の実施例では、前記アレイ基板は、
前記正電源バスの前記表示領域から離れた側の前記周辺領域に位置しかつ前記第１正電源アクセス端子と前記第３正電源アクセス端子との間に位置し、前記正電源バスに電気的に接続される第４正電源アクセス端子をさらに含み、例えば、前記第４正電源アクセス端子は、前記第２負電源アクセス端子と前記第３正電源アクセス端子との間に位置し、そして、前記第４正電源アクセス端子は、前記第４負電源アクセス端子と前記第３正電源アクセス端子との間に位置し、
前記第４正電源アクセス端子は、前記正電源バス、及び前記正電源線を介して前記発光素子の前記第１電極に正電圧信号を伝送するように構成される。
前記正電源バスの前記表示領域から離れた側の前記周辺領域に位置しかつ前記第１正電源アクセス端子と前記第３正電源アクセス端子との間に位置し、前記正電源バスに電気的に接続される第４正電源アクセス端子をさらに含み、例えば、前記第４正電源アクセス端子は、前記第２負電源アクセス端子と前記第３正電源アクセス端子との間に位置し、そして、前記第４正電源アクセス端子は、前記第４負電源アクセス端子と前記第３正電源アクセス端子との間に位置し、
前記第４正電源アクセス端子は、前記正電源バス、及び前記正電源線を介して前記発光素子の前記第１電極に正電圧信号を伝送するように構成される。
【0038】
例示的に、図１及び図２に示すように、該アレイ基板は、
正電源バス１３の表示領域Ｂ１から離れた側の周辺領域Ｂ２に位置しかつ第２負電源アクセス端子２０と第３正電源アクセス端子１６との間に位置し、該第４正電源アクセス端子２３は、正電源バス１３に電気的に接続され、第４正電源アクセス端子２３は、正電源バス１３、及び正電源線１２を介して正電圧信号を発光素子の第１電極に伝送するように構成される。
正電源バス１３の表示領域Ｂ１から離れた側の周辺領域Ｂ２に位置しかつ第２負電源アクセス端子２０と第３正電源アクセス端子１６との間に位置し、該第４正電源アクセス端子２３は、正電源バス１３に電気的に接続され、第４正電源アクセス端子２３は、正電源バス１３、及び正電源線１２を介して正電圧信号を発光素子の第１電極に伝送するように構成される。
【0039】
例示的に、図４に示すように、該アレイ基板は、
正電源バス１３の表示領域Ｂ１から離れた側の周辺領域Ｂ２、且つ第４負電源アクセス端子２４と第３正電源アクセス端子１６との間に位置し、する第４正電源アクセス端子２３且つ正電源バス１３に電気的に接続される第４正電源アクセス端子２３をさらに含み、
第４正電源アクセス端子２３は、正電源バス１３、及び正電源線１２を介して正電圧信号を発光素子の第１電極に伝送するように構成される。
正電源バス１３の表示領域Ｂ１から離れた側の周辺領域Ｂ２、且つ第４負電源アクセス端子２４と第３正電源アクセス端子１６との間に位置し、する第４正電源アクセス端子２３且つ正電源バス１３に電気的に接続される第４正電源アクセス端子２３をさらに含み、
第４正電源アクセス端子２３は、正電源バス１３、及び正電源線１２を介して正電圧信号を発光素子の第１電極に伝送するように構成される。
【0040】
図１、図２、及び図４に示すように、第４正電源アクセス端子２３と第２正電源アクセス端子１５は対称であってもよく。第４正電源アクセス端子２３及び第２正電源アクセス端子１５における正電圧信号は、正電源バス１３を介して中央領域（図２及び図４に示す配置位置の中央領域）の正電源線１２に電気的に接続される発光素子に伝送されることができる。このようにして、正電源アクセス端子から発光素子に伝送される正電圧信号の通過経路が短いため、発光素子に正電圧信号を伝送するための信号伝送線が短く、インピーダンスが小さくなって、アレイ基板に表示される画面の輝度の均一性を確保するのに有利である。
【0041】
当業者であれば容易に理解できるように、第１正電源アクセス端子１４、第２正電源アクセス端子１５、第３正電源アクセス端子１６、及び第４正電源アクセス端子２３は、正電圧信号をアレイ基板におけるすべてのサブ画素の発光素子に同時に伝送し、第１負電源アクセス端子１９、第２負電源アクセス端子２０、第３負電源アクセス端子２１、及び第４負電源アクセス端子２４は、負電圧信号をアレイ基板におけるすべてのサブ画素の発光素子に同時に伝送する。ただし、第２正電源アクセス端子１５及び第４正電源アクセス端子２３が中央領域の発光素子に近いため、中央領域の発光素子に第２正電源アクセス端子１５及び第４正電源アクセス端子２３からの正電圧信号が伝送されるのは通過経路が短く、インピーダンスが小さく、第１正電源アクセス端子１４、および第３正電源アクセス端子１６は左右両側の発光素子に近いため、左右両側の発光素子に第１正電源アクセス端子１４、および第３正電源アクセス端子１６からの正電圧信号が伝送されるのは通過経路が短く、インピーダンスが小さく、第２負電源アクセス端子２０及び第４負電源アクセス端子２４が中央領域の発光素子に近いため、中央領域の発光素子に第２負電源アクセス端子２０及び第４負電源アクセス端子２４からの負電圧信号が伝送されるのは通過経路が短く、インピーダンスが小さく、第１負電源アクセス端子１９、および第３負電源アクセス端子２１は左右両側の発光素子に近いため、左右両側の発光素子に第１負電源アクセス端子１９、および第３負電源アクセス端子２１からの負電圧信号が伝送されるのは通過経路が短く、インピーダンスが小さい。
【0042】
選択的に、前記第１正電源アクセス端子と前記第３正電源アクセス端子は、前記負電源補助線に対して対称に設けられ、及び/または、前記第１負電源アクセス端子と前記第３負電源アクセス端子は、前記負電源補助線に対して対称に設けられ、及び/または、前記第２正電源アクセス端子と前記第４正電源アクセス端子は、前記負電源補助線に対して対称に設けられ、及び/または、前記第２負電源アクセス端子と前記第４負電源アクセス端子は、前記負電源補助線に対して対称に設けられる。
例示的に、図１及び図２に示すように、第１正電源アクセス端子１４と第３正電源アクセス端子１６は、負電源補助線２２に対して対称に設けられ、第２正電源アクセス端子１５と第４正電源アクセス端子２３は、負電源補助線２２に対して対称に設けられ、第１負電源アクセス端子１９と第３負電源アクセス端子２１は、負電源補助線２２に対して対称に設けられる。図３に示すように、第１正電源アクセス端子１４と第３正電源アクセス端子１６は、負電源補助線２２に対して対称に設けられ、第１負電源アクセス端子１９と第３負電源アクセス端子２１は、負電源補助線２２に対して対称に設けられる。第２負電源アクセス端子２０と第４負電源アクセス端子２４は、負電源補助線２２に対して対称に設けられる。図４に示すように、第１正電源アクセス端子１４と第３正電源アクセス端子１６は、負電源補助線２２に対して対称に設けられ、第２正電源アクセス端子１５と第４正電源アクセス端子２３は、負電源補助線２２に対して対称に設けられ、第１負電源アクセス端子１９と第３負電源アクセス端子２１は、負電源補助線２２に対して対称に設けられ、第２負電源アクセス端子２０と第４負電源アクセス端子２４は、負電源補助線２２に対して対称に設けられる。
例示的に、図１及び図２に示すように、第１正電源アクセス端子１４と第３正電源アクセス端子１６は、負電源補助線２２に対して対称に設けられ、第２正電源アクセス端子１５と第４正電源アクセス端子２３は、負電源補助線２２に対して対称に設けられ、第１負電源アクセス端子１９と第３負電源アクセス端子２１は、負電源補助線２２に対して対称に設けられる。図３に示すように、第１正電源アクセス端子１４と第３正電源アクセス端子１６は、負電源補助線２２に対して対称に設けられ、第１負電源アクセス端子１９と第３負電源アクセス端子２１は、負電源補助線２２に対して対称に設けられる。第２負電源アクセス端子２０と第４負電源アクセス端子２４は、負電源補助線２２に対して対称に設けられる。図４に示すように、第１正電源アクセス端子１４と第３正電源アクセス端子１６は、負電源補助線２２に対して対称に設けられ、第２正電源アクセス端子１５と第４正電源アクセス端子２３は、負電源補助線２２に対して対称に設けられ、第１負電源アクセス端子１９と第３負電源アクセス端子２１は、負電源補助線２２に対して対称に設けられ、第２負電源アクセス端子２０と第４負電源アクセス端子２４は、負電源補助線２２に対して対称に設けられる。
【0043】
選択的に、本願の実施例では、前記正電源バスは、前記第１正電源アクセス端子、前記第２正電源アクセス端子、前記第３正電源アクセス端子、および前記第４正電源アクセス端子の少なくとも一つと一体となっている構造である。
【0044】
例示的に、図１、図２及び図４に示すアレイ基板において、正電源バス１３は、第１正電源アクセス端子１４、第２正電源アクセス端子１５、第３正電源アクセス端子１６、及び第４正電源アクセス端子２３と一体となっている構造である。図３に示すアレイ基板において、正電源バス１３は、第１正電源アクセス端子１４、第２正電源アクセス端子１５、及び第３正電源アクセス端子１６と一体となっている構造である。
【0045】
選択的に、本願の実施例では、前記第１正電源アクセス端子、前記第２正電源アクセス端子、前記第３正電源アクセス端子、前記第４正電源アクセス端子、前記第１負電源アクセス端子、前記第２負電源アクセス端子、前記第３負電源アクセス端子、及び前記第４負電源アクセス端子の少なくとも一つは、前記正電源バスとの角度は直角である。
【0046】
例示的に、図１及び図２に示すアレイ基板において、第１正電源アクセス端子１４、第２正電源アクセス端子１５、第３正電源アクセス端子１６、第４正電源アクセス端子２３、第１負電源アクセス端子１９、第２負電源アクセス端子２０、及び第３負電源アクセス端子２１のうち、いずれも正電源バスとの角度は直角である。図３に示すアレイ基板において、第１正電源アクセス端子１４、第２正電源アクセス端子１５、第３正電源アクセス端子１６、第１負電源アクセス端子１９、第２負電源アクセス端子２０、及び第３負電源アクセス端子２１、及び第４負電源アクセス端子２４のうち、いずれも正電源バスとの角度は直角である。図４に示すアレイ基板において、第１正電源アクセス端子１４、第２正電源アクセス端子１５、第３正電源アクセス端子１６、第４正電源アクセス端子２３、第１負電源アクセス端子１９、第２負電源アクセス端子２０、及び第３負電源アクセス端子２１、第４負電源アクセス端子２４のうち、いずれも正電源バスとの角度は直角である。
【0047】
選択的に、本願の実施例では、前記第１正電源アクセス端子、前記第２正電源アクセス端子、前記第３正電源アクセス端子、前記第４正電源アクセス端子、前記第１負電源アクセス端子、前記第２負電源アクセス端子、前記第３負電源アクセス端子、及び前記第４負電源アクセス端子の少なくとも一つは、前記ベース基板での正投影の形状が折れ線状である。
【0048】
例示的に、図１及び図２に示すアレイ基板において、第１正電源アクセス端子１４、第２正電源アクセス端子１５、第３正電源アクセス端子１６、第４正電源アクセス端子２３、第１負電源アクセス端子１９、及び第３負電源アクセス端子２１のうち、いずれもベース基板での正投影の形状が折れ線状である。図３に示すアレイ基板において、第１正電源アクセス端子１４、第２正電源アクセス端子１５、第３正電源アクセス端子１６、第１負電源アクセス端子１９、第２負電源アクセス端子２０、第３負電源アクセス端子２１、および第４負電源アクセス端子２４のうち、いずれもベース基板での正投影の形状が折れ線状である。図４に示すアレイ基板において、第１正電源アクセス端子１４、第２正電源アクセス端子１５、第３正電源アクセス端子１６、第４正電源アクセス端子２３、第１負電源アクセス端子１９、第２負電源アクセス端子２０、第３負電源アクセス端子２１、および第４負電源アクセス端子２４のうち、いずれもベース基板での正投影の形状が折れ線状である。
【0049】
選択的に、本願の実施例では、前記第１負電源アクセス端子、前記第３負電源アクセス端子、及び前記負電源線は一体となっている構造である。例えば、図１～図４に示すアレイ基板において、第１負電源アクセス端子１９、第３負電源アクセス端子２１、および負電源線は一体となっている構造である。
【0050】
選択的に、本願の実施例では、前記補助電極の構成は、閉リングであり、前記補助電極は、前記表示領域を取り囲む。例えば、図１～図４に示すように、補助電極１８は、閉リングであり、補助電極１８は、表示領域Ｂ１を取り囲む。すなわち、補助電極１８は、表示領域Ｂ１の４つの境界に沿って延びる閉リング構成である。
【0051】
選択的に、本願の実施例では、前記発光素子は有機発光ダイオードであり、前記第１電極は陽極であり、前記第２電極は陰極である。
【0052】
選択的に、本願の実施例では、前記複数のサブ画素のうちの少なくとも１つは、薄膜トランジスタ及び接続電極を含み、前記薄膜トランジスタは、前記ベース基板上に位置する活性層と、前記活性層の前記ベース基板から離れた側に位置するゲートと、前記ゲートの前記ベース基板から離れた側に位置するソース及びドレインとを含む。
【0053】
選択的に、前記正電源バスは、電気的に接続されている、正電源バス第１サブ層と、正電源バス第２サブ層とを含み、
前記正電源バス第１サブ層は前記ソース又は前記ドレインと同一層に位置し、前記正電源バス第２サブ層は前記接続電極と同一層に位置する。
前記正電源バス第１サブ層は前記ソース又は前記ドレインと同一層に位置し、前記正電源バス第２サブ層は前記接続電極と同一層に位置する。
【0054】
選択的に、前記正電源バス第１サブ層と前記正電源バス第２サブ層は、正電源バスのビアを介して電気的に接続される。
【0055】
選択的に、前記負電源線は、電気的に接続されている、負電源線第１サブ層と、負電源線第２サブ層とを含み、
前記負電源補助線は、電気的に接続されている、負電源補助線第１サブ層と、負電源補助線第２サブ層とを含み、
前記負電源線第１サブ層及び前記負電源補助線第１サブ層はいずれも前記ソース又は前記ドレインと同一層に位置し、前記負電源線第２サブ層及び前記負電源補助線第２サブ層はいずれも前記接続電極と同一層に位置する。
前記負電源補助線は、電気的に接続されている、負電源補助線第１サブ層と、負電源補助線第２サブ層とを含み、
前記負電源線第１サブ層及び前記負電源補助線第１サブ層はいずれも前記ソース又は前記ドレインと同一層に位置し、前記負電源線第２サブ層及び前記負電源補助線第２サブ層はいずれも前記接続電極と同一層に位置する。
【0056】
選択的に、前記負電源線第１サブ層と前記負電源線第２サブ層は、負電源線ビアを介して電気的に接続され、前記負電源補助線第１サブ層と前記負電源補助線第２サブ層は負電源補助線ビアを介して電気的に接続される。
【0057】
例示的に、図５を参照して、図１～図４のいずれか１つに示すアレイ基板のａ－ａ部位、ｂ－ｂ部位、ｃ－ｃ部位、及びｅ－ｅ部位の断面図が示されている。図５に示すように、複数のサブ画素１１のうちの少なくとも１つは、薄膜トランジスタ１１０と、接続電極１１１とを含み、薄膜トランジスタ１１０は、ベース基板１０上に位置する活性層１１０１と、活性層１１０１のベース基板１０から離れた側に位置するゲート１１０２と、ゲート１１０２のベース基板１０から離れた側に位置するソース１１０３及びドレイン１１０４とを含み、ソース１１０３及びドレイン１１０４は同一層に位置してもよい。
【0058】
正電源バス１３は、正電源バスのビア（図５には図示せず）を介して電気的に接続されている、正電源バス第１サブ層１３１と、正電源バス第２サブ層１３２とを含む。該正電源バス第１サブ層１３１は、ソース１１０３又はドレイン１１０４と同一層に位置し、該正電源バス第２サブ層１３２は、接続電極１１１と同一層に位置する。正電源バスのビアの数は複数であってもよく、正電源バス第１サブ層１３１及び正電源バス第２サブ層１３２は複数の正電源バスのビアを介して電気的に接続されて接続の信頼性を確保する。
【0059】
負電源線１７は、負電源線ビア（図５には図示せず）を介して電気的に接続されている、負電源線第１サブ層１７１と、負電源線第２サブ層１７２とを含む。負電源補助線２２は、負電源補助線ビアを介して電気的に接続されている、負電源補助線第１サブ層２２１と、負電源補助線第２サブ層２２２とを含む。負電源線第１サブ層１７１及び負電源補助線第１サブ層２２１はいずれもソース１１０３又はドレイン１１０４と同一層に位置し、負電源線第２サブ層１７２及び負電源補助線第２サブ層２２２はいずれも接続電極１１１と同一層に位置する。負電源線ビアの数及び負電源補助線ビアの数はいずれも複数であってもよく、負電源線第１サブ層１７１及び負電源線第２サブ層１７２は、複数の負電源線ビアを介して電気的に接続されて接続の信頼性を確保し、負電源補助線第１サブ層２２１及び負電源補助線第２サブ層２２２は複数の負電源補助線ビアを介して電気的に接続されて接続の信頼性を確保する。
【0060】
選択的に、本願の実施例では、前記補助電極は、前記負電源線の前記ベース基板から離れた側に位置し、負電源補助ビアを介して前記負電源補助線に電気的に接続される。
【0061】
例示的に、図５に示すように、補助電極１８は負電源線１７のベース基板１０から離れた側に位置しており、補助電極１８は負電源補助ビアを介して負電源補助線２２に電気的に接続され、例えば、補助電極１８は負電源補助ビアを介して負電源補助線第２サブ層２２２に電気的に接続される。負電源補助ビアの数は複数であってもよく、補助電極１８及び負電源補助線第２サブ層２２２は複数の負電源補助ビアを介して電気的に接続されて接続の信頼性を確保する。
【0062】
選択的に、本願の実施例では、前記補助電極は前記負電源線の前記ベース基板から離れた側に位置し、負電源補助ビアを介して前記負電源線に電気的に接続される。
【0063】
例示的に、図５に示すように、補助電極１８は負電源線１７のベース基板１０から離れた側に位置しており、補助電極１８は負電源補助ビアを介して負電源線１７に電気的に接続される。例えば、補助電極１８は負電源補助ビアを介して負電源線第２サブ層１７２に電気的に接続される。負電源補助ビアの数は複数であってもよく、補助電極１８及び負電源線第２サブ層１７２は複数の負電源補助ビアを介して電気的に接続されて接続の信頼性を確保する。
【0064】
当業者であれば容易に理解できるように、補助電極１８と負電源補助線第２サブ層２２２を接続する負電源補助ビアは、補助電極１８と負電源補助線第２サブ層２２２との間の絶縁層に位置するビアであり、補助電極１８と負電源線第２サブ層１７２を接続する負電源補助ビアは、補助電極１８と負電源線第２サブ層１７２との間の絶縁層に位置するビアであり、補助電極１８と負電源補助線第２サブ層２２２を接続する負電源補助ビアは、補助電極１８と負電源線第２サブ層１７２を接続する負電源補助ビアとは異なる。
【0065】
選択的に、本願の実施例では、前記複数のサブ画素のうちの少なくとも１つは、薄膜トランジスタを含み、前記薄膜トランジスタは、前記ベース基板上に位置する活性層と、前記活性層の前記ベース基板から離れた側に位置するゲートと、前記ゲートの前記ベース基板から離れた側に位置するソース及びドレインとを含み、前記第１正電源アクセス端子、前記第２正電源アクセス端子、及び前記第３正電源アクセス端子は、いずれも前記ソース又は前記ドレインと同一層に位置し、前記第１負電源アクセス端子、前記第２負電源アクセス端子、及び前記第３負電源アクセス端子は、いずれも前記ソース又は前記ドレインと同一層に位置する。
【0066】
例示的に、図６を参照して、図１に示すアレイ基板のａ－ａ部位及びｆ－ｆ部位の断面図が示されている。図６に示すように、複数のサブ画素１１のうちの少なくとも１つは、薄膜トランジスタ１１０を含み、薄膜トランジスタ１１０は、ベース基板１０上に位置する活性層１１０１と、活性層１１０１のベース基板１０から離れた側に位置するゲート１１０２と、ゲート１１０２のベース基板１０から離れた側に位置するソース１１０３及びドレイン１１０４とを含み、第１正電源アクセス端子１４、第２正電源アクセス端子１５、及び第３正電源アクセス端子１６は、いずれもソース１１０３又はドレイン１１０４と同一層に位置し、第１負電源アクセス端子１９、第２負電源アクセス端子２０、及び第３負電源アクセス端子２１は、いずれもソース１１０３又はドレイン１１０４と同一層に位置する。
【0067】
選択的に、本願の実施例では、アレイ基板は、第４正電源アクセス端子、及び／又は、第４負電源アクセス端子をさらに含む。該第４正電源アクセス端子、及び／又は、第４負電源アクセス端子は、いずれも前記ソース又は前記ドレインと同一層に位置する。
【0068】
例示的に、図７を参照して、図２に示すアレイ基板のａ－ａ部位及びｆ－ｆ部位の断面図が示されている。図７に示すように、第１正電源アクセス端子１４、第２正電源アクセス端子１５、第３正電源アクセス端子１６、及び第４正電源アクセス端子２３は、いずれもソース１１０３又はドレイン１１０４と同一層に位置し、第１負電源アクセス端子１９、第２負電源アクセス端子２０、及び第３負電源アクセス端子２１は、いずれもソース１１０３又はドレイン１１０４と同一層に位置する。
【0069】
例示的に、図８を参照して、図３に示すアレイ基板のａ－ａ部位及びｆ－ｆ部位の断面図が示されている。図８に示すように、第１正電源アクセス端子１４、第２正電源アクセス端子１５、及び第３正電源アクセス端子１６は、いずれもソース１１０３又はドレイン１１０４と同一層に位置し、第１負電源アクセス端子１９、第２負電源アクセス端子２０、第３負電源アクセス端子２１、及び第４負電源アクセス端子２４は、いずれもソース１１０３又はドレイン１１０４と同一層に位置する。
【0070】
例示的に、図９を参照して、図４に示すアレイ基板のａ－ａ部位及びｆ－ｆ部位の断面図が示されている。図９に示すように、第１正電源アクセス端子１４、第２正電源アクセス端子１５、第３正電源アクセス端子１６、及び第４正電源アクセス端子２３は、いずれもソース１１０３又はドレイン１１０４と同一層に位置し、第１負電源アクセス端子１９、第２負電源アクセス端子２０、第３負電源アクセス端子２１、及び第４負電源アクセス端子２４は、いずれもソース１１０３又はドレイン１１０４と同一層に位置する。
【0071】
選択的に、本願の実施例では、前記負電源補助線は、電気的に接続されている、負電源補助線第１サブ層と、負電源補助線第２サブ層とを含み、前記負電源補助線第２サブ層は、前記負電源補助線第１サブ層の前記ベース基板から離れた側に位置し、前記第２負電源アクセス端子、前記第４負電源アクセス端子、及び前記負電源補助線第１サブ層は一体となっている構造である。
【0072】
例示的に、図１０を参照して、図３又は図４に示すアレイ基板のａ－ａ部位及びｇ－ｇ部位の断面図が示されている。図１０に示すように、負電源補助線２２は、負電源補助線ビア（図１０には図示せず）を介して電気的に接続されている、負電源補助線第１サブ層２２１と、負電源補助線第２サブ層２２２とを含み、負電源補助線第２サブ層２２２は、負電源補助線第１サブ層２２１のベース基板から離れた側に位置し、第２負電源アクセス端子２０、第４負電源アクセス端子２４、及び負電源補助線第１サブ層２２１は一体となっている構造である。
【0073】
なお、図１０には、アレイ基板が第２負電源アクセス端子２０と第４負電源アクセス端子２４とをともに含む場合を例として説明するが、アレイ基板が第２負電源アクセス端子２０又は第４負電源アクセス端子２４のいずれか一方のみを含む場合、第２負電源アクセス端子２０又は第４負電源アクセス端子２４、及び負電源補助線第１サブ層２２１は一体となっている構造である。例えば、アレイ基板が第２負電源アクセス端子２０を含むが、第４負電源アクセス端子２４を含まない場合、第２負電源アクセス端子２０及び負電源補助線第１サブ層２２１は一体となっている構造であり、アレイ基板が第４負電源アクセス端子２４を含むが、第２負電源アクセス端子２０を含まない場合、第４負電源アクセス端子２４及び負電源補助線第１サブ層２２１は一体となっている構造である。
【0074】
選択的に、本願の実施例では、前記アレイ基板は、前記第１正電源アクセス端子、前記第２正電源アクセス端子、前記第３正電源アクセス端子、前記第４正電源アクセス端子、前記第１負電源アクセス端子、前記第２負電源アクセス端子、前記第３負電源アクセス端子、及び前記第４負電源アクセス端子の前記表示領域から離れた側の前記周辺領域に位置する回路基板であって、前記第１正電源アクセス端子、前記第２正電源アクセス端子、前記第３正電源アクセス端子、前記第４正電源アクセス端子、前記第１負電源アクセス端子、前記第２負電源アクセス端子、前記第３負電源アクセス端子、及び前記第４負電源アクセス端子がそれぞれ電気的に接続される回路基板をさらに含む。
【0075】
例示的に、図１に示すように、該アレイ基板は、第１正電源アクセス端子１４、第２正電源アクセス端子１５、第３正電源アクセス端子１６、第１負電源アクセス端子１９、第２負電源アクセス端子２０、及び第３負電源アクセス端子２１の表示領域Ｂ１から離れた側の前記周辺領域Ｂ２に位置する回路基板であって、第１正電源アクセス端子１４、第２正電源アクセス端子１５、第３正電源アクセス端子１６、第１負電源アクセス端子１９、第２負電源アクセス端子２０、及び第３負電源アクセス端子２１がそれぞれ電気的に接続される回路基板２５をさらに含む。
【0076】
例示的に、図２に示すように、該アレイ基板は、第１正電源アクセス端子１４、第２正電源アクセス端子１５、第３正電源アクセス端子１６、第４正電源アクセス端子２３、第１負電源アクセス端子１９、第２負電源アクセス端子２０、及び第３負電源アクセス端子２１の表示領域Ｂ１から離れた側の前記周辺領域Ｂ２に位置する回路基板であって、第１正電源アクセス端子１４、第２正電源アクセス端子１５、第３正電源アクセス端子１６、第４正電源アクセス端子２３、第１負電源アクセス端子１９、第２負電源アクセス端子２０、及び第３負電源アクセス端子２１がそれぞれ電気的に接続される回路基板２５をさらに含む。
【0077】
例示的に、図３に示すように、該アレイ基板は、第１正電源アクセス端子１４、第２正電源アクセス端子１５、第３正電源アクセス端子１６、第１負電源アクセス端子１９、第２負電源アクセス端子２０、第３負電源アクセス端子２１、及び第４負電源アクセス端子２４の表示領域Ｂ１から離れた側の前記周辺領域Ｂ２に位置する回路基板であって、第１正電源アクセス端子１４、第２正電源アクセス端子１５、第３正電源アクセス端子１６、第１負電源アクセス端子１９、第２負電源アクセス端子２０、第３負電源アクセス端子２１、及び第４負電源アクセス端子２４がそれぞれ電気的に接続される回路基板２５をさらに含む。
【0078】
例示的に、図４に示すように、該アレイ基板は、第１正電源アクセス端子１４、第２正電源アクセス端子１５、第３正電源アクセス端子１６、第４正電源アクセス端子２３、第１負電源アクセス端子１９、第２負電源アクセス端子２０、第３負電源アクセス端子２１、及び第４負電源アクセス端子２４の表示領域Ｂ１から離れた側の前記周辺領域Ｂ２に位置する回路基板であって、第１正電源アクセス端子１４、第２正電源アクセス端子１５、第３正電源アクセス端子１６、第４正電源アクセス端子２３、第１負電源アクセス端子１９、第２負電源アクセス端子２０、第３負電源アクセス端子２１、及び第４負電源アクセス端子２４がそれぞれ電気的に接続される回路基板２５をさらに含む。
【0079】
なお、本願の実施例に記載の回路基板２５は、フレキシブル回路基板（英語：Ｆｌｅｘｉｂｌｅ Ｐｒｉｎｔｅｄ Ｃｉｒｃｕｉｔ、略称ＦＰＣ）であってもよい。
【0080】
例示的に、図５～図１０に示すように、複数のサブ画素１１のうちの少なくとも１つは、薄膜トランジスタ１１０と、接続電極１１１と、発光素子１１２と、蓄積容量１１３とを含む。薄膜トランジスタ１１０は、ベース基板１０上に位置する活性層１１０１と、活性層１１０１のベース基板１０から離れた側に位置する第１絶縁層１１０５と、第１絶縁層１１０５のベース基板１０から離れた側に位置するゲート１１０２と、ゲート１１０２のベース基板１０から離れた側に位置する第２絶縁層１１０６と、第２絶縁層１１０６のベース基板１０から離れた側に位置する第３絶縁層１１０７と、第３絶縁層１１０７のベース基板１０から離れた側に位置するソース１１０３及びドレイン１１０４とを含む。接続電極１１１は、薄膜トランジスタ１１０のベース基板１０から離れた側に位置し、接続電極１１１はドレイン１１０４に電気的に接続され、発光素子１１２は接続電極１１１のベース基板から離れた側に位置し、該発光素子１１２は、ベース基板１０から離れる方向において順に積層される、第１電極１１２１と、発光層１１２２と、第２電極１１２３とを含み、第１電極１１２１が接続電極１１１に電気的に接続される。蓄積容量１１３は、第１極板１１３１と、第２極板１１３２とを含み、第１極板１１３１がゲート１１０２と同一層に位置し、第２極板１１３２が第２絶縁層１１０６と第３絶縁層１１０７との間に位置する。
【0081】
例示的に、図５～図１０に示すように、複数のサブ画素１１のうちの少なくとも１つは、活性層１１０１とベース基板１０との間に位置するバッファ層１１４と、ベース基板１０から離れる方向においてソース１１０３と接続電極１１１との間に位置するパッシベーション層１１５及び第１平坦層１１６と、接続電極１１１と第１電極１１２１との間に位置する第２平坦層１１７とをさらに含む。パッシベーション層１１５及び第１平坦層１１６にはビアを有し、接続電極１１１は、パッシベーション層１１５及び第１平坦層１１６のビアを介してドレイン１１０４に電気的に接続され、第２平坦層１１７にはビアを有し、第１電極１１２１は第２平坦層１１７のビアを介して接続電極１１１に電気的に接続される。
【0082】
選択的に、図５～図１０に示すように、該アレイ基板は、画素定義層２６と、パッケージ構造２７とをさらに含む。該画素定義層２６は、第２平坦層１１７のベース基板１０から離れた側に位置し、バリア壁構造で定義される開口領域を含み、発光素子１１２が画素定義層２６の開口領域に位置する。該パッケージ構造２７は、発光素子１１２のベース基板から離れた側に位置し、発光素子１１２をパッケージすることに用いられる。
【0083】
なお、図５～図１０のｂ－ｂ部位、ｃ－ｃ部位、ｅ－ｅ部位、ｆ－ｆ部位、及びｇ－ｇ部位において、第１絶縁層１１０５、第２絶縁層１１０６、第３絶縁層１１０７、バッファ層１１４、パッシベーション層１１５、第１平坦層１１６、及び第２平坦層１１７は、ａ－ａ部位の第１絶縁層１１０５、第２絶縁層１１０６、第３絶縁層１１０７、バッファ層１１４、パッシベーション層１１５、第１平坦層１１６、及び第２平坦層１１７のそれぞれの周辺領域Ｂ２まで延伸した部分であってもよい。当業者であれば容易に理解できるように、図５～図１０のｂ－ｂ部位、ｃ－ｃ部位、ｅ－ｅ部位、ｆ－ｆ部位、及びｇ－ｇ部位において、正電源バス１３、第１正電源アクセス端子１４、第２正電源アクセス端子１５、第３正電源アクセス端子１６、負電源線１７、補助電極１８、第１負電源アクセス端子１９、第２負電源アクセス端子２０、第３負電源アクセス端子２１、負電源補助線２２、第４正電源アクセス端子２３、及び第４負電源アクセス端子２４のみが示されているが、アレイ基板の周辺領域は、図５～図１０に示されない他の回路構造を含んでもよい。
【0084】
なお、該アレイ基板では、本願で説明した構造に加えて、他の構造を含んでもよい。例えば、該アレイ基板は、同じ延伸方向の複数のゲートラインをさらに含んでもよく、同じ延伸方向の複数のデータライン、複数のゲートライン、及び複数のデータラインが交差して複数の画素領域を定義し、複数のサブ画素は複数の画素領域に一対一で位置する。さらに、例えば、該アレイ基板は、チップオンフィルム（英語：Ｃｈｉｐ Ｏｎ Ｆｉｌｍ、略称ＣＯＦ）及び集積回路（英語：Ｉｎｔｅｇｒａｔｅｄ Ｃｉｒｃｕｉｔ、略称ＩＣ）等をさらに含んでもよく、本願の実施例はここで説明を省略する。
【0085】
以上のように、本願の実施例によるアレイ基板は、第１正電源アクセス端子と、第２正電源アクセス端子と、第３正電源アクセス端子と、第１負電源アクセス端子と、第２負電源アクセス端子と、第３負電源アクセス端子とを含み、第２正電源アクセス端子及び第２負電源アクセス端子は、いずれも第１正電源アクセス端子と第３正電源アクセス端子との間に位置し、各正電源アクセス端子は、正電源バス及び正電源線を介してそれに近いサブ画素の発光素子に正電圧信号を伝送することができ、各負電源アクセス端子は、負電源線、負電源補助線、及び補助電極を介してそれに近いサブ画素の発光素子に負電圧信号を伝送することができ、それにより、発光素子に正電圧信号を伝送するための信号伝送線の長さ及び発光素子に負電圧信号を伝送するための信号伝送線がいずれも短く、インピーダンスが小さいため、アレイ基板に表示される画面の輝度の均一性を確保するのに有利である。
【0086】
同じ発明構想に基づき、本願の実施例は、表示装置をさらに提供し、該表示装置は、上記いずれか一つのアレイ基板を含む。本願の実施例における表示装置は、携帯電話、タブレットコンピュータ、テレビ、ディスプレイ、ノートパソコン、デジタルフォトフレーム、ナビゲータ等の表示機能を有する任意の製品又は部材であってもよい。
【0087】
本願の実施例では、用語「同一層」とは、同一のステップで同時に形成される層の間の関係を指す。例えば、負電源補助線第２サブ層２２２及び接続電極１１１は同一層の材料において同じパターニングプロセスの１つ又は複数のステップを実行することによって形成されるとき、それらは同一層に位置し、別の例では、負電源補助線第２サブ層２２２及び接続電極１１１は、負電源補助線第２サブ層２２２を形成するステップと、接続電極１１１を形成するステップとを同時に行うことにより、同一層に形成される。「同一層」とは、いつでも横断面図にはその層の厚さ又は高さが同じであることを意味するとは限らない。
【0088】
本願の実施例では、用語「第１」、「第２」、「第３」、「第４」及び類似した単語は、いかなる順次、数量又は重要性を示すものではなく、単に異なる構成要件を区別するために用いられるものである。２つの導体が「電気的に接続」されるとは、この２つの導体が直接又は間接的に電気的に接続されかつ電気信号を伝送できることである。用語「少なくとも１つ」は１つ又は複数を指し、「複数」は２つ又は２つ以上を指す。
【0089】
本願の実施例では、用語「及び／又は」は、関連する事物の関連関係を説明するために過ぎず、３つの関係が存在し得ることを表す。例えば、Ａ及び／又はＢは、Ａのみが存在する場合、Ａ及びＢの両方が存在する場合、Ｂのみが存在する場合を表すことができる。また、本明細書中における文字「／」は、一般的には、その前後の関連する事物の間の「又は」である関係を示す。
【0090】
なお、図面では、明確化のために、一部又はすべての層のサイズ、又は一部又はすべての領域のサイズが拡大されていることがある。かつ、要素又は層が、別の要素又は層「上」にあると記載された場合、他の要素の上に直接存在してもよく、又は介在する層が存在してもよいことが理解される。また、要素又は層が、別の要素又は層「下」にあると記載された場合、他の要素の下に直接存在してもよく、又は１つ以上の介在する層又は要素が存在してもよいことが理解される。さらに、層又は要素が、２層又は２つの要素の「間」に存在すると記載された場合、２層又は２つの素子の間の唯一な層であってもよく、又は１つ以上の中間層又は要素が存在してもよいことが理解される。全文を通じ、同じ符号は類似の要素を示している。
【0091】
以上は、本願の例示的な実施例に過ぎず、本願を制限するものではない。本願の思想と原則の範囲内で行われた変更、等価置換、改良等は、いずれも本願の保護範囲内に含まれるべきである。
【図1】
【図2】
【図3】
【図4】
【図5】
【図6】
【図7】
【図8】
【図9】
【図10】
