特許7425786IP Force 特許公報全文掲載

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技術分野

メモリ・アクセス制御

発明が解決しようとする課題[発明の詳細な説明]から抜粋

コンパートメントが共有されるメモリ・アドレス又は領域により互いに通信することに有用であり得る。しかしながら、次に、例えばメモリ・アドレス又は領域を別の目的に再割り当てすることなど、そのような共有アクセスを取り消すことができることが有用であると考えられる。いかなる時でも、共有メモリへのどの進行中の参照がまだ有効かどうか知ることは、システムにとって難しいことがあるため、これは困難な場合がある。

課題を解決するための手段[発明の詳細な説明]から抜粋

一実例の配置構成において、装置であって、処理スレッドを、それぞれが１つ又は複数の処理スレッドである１つ又は複数のプロセス・グループとして実行するためのマルチスレッド処理要素であって、それぞれのプロセス・グループは１つ又は複数のプロセス・グループの中で一意であるプロセス・グループ識別子を有し、仮想メモリ・アドレス空間内で機能データによって個々のメモリ・アドレス範囲に関連付けられる、マルチスレッ・・・　続きを知財ポータルサイト IP Force にログインして見る

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この特許公報に記載されている図面[図面の簡単な説明]から抜粋

【図1】 データ処理装置を概略的に示す図である。
【図2】 有界ポインタを概略的に示す図である。
【図3】 機能レジスタの使用を概略的に示す図である。
【図4】 機能フィールドのセットを概略的に表現する図である。
【図5】 トランスレーション・ルックアサイド・バッファ（ＴＬＢ：ｔｒａｎｓｌａｔｉｏｎ ｌｏｏｋａｓｉｄｅ ｂｕｆｆｅｒ）及びメモリ管理ユニット（ＭＭＵ：ｍｅｍｏｒｙ ｍａｎａｇｅｍｅｎｔ ｕｎｉｔ）の使用を概略的に示す図である。
【図6】 ＴＬＢ及びＭＭＵによる動作を図示する概略的なフローチャートである。
【図7】 コンパートメントのセットを概略的に示す図である。
【図8】 コンパートメント・マネージャによる共有メモリ領域の確立を概略的に示す図である。
【図9】 共有メモリ領域の使用を概略的に示す図である。
【図10】 共有メモリ領域の再割り当てを概略的に示す図である。
【図11】 メモリ・アドレス・トランスレーション・ユニットを概略的に示す図である。
【図12】 メモリ・アクセス条件を概略的に示す図である。
【図13】 メモリ・アクセス条件を概略的に示す図である。
【図14】 共有メモリ領域の再割り当てを概略的に示す図である。
【図15】 共有メモリ領域の再割り当てを概略的に示す図である。
【図16】 共有メモリ領域の再割り当てを概略的に示す図である。
【図17】 個々の方法を図示する概略的なフローチャートである。
【図18】 個々の方法を図示する概略的なフローチャートである。
【図19】 個々の方法を図示する概略的なフローチャートである。
【図20】 個々の方法を図示する概略的なフローチャートである。
【図21】 個々の方法を図示する概略的なフローチャートである。
【図22】 シミュレータ実装形態を概略的に示す図である。

代表図 図1本件の代表的な図

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