特許7910646IP Force 特許公報全文掲載

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技術分野

集積回路、及び電源回路

発明が解決しようとする課題[発明の詳細な説明]から抜粋

ところで、集積回路には、電源回路の負荷の状態に応じて動作モードを変更するものがある。

課題を解決するための手段[発明の詳細な説明]から抜粋

前述した課題を解決する主たる本発明の集積回路の第１の態様は、電源回路に目的レベルの出力電圧を生成させるために、前記電源回路のトランジスタを駆動する集積回路であって、前記集積回路の動作モードを指示する指示信号に基づいてオンオフする第１スイッチが接続される第１端子と、前記第１端子の電圧レベルに基づいて、前記集積回路を第１モードで動作させるか、前記第１モードより消費電力の大きい第２モードで動作させ・・・　続きを知財ポータルサイト IP Force にログインして見る

発明の効果[発明の詳細な説明]から抜粋

本発明によれば、消費電力をより低減することが可能な集積回路を提供することができる。

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この特許公報に記載されている図面[図面の簡単な説明]から抜粋

【図1】 電源装置１０の一例を示す図である。
【図2】 ＡＣ－ＤＣコンバータ１２の概要を示す図である。
【図3】 ＤＣ－ＤＣコンバータ１３の一例を示す図である。
【図4】 制御ＩＣ５０の一例を示す図である。
【図5】 設定回路７６の一例を示す図である。
【図6】 抵抗Ｒｓｔｂの抵抗値と、制御ＩＣ５０の駆動パターンを切り替える方式との関係を示す図である。
【図7】 “通常モード”時の駆動信号Ｖｄｒ１，Ｖｄｒ２の一例を示す図である。
【図8】 “低待機電力モード”時の駆動信号Ｖｄｒ１，Ｖｄｒ２の一例を示す図である。
【図9】 インターフェース（ＩＦ）回路１８ａの一例を示す図である。
【図10】 信号Ｗａｋｅｕｐ及び信号ＥｘｔＳＴＢの論理レベルと、電圧Ｖｓｔｂとの関係を示す図である。
【図11】 信号Ｗａｋｅｕｐ及び信号ＥｘｔＳＴＢの論理レベルと、制御ＩＣ５０の動作モードとの関係を示す図である。
【図12】 力率改善回路２２の一例を示す図である。
【図13】 力率改善ＩＣ１７５の一例を示す図である。
【図14】 制御ＩＣ５０の動作の一例を示す図である。
【図15】 インターフェース（ＩＦ）回路１８ｂの一例を示す図である。
【図16】 信号Ｗａｋｅｕｐの論理レベルと、電圧Ｖｓｔｂとの関係を示す図である。
【図17】 信号Ｗａｋｅｕｐの論理レベルと、制御ＩＣ５０及び力率改善ＩＣ１５５の動作モードとの関係を示す図である。
【図18】 制御ＩＣ５０及び力率改善ＩＣ１７５の動作の一例を示す図である。

代表図 図1本件の代表的な図

１０ 電源装置 １１ スイッチ １２ ＡＣ－ＤＣコンバータ １３ ＤＣ－ＤＣコンバータ １４ 負荷 １５ａ，１５ｂ マイクロコントローラ １６，３０，３１，４２，６１，６３，６４，６７，６８，１５０，１５４，１５９，１６２，１７１，１７４，１８３，１８４ コンデンサ １７ フォトダイオード １８ａ，１８ｂ インターフェース回路 ２０，２１，４０，４１，６０，１７３ ダイオード ２２ 力率改善回路 ３２，３３，１５２，１５３，１５７，１６０，１７６ ＮＭＯＳトランジスタ ３４，１７２ トランス ３５ 制御ブロック ４３ 定電圧回路 ４４ 発光ダイオード ６２ フォトトランジスタ ６５，６６，７４，７５，１４２，１５１，１５５，１５６，１５８，１６１，１８０，１８１，１８２ 抵抗 ７０ 起動回路 ７１，１３１ 電流源 ７２ ツェナーダイオード ７３ 判定回路 ７６ 設定回路 ８０ 定電圧源 ８１，１２０ 制御回路 ８２ 充電回路 ９０ リセット回路 ９１ 低電圧保護回路 ９２，９３ 内部電源 １００ 負荷検出回路 １０１，２１１ 発振回路 １０２，１９０ 駆動回路 １１０ デジタル部 １１１ アナログ部 １２１ 判定回路 １３０ 放電回路 １３２ アナログ・デジタル変換器 １３３ クランプ回路 １３４，２１２ コンパレータ １３５ 通信回路 １４０ オペアンプ １４１ ＰＭＯＳトランジスタ １７０ 全波整流回路 １９１ 信号検出回路 ２００ ゼロ電流検出回路 ２０１ 遅延回路 ２０２ パルス回路 ２０３ ターンオンタイマ回路 ２０４，２１３ ＯＲ回路 ２１０ 誤差増幅回路 ２２０ ＳＲフリップフロップ ２２１ バッファ回路

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