特許 7920451出願番号特願 2025-518237
方法、装置及びコンピュータプログラム

出願人ノキア　テクノロジーズ　オサケユイチア（識別番号 515076873）

2026年特許公開件数ランキング 156位 178件（※）

2026年特許取得件数ランキング 126位 170件（※）

公報発行日　2026年9月14

公報URL　https://ipforce.jp/patent-jp-P_B1-7920451　ログイン済みの方はこのURLへ

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※ 共同出願を含む

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関連出願の相互参照本出願は、２０２２年９月２９日に出願されたＧＢ出願第２２１４２４３．４号に対する優先権、及び利益を主張するものであり、その全体が参照により本明細書に援用されている。

【図1】５Ｇシステムの概略図を示す。

【図2】制御装置の概略図を示す。

【図3】端末の概略図を示す。

【図4】１５ｋＨｚのサブキャリア間隔を有する既存の新無線初期アクセス信号及びチャネルの概略図を示す。

【図5】同期信号ブロックの異なる間引きパターンの概略図を示す。

【図6】リソースブロックオフセットを含むＣＯＲＥＳＥＴリソース割り振りの例示的な図を示す。

【図7】２２個の物理リソースブロックの初期帯域幅部分内のＣＯＲＥＳＥＴ０コンフィグレーションの概略図を示す。

【図8a】２個の制御チャネルエレメントのオフセットを有する、２０個の物理リソースブロックの初期帯域幅部分内のＣＯＲＥＳＥＴ０コンフィグレーションのもう１つの概略図を示す。

【図8b】２個の制御チャネルエレメントのオフセットを有する、２４個の物理リソースブロックの初期帯域幅部分内のＣＯＲＥＳＥＴ０コンフィグレーションのもう１つの概略図を示す。

【図9a】物理報知チャネルの有効な物理リソースブロックとＣＯＲＥＳＥＴ０の有効な物理リソースブロックとの間のアライメントの概略図を示す。

【図9b】物理報知チャネルの有効な物理リソースブロックとＣＯＲＥＳＥＴ０の有効な物理リソースブロックとの間のアライメントの概略図を示す。

【図10】ＣＯＲＥＳＥＴ０のサイズ決定及びＣＣＥ割り振りオプションの概略図を示す。

【図11】ユーザ機器によって実行されるもう１つの例示的な方法のフロー図を示す。

【図12】プロセッサによって実行されると、プロセッサが図１１の方法のステップの１つまたは複数を行うことを可能にする命令を格納する不揮発性メモリ媒体の概略図を示す。

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