特許 7932985出願番号 特願 2023-127112
計算装置
公報発行日 2026年10月9
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技術分野
計算装置
発明が解決しようとする課題[発明の詳細な説明]から抜粋
安定した特性が得られる計算装置を提供する。
課題を解決するための手段[発明の詳細な説明]から抜粋
本発明の実施形態によれば、計算装置は、素子部を含む。前記素子部は、第１構造体及び第２構造体を含む。前記第１構造体は、第１基体と、前記第１基体に固定された第１量子ビットと、を含む。前記第２構造体は、第２基体と、前記第２基体に固定された第２量子ビットと、前記第２基体に固定された第１可変結合器と、を含む。前記第１可変結合器は、第１部分と、第２部分と、を含む。前記第１部分は、前記第１量子ビットと容量・・・ 続きを知財ポータルサイト IP Force にログインして見る
この特許の権利範囲[特許請求の範囲]
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この特許公報に記載されている図面[図面の簡単な説明]から抜粋
【図1】
図１（ａ）及び図１（ｂ）は、第１計算装置を例示する模式図である。
【図2】
図２（ａ）及び図２（ｂ）は、第１計算装置を例示する模式的断面図である。
【図3】
図３は、第１計算装置を例示する模式図である。
【図4】
図４は、第１計算装置を例示する模式的斜視図である。
【図5】
図５は、第１計算装置を例示する模式的斜視図である。
【図6】
図６（ａ）及び図６（ｂ）は、第１計算装置を例示する模式的断面図である。
【図7】
図７（ａ）及び図７（ｂ）は、第２計算装置を例示する模式図である。
【図8】
図８は、第２計算装置を例示する模式的平面図である。
【図9】
図９は、第２計算装置を例示する模式断面図である。
【図10】
図１０は、第２計算装置を例示する模式断面図である。
【図11】
図１１は、第２計算装置を例示する模式断面図である。
【図12】
図１２は、計算装置を例示する模式断面図である。
【図13】
図１３は、計算装置を例示する模式断面図である。
代表図 図1本件の代表的な図
１０Ｅ：素子部、 １１～１４：第１～４構造体、 １１ＣＢ：第１接続構造体、 １１Ｃｓ：第１接続基体、 １１Ｇ、１２Ｇ：第１、第２導電層、 １１Ｍ、１２Ｍ：第１、第２中間導電層、 １１ｂ～１４ｂ：第１～４量子ビット、 １１ｂＣ、１２ｂＣ：第１、第２量子ビットキャパシタ、 １１ｂＪ、１２ｂＪ：第１、第２量子ビットジョセフソン接合、 １１ｃ～１４ｃ：第１～第４導電部、 １１ｓ～１４ｓ：第１～第４基体、 １２ｂＡ：第２他量子ビット、 １２ｃＡ：第２対向導電部、 １３ｂＡ：第３他量子ビット、 １３ｃＡ：第３他導電部、 ３１Ｃ～３３Ｃ：第１～第３接続部、 ３２ＣＡ：第２対向接続部、 ４１～４６：第１～第６部分、 ５０Ａ～５０Ｃ：第１～第３可変結合器、 ５１～５９：第１～第９ジョセフソン接合、 ５１Ｌ：ループ、 ５１ＳＰ：空間、 ５１ｅ～５９ｅ：第１～第９端部、 ５１ｆ～５９ｆ：第１～第９他端部、 ５１ｉ～５３ｉ：第１～第３絶縁部材、 ６１：第１制御導電部材、 ７０：制御部、 １１０～１１２、１１０ａ、１１０ｂ、１２０～１２３：計算装置、 Ｄ１：第１方向、 Ｓ１：信号
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