特表 2022-507088 制御回路と弾性波フィルタの集積方法及び集積構造

(19)【発行国】日本国特許庁(JP)

(12)【公報種別】公表特許公報(A)

(11)【公表番号】

(43)【公表日】2022-01-18

(54)【発明の名称】制御回路と弾性波フィルタの集積方法及び集積構造

(51)【国際特許分類】

   H03H 3/08 20060101AFI20220111BHJP

   H03H 9/25 20060101ALI20220111BHJP

   H03H 3/02 20060101ALI20220111BHJP

   H03H 9/17 20060101ALI20220111BHJP

   H03H 9/54 20060101ALI20220111BHJP

   B81B 3/00 20060101ALI20220111BHJP

   B81C 3/00 20060101ALI20220111BHJP

【ＦＩ】

H03H3/08

H03H9/25 A

H03H3/02 B

H03H9/17 F

H03H9/54 Z

B81B3/00

B81C3/00

【審査請求】有

【予備審査請求】未請求

(21)【出願番号】P 2021525267

(86)(22)【出願日】2019-11-13

(85)【翻訳文提出日】2021-05-10

(86)【国際出願番号】 CN2019117790

(87)【国際公開番号】W WO2020134665

(87)【国際公開日】2020-07-02

(31)【優先権主張番号】201811602834.4

(32)【優先日】2018-12-26

(33)【優先権主張国・地域又は機関】CN

(81)【指定国・地域】

(71)【出願人】

【識別番号】519437928

【氏名又は名称】中芯集成電路（寧波）有限公司上海分公司

【氏名又は名称原語表記】ＮＩＮＧＢＯ ＳＥＭＩＣＯＮＤＵＣＴＯＲ ＩＮＴＥＲＮＡＴＩＯＮＡＬ ＣＯＲＰＯＲＡＴＩＯＮ（ＳＨＡＮＧＨＡＩ ＢＲＡＮＣＨ）

【住所又は居所原語表記】Ｒｏｏｍ ３０９， Ａｒｅａ Ｃ， Ｆ３， Ｂｕｉｌｄｉｎｇ １，Ｎｏ．９５， Ｌａｎｅ ８５， Ｃａｉｌｕｎ Ｒｏａｄ， Ｃｈｉｎａ（Ｓｈａｎｇｈａｉ） Ｐｉｌｏｔ Ｆｒｅｅ Ｔｒａｄｅ Ｚｏｎｅ， Ｓｈａｎｇｈａｉ ２０１２１０ Ｃｈｉｎａ

(74)【代理人】

【識別番号】110002468

【氏名又は名称】特許業務法人後藤特許事務所

(72)【発明者】

【氏名】秦 暁珊

【テーマコード（参考）】

3C081

5J097

5J108

【Ｆターム（参考）】

3C081AA11

3C081BA07

3C081BA22

3C081BA46

3C081BA55

3C081CA05

3C081CA20

3C081CA32

3C081CA38

3C081DA02

3C081DA03

3C081DA04

3C081EA22

5J097AA01

5J097AA30

5J097BB11

5J097EE05

5J097FF07

5J097HA04

5J097JJ04

5J097JJ06

5J097JJ09

5J097KK10

5J097LL04

5J097LL08

5J108AA07

5J108BB04

5J108BB07

5J108BB08

5J108EE07

5J108EE13

5J108FF11

5J108FF13

5J108GG01

5J108GG07

5J108GG14

5J108KK03

5J108KK04

5J108MM01

(57)【要約】

制御回路と弾性波フィルタの集積方法及び集積構造を提供する。該方法は、制御回路が形成される基板を提供するステップと、基板上に第１キャビディと第２キャビティを形成するステップと、第１入力電極、第１出力電極が設けられるＳＡＷ共振片と、表面に第２入力電極、第２出力電極が設けられる、第３キャビティを含むＢＡＷ共振構造を提供するステップと、ＳＡＷ共振片の表面を基板に向け、ＳＡＷ共振片を基板にボンディングさせ且つ第１キャビディを封止し、ＢＡＷ共振構造の表面を基板に向け、ＢＡＷ共振構造を基板にボンディングさせ且つ第２キャビティを封止するステップと、制御回路を第１入力電極、第１出力電極、第２入力電極、第２出力電極に電気的に接続させるステップと、を含む。上記構造は、従来のＳＡＷフィルタとＢＡＷフィルタが個別デバイスとしてＰＣＢに集積されることによる電気的な接続プロセスが複雑で、挿入損耗が大きいなどという問題を回避でき、集積度が高く、プロセスコストを低減させることができる。
【選択図】図７

【特許請求の範囲】

【請求項1】

制御回路と弾性波フィルタの集積方法であって、
制御回路が形成される基板を提供するステップと、
前記基板上に第１キャビディと第２キャビティを形成するステップと、
表面に第１入力電極、第１出力電極が設けられるＳＡＷ共振片と、表面に第２入力電極、第２出力電極が設けられ、第３キャビティを含むＢＡＷ共振構造とを提供するステップと、
前記ＳＡＷ共振片の前記表面を前記基板に向け、前記ＳＡＷ共振片を前記基板にボンディングさせ且つ前記第１キャビディを封止し、また前記ＢＡＷ共振構造の前記表面を前記基板に向け、前記ＢＡＷ共振構造を前記基板にボンディングさせ且つ前記第２キャビティを封止するステップと、
前記制御回路を前記第１入力電極、前記第１出力電極、前記第２入力電極、前記第２出力電極に電気的に接続させるステップと、を含む、ことを特徴とする制御回路と弾性波フィルタの集積方法。

【請求項2】

前記基板は、ベースと、前記ベース上に形成される第１誘電層とを含み、
前記基板上に前記第１キャビディと前記第２キャビティを形成するステップは、
前記第１誘電層内に前記第１キャビディと前記第２キャビティを形成することを含む、ことを特徴とする請求項１に記載の集積方法。

【請求項3】

前記ベースは、ＳＯＩベース、シリコンベース、ケイ素ゲルマニウムベース、ゲルマニウム化シリコンベース、ガリウムヒ素ベースのうちのいずれか一つを含む、ことを特徴とする請求項２に記載の集積方法。

【請求項4】

前記制御回路は、デバイス構造と、前記デバイス構造に電気的に接続される第１相互接続構造層を含み、
前記第１相互接続構造層は、前記第１誘電層に位置し、前記第１入力電極、前記第１出力電極、前記第２入力電極、前記第２出力電極に電気的に接続される、ことを特徴とする請求項２に記載の集積方法。

【請求項5】

前記デバイス構造は、ＭＯＳデバイスを含む、ことを特徴とする請求項４に記載の集積方法。

【請求項6】

前記制御回路を前記第１入力電極、前記第１出力電極に電気的に接続させるステップは、
前記ＳＡＷ共振片をボンディングした後に、前記第１相互接続構造層を前記第１入力電極、前記第１出力電極に電気的に接続させるステップを含み、又は、
前記ＳＡＷ共振片をボンディングする前に、前記第１相互接続構造層上に第１再配線層及び第１溶接パッドを形成するステップと、
前記ＳＡＷ共振片をボンディングした後に、前記第１溶接パッドを前記第１入力電極、前記第１出力電極に電気的に接続させることにより、前記第１入力電極、前記第１出力電極を前記第１溶接パッド、前記第１再配線層によって前記制御回路に電気的に接続させるステップと、を含む、ことを特徴とする請求項４に記載の集積方法。

【請求項7】

前記制御回路を前記第２入力電極、前記第２出力電極に電気的に接続させるステップは、
前記ＢＡＷ共振構造をボンディングした後に、前記第１相互接続構造層を前記第２入力電極、前記第２出力電極に電気的に接続させるステップを含み、又は、
前記ＢＡＷ共振構造をボンディングする前に、前記第１相互接続構造層上に第２再配線層及び第２溶接パッドを形成するステップと、
前記ＢＡＷ共振構造をボンディングした後に、前記第２溶接パッドを前記第２入力電極、前記第２出力電極に電気的に接続させ、前記第２入力電極、前記第２出力電極を前記第２溶接パッド、前記第２再配線層によって前記制御回路に電気的に接続させるステップと、を含む、ことを特徴とする請求項６に記載の集積方法。

【請求項8】

前記ＳＡＷ共振片の前記表面を前記基板に向け、前記ＳＡＷ共振片を前記基板にボンディングさせ且つ前記第１キャビディを封止し、また前記ＢＡＷ共振構造の前記表面を前記基板に向け、前記ＢＡＷ共振構造を前記基板にボンディングさせ且つ前記第２キャビティを封止するステップは、
前記基板の表面の、前記第１キャビディと前記第２キャビティの外周に第１接着構造と第２接着構造をそれぞれ形成するステップと、
前記第１接着構造によって前記ＳＡＷ共振片を前記基板に接着させるステップと、
前記第２接着構造によって前記ＢＡＷ共振構造を前記基板に接着させるステップと、を含む、ことを特徴とする請求項１に記載の集積方法。

【請求項9】

前記第１接着構造及び／又は前記第２接着構造は、ドライフィルムを含む、ことを特徴とする請求項８に記載の集積方法。

【請求項10】

露光現像によって前記ドライフィルム内に前記第１キャビディ及び／又は前記第２キャビティを形成する、ことを特徴とする請求項９に記載の集積方法。

【請求項11】

パターン化の接着層をシルクスクリーンすることによって、前記第１接着構造と前記第２接着構造を形成する、ことを特徴とする請求項８に記載の集積方法。

【請求項12】

前記基板の背面に、前記第１入力電極、前記第１出力電極、前記第２入力電極、前記第２出力電極、前記制御回路に電気的に接続させる第３再配線層を形成するステップをさらに含む、ことを特徴とする請求項１に記載の集積方法。

【請求項13】

前記第３再配線層は、Ｉ／Ｏ溶接パッドを含む、ことを特徴とする請求項１２に記載の集積方法。

【請求項14】

前記ＳＡＷ共振片と前記ＢＡＷ共振構造をボンディングした後に、
前記基板、前記ＳＡＷ共振片及び前記ＢＡＷ共振構造を覆うパッケージング層を形成するステップをさらに含む、ことを特徴とする請求項１に記載の集積方法。

【請求項15】

前記パッケージング層上に、前記第１入力電極、前記第２入力電極、前記第１出力電極、前記第２出力電極、前記制御回路に電気的に接続させる第４再配線層を形成するステップをさらに含む、ことを特徴とする請求項１４に記載の集積方法。

【請求項16】

前記第１入力電極、前記第１出力電極、前記第２入力電極及び前記第２出力電極は、いずれも溶接パッドを含む、ことを特徴とする請求項１に記載の集積方法。

【請求項17】

制御回路と弾性波フィルタの集積構造であって、
制御回路、第１キャビディ及び第２キャビティが形成される基板と、
表面に第１入力電極、第１出力電極が設けられ、その表面が前記基板に向かって前記基板にボンディングされ且つ前記第１キャビディを封止するＳＡＷ共振片と、
表面に第２入力電極、第２出力電極が設けられ、第３キャビティを含み、その表面が前記基板に向かって前記基板にボンディングされ且つ前記第２キャビティを封止するＢＡＷ共振構造と、を含み、
前記制御回路が前記第１入力電極、前記第１出力電極、前記第２入力電極、前記第２出力電極に電気的に接続される、ことを特徴とする制御回路と弾性波フィルタの集積構造。

【請求項18】

前記基板は、ベースと、前記ベース上に形成される第１誘電層とを含み、前記第１キャビディと前記第２キャビティが前記第１誘電層内に形成され、
又は、前記基板と前記ＳＡＷ共振片が第１接着構造によってボンディングされ、前記第１キャビディが前記第１接着構造内に形成され、前記基板と前記ＢＡＷ共振構造が第２接着構造によってボンディングされ、前記第２キャビティが前記第２接着構造内に形成される、ことを特徴とする請求項１７に記載の集積構造。

【請求項19】

前記第１接着構造及び／又は前記第２接着構造は、ドライフィルムである、ことを特徴とする請求項１８に記載の集積構造。

【請求項20】

前記ベースは、ＳＯＩベース、シリコンベース、ケイ素ゲルマニウムベース、ゲルマニウム化シリコンベース、ガリウムヒ素ベースのうちのいずれか一つを含む、ことを特徴とする請求項１８に記載の集積構造。

【請求項21】

前記制御回路は、デバイス構造と、前記デバイス構造に電気的に接続される第１相互接続構造層を含み、
前記第１相互接続構造層は、前記第１誘電層に位置し、前記第１入力電極、前記第１出力電極、前記第２入力電極、前記第２出力電極に電気的に接続される、ことを特徴とする請求項１８に記載の集積構造。

【請求項22】

前記デバイス構造は、ＭＯＳデバイスを含む、ことを特徴とする請求項２１に記載の集積構造。

【請求項23】

前記基板上に第１再配線層、第２再配線層、第１溶接パッド及び第２溶接パッドが形成され、
前記第１溶接パッドが前記第１入力電極、前記第１出力電極に電気的に接続されることにより、前記第１入力電極、前記第１出力電極を前記第１溶接パッド、前記第１再配線層によって前記制御回路に電気的に接続させ、
前記第２溶接パッドが前記第２入力電極、前記第２出力電極に電気的に接続されることにより、前記第２入力電極、前記第２出力電極を前記第２溶接パッド、前記第２再配線層によって前記制御回路に電気的に接続させる、ことを特徴とする請求項２１に記載の集積構造。

【請求項24】

前記基板の背面に形成され、前記第１入力電極、前記第１出力電極、前記第２入力電極、前記第２出力電極、前記制御回路に電気的に接続される第３再配線層をさらに含む、ことを特徴とする請求項１７に記載の集積構造。

【請求項25】

前記第３再配線層は、Ｉ／Ｏ溶接パッドを含む、ことを特徴とする請求項２４に記載の集積構造。

【請求項26】

前記基板、前記ＳＡＷ共振片及び前記ＢＡＷ共振構造を覆うパッケージング層をさらに含む、ことを特徴とする請求項１７に記載の集積構造。

【請求項27】

前記パッケージング層上に形成され、前記第１入力電極、前記第２入力電極、前記第１出力電極、前記第２出力電極、制御回路に電気的に接続される第４再配線層をさらに含む、ことを特徴とする請求項２６に記載の集積構造。

【請求項28】

前記第１入力電極、前記第１出力電極、前記第２入力電極及び前記第２出力電極は、いずれも溶接パッドを含む、ことを特徴とする請求項１７に記載の集積構造。

【発明の詳細な説明】

【技術分野】

【0001】

本発明は、弾性波フィルタの技術分野に関し、特に制御回路と弾性波フィルタの集積方法及び集積構造に関する。

【背景技術】

【0002】

ＳＡＷは、圧電性基材材料の表面に発生し且つ伝播し、且つ振幅は、基材材料に入る深さの増加に応じて迅速に減少する弾性波である。ＳＡＷフィルタの基本的な構造は、圧電特性を有する基材材料上に二つの音響電気トランスデューサ－櫛形電極インターディジタルトランスデューサ（Ｉｎｔｅｒｄｉｇｉｔａｌ Ｔｒａｎｓｄｕｃｅｒ、ＩＤＴ）を製作し、それぞれ放出トランスデューサと受信トランスデューサとして用いる。ＳＡＷフィルタの作動周波数帯は、一般的には８００ＭＨｚ～２ＧＨｚであり、帯域幅は、１７ＭＨｚ～３０ＭＨｚである。それは、選択型がよく、帯域幅が広く、性能が安定的で、信頼性が高いため、現在で最も広く応用されている無線周波数フィルタとなっている。

【0003】

ＢＡＷフィルタは、バルク音波理論に基づき、音響学共振を利用して電気的フィルタリングを実現するデバイスであり、電極間の圧電層（ＡｌＮ、ＺｎＯなど）の垂直方向での共振によってフィルタリングを行う。キャビティ型ＢＡＷフィルタは、現在最も応用に成功しているＢＡＷフィルタであり、その本体構造は、上部電極、圧電層及び下部電極で構成されるサンドイッチ構造であり、上部電極と下部電極の両側にいずれもキャビティが設けられ、音波信号が上部電極の最上端と下部電極の底端に進むとき、音響インピーダンスの大きな差により、音波の全反射を引き起こす。このようなＢＡＷフィルタは、音響リークが小さく、デバイスの高いＱ値を実現することができる。ＢＡＷフィルタの作動周波数帯は、一般的には２ＧＨｚ～６ＧＨｚである。

【発明の概要】

【発明が解決しようとする課題】

【0004】

ＳＡＷとＢＡＷは、作動周波数帯が異なり、異なる周波数帯の信号のフィルタリングニーズを満たすために組み合わせて使用されてもよい。パッケージングを行うとき、一般的には、単一のＳＡＷフィルタ及びＢＡＷフィルタを個別デバイスにパッケージングし、さらにプリント回路板（ＰＣＢ）上に集積する。使用上のニーズのため、往々にして一つのＰＣＢ板上に複数のフィルタを集積する必要がある。このように単独してパッケージングしてからシステム集積を行う方式は、ＳＩＰ接線が複雑で、挿入損耗が大きいなどという問題をもたらし、且つ個別のスイッチ、選択、制御デバイスを導入してフィルタに対して制御を行う必要があり、プロセスの複雑度と製造コストを向上させる。

【課題を解決するための手段】

【0005】

本発明の目的は、制御回路と弾性波フィルタの集積方法及び相応の集積構造を提供し、従来のＳＡＷフィルタとＢＡＷフィルタのパッケージングと集積プロセスにおいて、ＳＩＰ接線が複雑で、挿入損耗が大きいなどという問題を克服することである。

【0006】

一方、本発明によれば、
制御回路が形成される基板を提供するステップと、
前記基板上に第１キャビディと第２キャビティを形成するステップと、
表面に第１入力電極、第１出力電極が設けられるＳＡＷ共振片と、表面に第２入力電極、第２出力電極が設けられ、第３キャビティを含むＢＡＷ共振構造とを提供するステップと、
前記ＳＡＷ共振片の前記表面を前記基板に向け、前記ＳＡＷ共振片を前記基板にボンディングさせ且つ前記第１キャビディを封止し、また前記ＢＡＷ共振構造の前記表面を前記基板に向け、前記ＢＡＷ共振構造を前記基板にボンディングさせ且つ前記第２キャビティを封止するステップと、
前記制御回路を前記第１入力電極、前記第１出力電極、前記第２入力電極、前記第２出力電極に電気的に接続させるステップと、を含む制御回路と弾性波フィルタの集積方法が提供される。

【0007】

選択的に、前記基板は、ベースと、前記ベース上に形成される第１誘電層とを含み、
前記基板上に前記第１キャビディと前記第２キャビティを形成するステップは、
前記第１誘電層内に前記第１キャビディと前記第２キャビティを形成することを含む。

【0008】

選択的に、前記ベースは、ＳＯＩベース、シリコンベース、ケイ素ゲルマニウムベース、ゲルマニウム化シリコンベース、ガリウムヒ素ベースのうちのいずれか一つを含む。

【0009】

選択的に、前記制御回路は、デバイス構造と、前記デバイス構造に電気的に接続される第１相互接続構造層を含み、前記第１相互接続構造層は、前記第１誘電層に位置し、前記第１入力電極、前記第１出力電極、前記第２入力電極、前記第２出力電極に電気的に接続される。

【0010】

選択的に、前記デバイス構造は、ＭＯＳデバイスを含む。

【0011】

選択的に、前記制御回路を前記第１入力電極、前記第１出力電極に電気的に接続させるステップは、
前記ＳＡＷ共振片をボンディングした後に、前記第１相互接続構造層を前記第１入力電極、前記第１出力電極に電気的に接続させるステップを含み、又は、
前記ＳＡＷ共振片をボンディングする前に、前記第１相互接続構造層上に第１再配線層及び第１溶接パッドを形成するステップと、
前記ＳＡＷ共振片をボンディングした後に、前記第１溶接パッドを前記第１入力電極、前記第１出力電極に電気的に接続させることにより、前記第１入力電極、前記第１出力電極を前記第１溶接パッド、前記第１再配線層によって前記制御回路に電気的に接続させるステップと、を含む。

【0012】

選択的に、前記制御回路を前記第２入力電極、前記第２出力電極に電気的に接続させるステップは、
前記ＢＡＷ共振構造をボンディングした後に、前記第１相互接続構造層を前記第２入力電極、前記第２出力電極に電気的に接続させるステップを含み、又は、
前記ＢＡＷ共振構造をボンディングする前に、前記第１相互接続構造層上に第２再配線層及び第２溶接パッドを形成するステップと、
前記ＢＡＷ共振構造をボンディングした後に、前記第２溶接パッドを前記第２入力電極、前記第２出力電極に電気的に接続させ、前記第２入力電極、前記第２出力電極を前記第２溶接パッド、前記第２再配線層によって前記制御回路に電気的に接続させるステップと、を含む。

【0013】

選択的に、前記ＳＡＷ共振片の前記表面を前記基板に向け、前記ＳＡＷ共振片を前記基板にボンディングさせ且つ前記第１キャビディを封止し、また前記ＢＡＷ共振構造の前記表面を前記基板に向け、前記ＢＡＷ共振構造を前記基板にボンディングさせ且つ前記第２キャビティを封止するステップは、
前記基板の表面の、前記第１キャビディと前記第２キャビティの外周に第１接着構造と第２接着構造をそれぞれ形成するステップと、
前記第１接着構造によって前記ＳＡＷ共振片を前記基板に接着させるステップと、
前記第２接着構造によって前記ＢＡＷ共振構造を前記基板に接着させるステップと、を含む。

【0014】

選択的に、前記第１接着構造及び／又は前記第２接着構造は、ドライフィルムを含む。

【0015】

選択的に、露光現像によって前記ドライフィルム内に前記第１キャビディ及び／又は前記第２キャビティを形成する。

【0016】

選択的に、パターン化の接着層をシルクスクリーンすることによって、前記第１接着構造と前記第２接着構造を形成する。

【0017】

選択的に、前記基板の背面に、前記第１入力電極、前記第１出力電極、前記第２入力電極、前記第２出力電極、前記制御回路に電気的に接続させる第３再配線層を形成するステップをさらに含む。

【0018】

選択的に、前記第３再配線層は、Ｉ／Ｏ溶接パッドを含む。

【0019】

選択的に、前記ＳＡＷ共振片と前記ＢＡＷ共振構造をボンディングした後に、
前記基板、前記ＳＡＷ共振片及び前記ＢＡＷ共振構造を覆うパッケージング層を形成するステップをさらに含む、ことを特徴とする請求項１に記載の集積方法。

【0020】

選択的に、前記パッケージング層上に、前記第１入力電極、前記第２入力電極、前記第１出力電極、前記第２出力電極、前記制御回路に電気的に接続させる第４再配線層を形成するステップをさらに含む。

【0021】

選択的に、前記第１入力電極、前記第１出力電極、前記第２入力電極、前記第２出力電極は、いずれも溶接パッドを含む。

【0022】

他方、本発明によれば、
制御回路、第１キャビディ及び第２キャビティが形成される基板と、
表面に第１入力電極、第１出力電極が設けられ、その表面が前記基板に向かって前記基板にボンディングされ且つ前記第１キャビディを封止するＳＡＷ共振片と、
表面に第２入力電極、第２出力電極が設けられ、第３キャビティを含み、その表面が前記基板に向かって前記基板にボンディングされ且つ前記第２キャビティを封止するＢＡＷ共振構造と、を含み、
前記制御回路が前記第１入力電極、前記第１出力電極、前記第２入力電極、前記第２出力電極に電気的に接続される、ことを特徴とする制御回路と弾性波フィルタの集積構造が提供される。

【0023】

選択的に、前記基板は、ベースと、前記ベース上に形成される第１誘電層とを含み、前記第１キャビディと前記第２キャビティが前記第１誘電層内に形成され、
又は、前記基板と前記ＳＡＷ共振片が第１接着構造によってボンディングされ、前記第１キャビディが前記第１接着構造内に形成され、前記基板と前記ＢＡＷ共振構造が第２接着構造によってボンディングされ、前記第２キャビティが前記第２接着構造内に形成される。

【0024】

選択的に、前記第１接着構造及び／又は前記第２接着構造は、ドライフィルムである。

【0025】

選択的に、前記ベースは、ＳＯＩベース、シリコンベース、ケイ素ゲルマニウムベース、ゲルマニウム化シリコンベース、ガリウムヒ素ベースのうちのいずれか一つを含む。

【0026】

選択的に、前記制御回路は、デバイス構造と、前記デバイス構造に電気的に接続される第１相互接続構造層を含み、
前記第１相互接続構造層は、前記第１誘電層に位置し、前記第１入力電極、前記第１出力電極、前記第２入力電極、前記第２出力電極に電気的に接続される。

【0027】

選択的に、前記デバイス構造は、ＭＯＳデバイスを含む。

【0028】

選択的に、前記基板上に第１再配線層、第２再配線層、第１溶接パッド及び第２溶接パッドが形成され、
前記第１溶接パッドが前記第１入力電極、前記第１出力電極に電気的に接続されることにより、前記第１入力電極、前記第１出力電極を前記第１溶接パッド、前記第１再配線層によって前記制御回路に電気的に接続させ、
前記第２溶接パッドが前記第２入力電極、前記第２出力電極に電気的に接続されることにより、前記第２入力電極、前記第２出力電極を前記第２溶接パッド、前記第２再配線層によって前記制御回路に電気的に接続させる。

【0029】

選択的に、前記集積構造は、前記基板の背面に形成され、前記第１入力電極、前記第１出力電極、前記第２入力電極、前記第２出力電極、前記制御回路に電気的に接続される第３再配線層をさらに含む。

【0030】

選択的に、前記第３再配線層は、Ｉ／Ｏ溶接パッドを含む。

【0031】

選択的に、前記集積構造は、前記基板、前記ＳＡＷ共振片及び前記ＢＡＷ共振構造を覆うパッケージング層をさらに含む。

【0032】

選択的に、前記集積構造は、前記パッケージング層上に形成され、前記第１入力電極、前記第２入力電極、前記第１出力電極、前記第２出力電極、前記制御回路に電気的に接続される第４再配線層をさらに含む。

【0033】

選択的に、前記第１入力電極、前記第１出力電極、前記第２入力電極、前記第２出力電極は、いずれも溶接パッドを含む。

【0034】

本発明の有益な効果は、基板上に制御回路、ＳＡＷフィルタ及びＢＡＷフィルタに必要とするキャビティを形成し、さらに既存のＳＡＷ共振片とＢＡＷ共振構造をキャビティに取り付け、制御回路の弾性波フィルタへの制御を実現することにより、従来のＳＡＷフィルタとＢＡＷフィルタが個別デバイスとしてＰＣＢに集積されることによる電気的な接続プロセスが複雑で、挿入損耗が大きいなどという問題を回避でき、集積度が高く、プロセスコストを低減させることができることである。

【0035】

本発明は、他の特性と利点を有し、これらの特性と利点は、明細書に組み込まれる添付図面と後の発明を実施するための形態の中に明らかであり、又は明細書に組み込まれる添付図面と後の発明を実施するための形態の中に詳細に説明され、これらの添付図面と発明を実施するための形態は、共同で本発明の特定の原理を解釈するために用いられる。

【図面の簡単な説明】

【0036】

添付図面を結び付けて、本発明の例示的な実施例をより詳細に説明することによって、本発明の上記及び他の目的、特徴、並びに利点は、より明らかになり、そのうち、本発明の例示的な実施例では、一般的に同じ参照番号が同じ部品を表す。

【図1】本発明の第１実施例による制御回路と弾性波フィルタの集積方法の各プロセスをそれぞれ表す。

【図2】本発明の第１実施例による制御回路と弾性波フィルタの集積方法の各プロセスをそれぞれ表す。

【図3】本発明の第１実施例による制御回路と弾性波フィルタの集積方法の各プロセスをそれぞれ表す。

【図4】本発明の第１実施例による制御回路と弾性波フィルタの集積方法の各プロセスをそれぞれ表す。

【図5】本発明の第１実施例による制御回路と弾性波フィルタの集積方法の各プロセスをそれぞれ表す。

【図6】本発明の第１実施例による制御回路と弾性波フィルタの集積方法の各プロセスをそれぞれ表す。

【図7】本発明の第１実施例による制御回路と弾性波フィルタの集積方法の各プロセスをそれぞれ表す。

【図8】本発明の第２実施例による制御回路と弾性波フィルタの集積方法のフィルタの電気的な接続を行う各プロセスをそれぞれ表す。

【図9】本発明の第２実施例による制御回路と弾性波フィルタの集積方法のフィルタの電気的な接続を行う各プロセスをそれぞれ表す。

【図10】本発明の第２実施例による制御回路と弾性波フィルタの集積方法のフィルタの電気的な接続を行う各プロセスをそれぞれ表す。

【発明を実施するための形態】

【0037】

以下で添付図面を参照しながら本発明をより詳細に説明する。添付図面では、本発明の好ましい実施例を説明したが、理解すべきことは、様々な形式で本発明を実現することができるが、本明細書に記載された実施例によって限定されるべきではない。逆に、これらの実施例を提供する目的は、本発明をより完全にし、且つ本発明の範囲を当業者に完全に伝達できることにすることである。

【0038】

従来の弾性波フィルタのパッケージング集積において、接線が複雑で、挿入損耗が大きいなどという問題を解決するために、本発明の実施例は、制御回路と弾性波フィルタの集積方法及び集積構造を提供する。

【0039】

本発明の実施例による制御回路と弾性波フィルタの集積方法は、制御回路が形成される基板を提供するステップと、基板上に第１キャビディと第２キャビティを形成するステップと、第１入力電極、第１出力電極が設けられるＳＡＷ共振片と、表面に第２入力電極、第２出力電極が設けられる、第３キャビティを含むＢＡＷ共振構造を提供するステップと、ＳＡＷ共振片の表面を基板に向け、ＳＡＷ共振片を基板にボンディングさせ且つ第１キャビディを封止し、ＢＡＷ共振構造の表面を基板に向け、ＢＡＷ共振構造を基板にボンディングさせ且つ第２キャビティを封止するステップと、制御回路を第１入力電極、第１出力電極、第２入力電極、第２出力電極に電気的に接続させるステップと、を含む。

【0040】

本発明の実施例による集積方法は、基板上に制御回路と弾性波フィルタに必要とするキャビティを形成し、さらに既存のＳＡＷ共振片とＢＡＷ共振構造をキャビティに取り付け、制御回路の弾性波フィルタへの制御を実現することにより、従来の弾性波フィルタが個別デバイスとしてＰＣＢに集積されることによる電気的な接続プロセスが複雑で、挿入損耗が大きいなどという問題を回避でき、集積度が高く、プロセスコストを低減させることができる。

【0041】

本発明の上記目の、特徴及び利点をより明らかに分かりやすくするために、以下では、添付図面を結び付けて本発明の具体実施例を詳細に説明する。本発明の実施例を詳述するとき、説明を容易にするために、例示図は、一般的な比率に従って局所的に増幅することなく、且つ前記例示図は、例示に過ぎず、それは、ここで本発明の保護範囲を制限すべきではない。なお、実際の製作中に長さ、広さ及び深さの三次元空間の大きさを含むべきである。

【0042】

図１～図７は、本発明の第１実施例による制御回路と弾性波フィルタの集積方法の各プロセスをそれぞれ表し、該集積方法は、以下のステップを含む：

【0043】

Ｓ１：図１～図４に示すように、制御回路が形成される基板を提供する。

【0044】

図１と図２に示すように、本実施例において、基板は、ベースと、ベース上に形成される第１誘電層４０１を含む。選択的に、ベースは、ＳＯＩベース、シリコンベース、ケイ素ゲルマニウムベース、ゲルマニウム化シリコンベース、ガリウムヒ素ベースのうちの一つを含む。当業者は、基板上に形成される制御回路に基づいてベースのタイプを選択してもよい。本実施例において、ベースは、ＳＯＩベースである。

【0045】

ＳＯＩ（Ｓｉｌｉｃｏｎ－ｏｎ－Ｉｎｓｕｌａｔｏｒ）は、即ちシリコンオンインシュレータであり、その構造は、絶縁シリコンベースにトップ層単結晶シリコン層を加える二層構造であってもよいし、絶縁層を中間層（埋込み層と呼ばれる）とするサンドイッチ構造であってもよい。デバイスを製作するとき、トップ層の薄シリコン層のみをデバイス製作層として、ソース、ドレイン、チャネル領域などの構造を形成し、シリコンベースは、支持のみの役割を果たす。サンドイッチ構造における埋込み層は、デバイス製作層とシリコンベースを電気的に隔離することにより、シリコンベースのデバイス性能への影響を減少する。ＳＯＩは、デバイス性能上に寄生容量を減少し、消費電力を低下させ、ラッチ効果を解消するなどという利点を有する。現在でＳＯＩベースを取得する典型的なプロセスは、スマートカット（Ｓｍａｒｔ－ｃｕｔＴＭ）プロセスである。本実施例は、ＳＯＩベースを選択することによりＳＯＩの上記利点を利用する。

【0046】

依然として図１に示すように、本実施例において、ＳＯＩベースは、シリコンベース１０１と、シリコンベース１０１上に位置する絶縁層１０２と、絶縁層１０２上に位置するシリコントップ層１０３とを含み、又はＳＯＩベースは、絶縁層にトップ層シリコンを加える二層構造であってもよい。

【0047】

依然として図２に示すように、第１誘電層４０１は、低Ｋ誘電材料層であり、例えばシリコン酸化層である。化学気相堆積（ＣＶＰ）によって第１誘電層４０１を形成してもよく、第１誘電層４０１は、弾性波フィルタ動作に必要とするキャビティを形成するために用いられる。

【0048】

本実施例において、制御回路は、デバイス構造及びデバイス構造に電気的に接続される第１相互接続構造層を含み、第１相互接続構造層が第１誘電層４０１に位置する。
デバイス構造は、ＭＯＳデバイスを含み、例えばＭＯＳスイッチであり、ＭＯＳスイッチは、ｎＭＯＳ又はｐＭＯＳスイッチであってもよい。依然として図１に示すように、ＭＯＳスイッチは、ソース２０１、ドレイン２０２及びゲート２０３を含み、シリコントップ層１０３の表面のゲート誘電層２０４又はゲート誘電領域をさらに含み、ソース、ドレイン及びゲートを隔離する。浅ドープソースドレイン（Ｌｏｗ Ｄｏｓｅ Ｄｒａｉｎ、ＬＤＤと略称される）プロセスとソースドレイン注入（Ｓｏｕｒｃｅ／Ｄｒａｉｎ Ｉｍｐｌａｎｔａｔｉｏｎ、Ｓ／Ｄ ＩＭＰと略称される）によってトップ層シリコン内にソース２０１とドレイン２０２を形成する。

【0049】

本実施例において、制御回路がＳＡＷ共振片とＢＡＷ共振構造にそれぞれ電気的に接続される。

【0050】

図３に示すように、選択的に、第１相互接続構造層は、デバイス構造に順に電気的に接続される第１導電ポスト４０４と第１回線層４０５を含む。本実施例において、まず第１誘電層４０１を貫通する第１ビアホール及び第１誘電層の表面に設けられる第１トレンチを形成し、次に第１ビアホールと第１トレンチ内に電気的に接続される材料を充填し、第１導電ポスト４０４と第１回線層４０５を形成する。

【0051】

エッチングによって第１誘電層４０１を貫通する第１ビアホール及び第１誘電層４０１の表面に設けられる第１トレンチを形成してもよく、第１トレンチは、局所的に相互に接続される金属の経路を定義し、次に堆積（例えばスパッタリング）によって第１ビアホールと第１トレンチ内に電気的に接続される材料を充填し、電気的に接続される材料は好ましくは、銅、タングステン、チタンなどである。本実施例において、シリコントップ層１０３上にゲート誘電層２０４が形成されるため、第１ビアホールはさらに、ゲート誘電層２０４を貫通している。

【0052】

図４に示すように、選択的に、第１相互接続構造層を第１入力電極、第１出力電極に直接的に電気的に接続させることが適切でない場合、基板上に第１再配線層４０６、第１溶接パッド４０７を形成し、第１溶接パッド４０７が、第１再配線層４０６によって制御回路の第１回線層に電気的に接続され、第１相互接続構造層を第２入力電極、第２出力電極に直接的に電気的に接続させるのが適切でない場合、基板上に第２再配線層４１４及び第２溶接パッド４１５を形成し、第２溶接パッド４１５が、第２再配線層４１４によって第１回線層４０５に電気的に接続され、又は、基材上に第１再配線層４０６、第１溶接パッド４０７、第２再配線層４１４及び第２溶接パッド４１５を同時に形成してもよい。堆積によって第１再配線層４０６と第２再配線層４１４を同時に形成し、且つ同様に、エッチング、堆積によって第１溶接パッド４０７と第２溶接パッド４１５を同時に形成してもよい。

【0053】

Ｓ２：図５に示すように、基板上に第１キャビディと第２キャビティを形成する。

【0054】

図５に示すように、本実施例において、エッチングによって第１誘電層４０１上に内へ凹む第１キャビディ４０２と第２キャビティ４１２を形成する。

【0055】

依然として図５に示すように、選択的に、基板の表面に第１接着構造４０８と第２接着構造４１３を形成し、後続のＳＡＷ共振片とＢＡＷ共振構造と基板とのボンディングを実現するために用いられる。第１接着構造４０８と第２接着構造４１３は、ドライフィルム又は他のタイプのチップ接続フィルムであってもよい。選択的に、基板上にキャビティを形成する前に、加熱加圧の条件下で、基板の表面に一層のドライフィルムを接着し、次にドライフィルムに対して図形化を行い、さらにドライフィルムに対して露光現像を行って第１誘電層４０１をエッチングすることによって、基板上に内へ凹む第１キャビディ４０２と第２キャビティ４１２を形成し、保留されるドライフィルム部分は、第１接着構造４０８と第２接着構造４１３を形成する。選択的に、図案化される接着層をシルクスクリーンすることによって、第１接着構造４０８と第２接着構造４１３を形成する。接着層の材料は、一般的にはエボキシ樹脂を採用する。シルクスクリーンの方法によって、基板の表面に図案化される接着層を直接形成することができ、図案化を実現するためにフォトマスク、露光と現像などのステップを必要としない。

【0056】

選択的に、基板上に第１再配線層４０６と第２再配線層４１４が形成されるとき、基板上にキャビティを形成する前に、加熱加圧の条件下で、第１再配線層４０６と第２再配線層４１４の表面に一層のドライフィルムを接着し、次にドライフィルムに対して図形化を行い、さらにドライフィルム、第１誘電層４０１をエッチングすることによって、基板上に内へ凹む第１キャビディ４０２と第２キャビティ４１２を形成し、保留されるドライフィルム部分は、第１接着構造４０８と第２接着構造４１３を形成する。

【0057】

選択的に、第１キャビディ４０２と第２キャビティ４１２の深さが比較的に小さいとき、第１接着構造４０８内に第１キャビディ４０２を形成してもよく、第２接着構造４１３内に第２キャビティ４１２を形成してもよい。

【0058】

Ｓ３：図５に示すように、表面に第１入力電極、第１出力電極が設けられるＳＡＷ共振片と、表面に第２入力電極、第２出力電極が設けられる、第３キャビティを含むＢＡＷ共振構造を提供する。

【0059】

図５に示すように、ＳＡＷ共振片は、圧電性基材３０１と、圧電性基材３０１上に設けられる一対の櫛形電極３０２を含み、第１入力電極と第１出力電極（図示せず）は、それぞれ一対の櫛形電極３０２に電気的に接続され、選択的に、第１入力電極と第１出力電極は、いずれも溶接パッドを含む。一対の櫛形電極３０２は、それぞれ放出トランスデューサと受信トランスデューサとして用いられ、放出トランスデューサは、電気信号を表面弾性波に変換し、圧電性基材３０１の表面上に伝播し、一定の遅延を経た後に、受信トランスデューサは、音波信号を電気信号に変換して出力する。フィルタプロセスは、電気から音波へ、音波から電気への変換の中に実現される。

【0060】

依然として図５に示すように、ＢＡＷ共振構造は、第１支持基材３０８と、第２支持基材３０９と、第１支持基材３０８と第２支持基材３０９との間に設けられる第１電極３０３と第２電極３０４と、第１電極３０３と第２電極３０４との間に設けられる圧電層３０５とを含み、第１支持基材３０８の外側面に第２入力電極と第２出力電極（図示せず）が設けられ、第２入力電極と第２出力電極は、それぞれ第１電極３０３と第２電極３０４に電気的に接続される。なお、ＢＡＷフィルタの正常な動作を保証するために、第２支持基材３０９の外側面にシリコンチップ３０６が設けられ、シリコンチップ３０６上に第３キャビティ３０７が設けられる。集積した後に、第３キャビティ３０７は、当技術分野で一般的に言及される下部キャビティとして使用され、第２キャビティ４１２は、当技術分野で一般的に言及される上部キャビティとして使用される。

【0061】

第１電極３０３と第２電極３０４の材料は、Ｍｏ、Ａｌ等であってもよく、その厚さは、一般的には１００ｎｍ～２００ｎｍである。圧電層３０５の材料は、一般的にはＰＺＴ（チタン酸ジルコン酸鉛圧電セラミックス）、ＺｎＯ又はＡｌＮであり、その厚さは、一般的には１～２μｍである。第１支持基材３０８と第２支持基材３０９は、一般的にはＳｉ３Ｎ４、ＡｌＮ材料を採用し、その機械的強度が高く、化学的性能が安定的で、音速が比較的に高く、中心周波数への影響が小さい。第１支持基材３０８と第２支持基材３０９の厚さは、一般的には１００ｎｍ～２００ｎｍである。

【0062】

Ｓ４：ＳＡＷ共振片の表面を基板に向け、ＳＡＷ共振片を基板にボンディングし且つ第１キャビディを封止し、またＢＡＷ共振構造の表面を基板に向け、ＢＡＷ共振構造を基板にボンディングさせ且つ第２キャビティを封止する。

【0063】

図５に示すように、本実施例において、第１入力電極と第１出力電極は、圧電性基材３０１の第１表面に位置し、ボンディングするとき、第１表面を第１キャビディ４０２に向け、ＳＡＷ共振片を基板にボンディングさせ且つ第１キャビディ４０２を封止する。同様に、第２入力電極と第２出力電極は、第１支持基材３０８の外側面に位置し、ボンディングするとき、該外側面を第２キャビティ４１２に向け、ＢＡＷ共振構造を基板にボンディングさせ且つ第２キャビティ４１２を封止する。

【0064】

選択的に、基板の表面、第１キャビディ４０２と第２キャビティ４１２の周囲に第１接着構造４０８と第２接着構造４１３がそれぞれ形成される。第１接着構造４０８によってＳＡＷ共振片の圧電性基材３０１を基板に接着することにより、ＳＡＷ共振片を基板にボンディングし且つ第１キャビディ４０２を封止するとともに、第２接着構造４１３によってＢＡＷ共振構造の第１支持基材３０８を基板に接着することにより、ＢＡＷ共振構造を基板にボンディングさせ且つ第２キャビティ４１２を封止する。第１接着構造４０８と第２接着構造４１３によって圧電性基材３０１と第１支持基材３０８を基板にそれぞれ堅牢に固定することができる。

【0065】

Ｓ５：制御回路を第１入力電極、第１出力電極、第２入力電極、第２出力電極に電気的に接続させる。

【0066】

ステップＳ１では言及されたように、制御回路は、デバイス構造及びデバイス構造に電気的に接続される第１相互接続構造層を含んでもよく、第１相互接続構造層が第１誘電層４０１に位置する。それに応じて、制御回路を第１入力電極、第１出力電極、第２入力電極、第２出力電極に電気的に接続させることは、ＳＡＷ共振片をボンディングした後に、第１相互接続構造層を第１入力電極、第２出力電極に電気的に接続させること、及びＢＡＷ共振構造をボンディングした後に、第１相互接続構造層を第２入力電極、第２出力電極に電気的に接続させることを含む。

【0067】

依然として図５に示すように、選択的に、基板上に第１再配線層４０６、第１溶接パッド４０７、第２再配線層４１４及び第２溶接パッド４１５が形成される。それに応じて、制御回路を第１入力電極、第１出力電極に電気的に接続させることは、

【0068】

ＳＡＷ共振片をボンディングする前に、第１相互接続構造層上に第１再配線層４０６及び第１溶接パッド４０７を形成するステップと、

【0069】

ＳＡＷ共振片をボンディングした後に、第１溶接パッド４０７を第１入力電極、第１出力電極に電気的に接続させ、第１入力電極、第１出力電極を第１溶接パッド４０７、第１再配線層４０６によって制御回路に電気的に接続させるステップと、を含む。

【0070】

制御回路を第２入力電極、第２出力電極に電気的に接続させることは、
ＢＡＷ共振構造をボンディングする前に、第１相互接続構造層上に第２再配線層４１４及び第２溶接パッド４１５を形成するステップと、
ＢＡＷ共振構造をボンディングした後に、第２溶接パッド４１５を第２入力電極、第２出力電極に電気的に接続させ、第２入力電極、第２出力電極を第２溶接パッド４１５、第２再配線層４１４によって制御回路に電気的に接続させるステップと、を含む。

【0071】

以上のステップＳ１～Ｓ５によって制御回路と弾性波フィルタの集積を実現した。本実施例において、該集積方法は、以下のステップＳ６～Ｓ８をさらに含んでもよい：

【0072】

Ｓ６：図６に示すように、基板、ＳＡＷ共振片及びＢＡＷ共振構造を覆うパッケージング層４０３を形成する。モールディング（ｍｏｌｄｉｎｇ）方法によってパッケージング層４０３を形成してもよく、モールディングに採用される材料は、エボキシ樹脂であってもよい。

【0073】

Ｓ７：図７に示すように、シリコンベース１０１を除去し、集積構造を薄型化する。
本実施例において、化学機械研磨（ＣＭＰ）によってシリコンベース１０１を除去してもよい。

【0074】

Ｓ８：依然として図７に示すように、パッケージング層４０３上に第４再配線層を形成し、第１入力電極、第２入力電極、第１出力電極、第２出力電極、制御回路に電気的に接続させる。

【0075】

具体的には、パッケージング層４０３を貫通する第２ビアホールを形成し、第２ビアホール内に電気的に接続される材料を填充し、第２導電ポスト４１０を形成し、次にパッケージング層４０３上に第４再配線層４０９を形成し、第４再配線層４０９が第２導電ポスト４１０に電気的に接続される。第４再配線層４０９は、Ｉ／Ｏ溶接パッド４１１をさらに含む。同様に、エッチングによって第２ビアホールを形成し、堆積（例えばスパッタリング）によって第２ビアホール内に電気的に接続される材料（例えば銅）を充填し、第２導電ポスト４１０を形成してもよい。Ｉ／Ｏ溶接パッド４１１は、外部電源に接続されてもよい。

【0076】

本実施例によって取得される集積構造は、図７に示すとおりである。

【0077】

本発明の第２実施例による制御回路と弾性波フィルタの集積方法は、前述ステップＳ１～Ｓ７も含み、それと第１実施例との差別は、ステップＳ８である。図８～図１０に示すように、本発明の第２実施例による集積方法は、ステップＳ７の後に以下のステップを実行することを含む：

【0078】

基板の背面上に第３再配線層５０３を形成し、第１入力電極、第２入力電極、第１出力電極、第２出力電極、制御回路に電気的に接続させる。

【0079】

具体的には、図８と図９に示すように、図８に示された、パッケージング層４０３が形成され且つシリコンベース１０１が除去された集積構造内に、絶縁層１０２、シリコントップ層１０３と第１誘電層４０１を貫通する第３ビアホールを形成し、第３ビアホール内に電気的に接続される材料を填充し、第３導電ポスト５０１を形成し、第３導電ポスト５０１が第１回線層４０５に電気的に接続され、絶縁層の表面に第２回線層５０２を形成し、第３導電ポスト５０１に電気的に接続させる。

【0080】

図１０に示すように、絶縁層１０２の表面に第２回線層５０２、第３導電ポスト５０１に順に電気的に接続される第３再配線層５０３を形成し、第３再配線層５０３は、Ｉ／Ｏ溶接パッド４１１をさらに含む。

【0081】

本発明の実施例は、制御回路と弾性波フィルタの集積構造をさらに提供し、基板であって、基板に制御回路が形成され、基板上に第１キャビディと第２キャビティが形成される基板と、ＳＡＷ共振片とＢＡＷ共振構造であって、ＳＡＷ共振片の表面に第１入力電極、第１出力電極が設けられ、ＳＡＷ共振片の表面が基板に向いて基板にボンディングされ且つ第１キャビディを封止し、ＢＡＷ共振構造の表面に第２入力電極、第２出力電極が設けられ、ＢＡＷ共振構造は、第３キャビティを含み、ＢＡＷ共振構造の表面が基板に向いて基板にボンディングされ且つ第２キャビティを封止するＳＡＷ共振片とＢＡＷ共振構造と、を含み、制御回路が第１入力電極、第１出力電極、第２入力電極及び第２出力電極に電気的に接続される。

【0082】

本発明の実施例による集積構造は、基板に形成される制御回路によって弾性波フィルタへの制御を実現することにより、従来の弾性波フィルタが個別デバイスとしてＰＣＢに集積されることによる電気的な接続プロセスが複雑で、挿入損耗が大きいなどという問題を回避でき、集積度が高く、プロセスコストを低減させることができる。

【0083】

図７に示すように、本発明の第１実施例による制御回路と弾性波フィルタの集積構造は、
基板であって、基板に制御回路が形成され、基板上に第１キャビディ４０２と第２キャビティ４１２が形成される基板と、
ＳＡＷ共振片とＢＡＷ共振構造であって、ＳＡＷ共振片の表面に第１入力電極、第１出力電極が設けられ、ＳＡＷ共振片の表面が基板に向いて基板にボンディングされ且つ第１キャビディ４０２を封止し、ＢＡＷ共振構造の表面に第２入力電極、第２出力電極が設けられ、ＢＡＷ共振構造は、第３キャビティ３０７を含み、ＢＡＷ共振構造の表面が基板に向いて基板にボンディングされ且つ第２キャビティ４１２を封止するＳＡＷ共振片とＢＡＷ共振構造と、を含み、
制御回路が第１入力電極、第１出力電極、第２入力電極、第２出力電極に電気的に接続される。

【0084】

本実施例において、基板は、ベースと、ベース上に形成される第１誘電層４０１とを含み、そのうち、ベースは、ＳＯＩベースであり、ＳＯＩベースは、絶縁層１０２と、絶縁層１０２上に位置するシリコントップ層１０３とを含む。

【0085】

制御回路は、デバイス構造及びデバイス構造に電気的に接続される第１相互接続構造層を含む。デバイス構造は、ＭＯＳスイッチを含み、ＭＯＳスイッチは、ＳＯＩベースに形成されるシリコントップ層１０３内のソース２０１とドレイン２０２、及びシリコントップ層１０３上に形成されるゲート誘電層２０４とゲート２０３を含む。

【0086】

第１相互接続構造層は、第１誘電層４０１に位置し、第１入力電極、第１出力電極、第２入力電極及び第２出力電極に電気的に接続され、具体的には、第１相互接続構造層は、デバイス構造に順に電気的に接続される第１導電ポスト４０４と第１回線層４０５を含む。第１キャビディ４０２と第２キャビティ４１２が第１誘電層４０１内に形成される。

【0087】

ＳＡＷ共振片は、圧電性基材３０１と、圧電性基材３０１上に設けられる一対の櫛形電極３０２と、それぞれ一対の櫛形電極に電気的に接続される第１入力電極と第１出力電極とを含み、選択的に、第１入力電極と第１出力電極は、いずれも溶接パッドを含む。

【0088】

ＢＡＷ共振構造は、第１支持基材３０８と、第２支持基材３０９と、第１支持基材３０８と第２支持基材３０９との間に設けられる第１電極３０３と第２電極３０４と、第１電極３０３と第２電極３０４との間に設けられる圧電層３０５とを含み、第１支持基材３０８の外側面に第２入力電極と第２入力電極（図示せず）が設けられ、第２入力電極と第２入力電極は、それぞれ第１電極３０３と第２電極３０４に電気的に接続される。なお、ＢＡＷフィルタの正常な動作を保証するために、第２支持基材３０９の外側面にシリコンチップ３０６が設けられ、シリコンチップ３０６上に第３キャビティ３０７が設けられる。選択的に、第２入力電極と第２出力電極は、いずれも溶接パッドを含む。

【0089】

本実施例において、集積構造は、基板上に形成される第１再配線層４０６及び第１溶接パッド４０７をさらに含み、第１溶接パッド４０７が第１入力電極、第１出力電極に電気的に接続され、第１入力電極、第１出力電極を第１溶接パッド４０７、第１再配線層４０６によって制御回路に電気的に接続させる。集積構造は、第２再配線層４１４及び第２溶接パッド４１５をさらに含み、第２溶接パッド４１５が第２入力電極、第２出力電極に電気的に接続され、第２入力電極、第２出力電極を第２溶接パッド４１５、第２再配線層４１４によって制御回路に電気的に接続させる。

【0090】

基板とＳＡＷ共振片は、第１接着構造４０８によってボンディングされ、第１接着構造４０８が第１再配線層４０６上、第１キャビディ４０２の周囲に設けられ、選択的に、第１接着構造４０８は、ドライフィルム又はシルクスクリーンによって形成される接着層、又は他のチップ接続フィルムである。

【0091】

基板とＢＡＷ共振構造は、第２接着構造４１３によってボンディングされ、第２接着構造４１３が第２再配線層４１４上、第２キャビティ４１２の周囲に設けられ、選択的に、第２接着構造４１３は、ドライフィルム又はシルクスクリーンによって形成される接着層、又は他のチップ接続フィルムである。

【0092】

選択的に、第１接着構造４０８及び第２接着構造４１３は、いずれもドライフィルムである。

【0093】

本実施例において、集積構造は、基板、ＳＡＷ共振片及びＢＡＷ共振構造を覆うパッケージング層４０３をさらに含む。

【0094】

本実施例において、集積構造は、第１入力電極、第２出力電極、第２入力電極、第２出力電極及び制御回路に電気的に接続するか第４再配線層４０９をさらに含む。具体的には、第４再配線層４０９がパッケージング層４０３を貫通する第２導電ポスト４１０に電気的に接続され、第４再配線層４０９は、Ｉ／Ｏ溶接パッド４１１をさらに含む。

【0095】

図１０に示すように、本発明の第２実施例による制御回路と弾性波フィルタの集積構造は、
基板であって、基板に制御回路が形成され、基板上に第１キャビディ４０２と第２キャビティ４１２が形成される基板と、
ＳＡＷ共振片とＢＡＷ共振構造であって、ＳＡＷ共振片の表面に第１入力電極、第１出力電極が設けられ、ＳＡＷ共振片の表面が基板に向いて基板にボンディングされ且つ第１キャビディ４０２を封止し、ＢＡＷ共振構造の表面に第２入力電極、第２出力電極が設けられ、ＢＡＷ共振構造は、第３キャビティ３０７を含み、ＢＡＷ共振構造の表面が基板に向いて基板にボンディングされ且つ第２キャビティ４１２を封止するＳＡＷ共振片とＢＡＷ共振構造と、を含み、
制御回路が第１入力電極、第１出力電極、第２入力電極、第２出力電極に電気的に接続される。

【0096】

本実施例において、基板は、ベースと、ベース上に形成される第１誘電層４０１とを含み、そのうち、ベースは、ＳＯＩベースであり、ＳＯＩベースは、絶縁層１０２と、絶縁層１０２上に位置するシリコントップ層１０３とを含む。

【0097】

制御回路は、デバイス構造及びデバイス構造に電気的に接続される第１相互接続構造層を含む。デバイス構造は、ＭＯＳスイッチを含み、ＭＯＳスイッチは、ＳＯＩベースに形成されるシリコントップ層１０３内のソース２０１とドレイン２０２、及びシリコントップ層１０３上に形成されるゲート誘電層２０４とゲート２０３を含む。

【0098】

第１相互接続構造層は、第１誘電層４０１に位置し、第１入力電極、第１出力電極、第２入力電極及び第２出力電極に電気的に接続され、具体的には、第１相互接続構造層は、デバイス構造に順に電気的に接続される第１導電ポスト４０４と第１回線層４０５を含む。第１キャビディ４０２と第２キャビティ４１２が第１誘電層４０１内に形成される。

【0099】

ＳＡＷ共振片は、圧電性基材３０１と、圧電性基材３０１上に設けられる一対の櫛形電極３０２と、それぞれ一対の櫛形電極に電気的に接続される第１入力電極と第１出力電極とを含み、選択的に、第１入力電極と第１出力電極は、いずれも溶接パッドを含む。ＢＡＷ共振構造は、第１支持基材３０８と、第２支持基材３０９と、第１支持基材３０８と第２支持基材３０９との間に設けられる第１電極３０３と第２電極３０４と、第１電極３０３と第２電極３０４との間に設けられる圧電層３０５とを含み、第１支持基材３０８の外側面に第２入力電極と第２入力電極（図示せず）が設けられ、第２入力電極と第２入力電極は、それぞれ第１電極３０３と第２電極３０４に電気的に接続される。なお、ＢＡＷフィルタの正常な動作を保証するために、第２支持基材３０９の外側面にシリコンチップ３０６が設けられ、シリコンチップ３０６上に第３キャビティ３０７が設けられる。選択的に、第２入力電極と第２出力電極は、いずれも溶接パッドを含む。

【0100】

本実施例において、集積構造は、基板上に形成される第１再配線層４０６及び第１溶接パッド４０７をさらに含み、第１溶接パッド４０７が第１入力電極、第１出力電極に電気的に接続され、第１入力電極、第１出力電極を第１溶接パッド４０７、第１再配線層４０６によって制御回路に電気的に接続させる。集積構造は、第２再配線層４１４及び第２溶接パッド４１５をさらに含み、第２溶接パッド４１５が第２入力電極、第２出力電極に電気的に接続され、第２入力電極、第２出力電極を第２溶接パッド４１５、第２再配線層４１４によって制御回路に電気的に接続させる。

【0101】

基板とＳＡＷ共振片は、環状の第１接着構造４０８によってボンディングされ、第１接着構造４０８が第１再配線層４０６上、第１キャビディ４０２の周囲に設けられ、選択的に、第１接着構造４０８は、ドライフィルム又はシルクスクリーンによって形成される接着層、又は他のチップ接続フィルムである。

【0102】

基板とＢＡＷ共振構造は、環状の第２接着構造４１３によってボンディングされ、第２接着構造４１３が第２再配線層４１４上、第２キャビティ４１２の周囲に設けられ、選択的に、第２接着構造４１３は、ドライフィルム又はシルクスクリーンによって形成される接着層、又は他のチップ接続フィルムである。

【0103】

選択的に、第１接着構造４０８及び第２接着構造４１３は、いずれもドライフィルムである。

【0104】

本実施例において、集積構造は、基板、ＳＡＷ共振片及びＢＡＷ共振構造を覆うパッケージング層４０３をさらに含む。

【0105】

本実施例において、集積構造は、基板の背面に形成される、第１入力電極、第１出力電極、第２入力電極、第２出力電極及び制御回路に電気的に接続するか第３再配線層５０３をさらに含む。具体的には、第３再配線層５０３が絶縁層１０２の表面に設けられ、基板を貫通する第３導電ポスト５０１及び絶縁層の表面に設けられる第２回線層５０２に電気的に接続され、第３導電ポスト５０１が第１相互接続構造層４０５に電気的に接続され、第３再配線層５０３は、Ｉ／Ｏ溶接パッド４１１をさらに含む。

【0106】

以上では、本発明の各実施例について記述したが、上記説明は例示的なものであり、網羅的なものではなく、且つ開示された実施例に限定されるものではない。説明された各実施例の範囲及び精神を逸脱することなく、当業者にとって、多くの修正及び変更は自明である。

【符号の説明】

【0107】

１０１－シリコンベース、１０２－絶縁層、１０３－シリコントップ層、２０１－ソース、２０２－ドレイン、２０３－ゲート、２０４－ゲート誘電層、３０１－圧電性基材、３０２－櫛形電極、３０３－第１電極、３０４－第２電極、３０５－圧電層、３０６－シリコンチップ、３０７－第３キャビティ、３０８－第１支持基材、３０９－第２支持基材、４０１－第１誘電層、４０２－第１キャビディ、４０３－パッケージング層、４０４－第１導電ポスト、４０５－第１回線層、４０６－第１再配線層、４０７－第１溶接パッド、４０８－第１接着構造、４０９－第４再配線層、４１０－第２導電ポスト、４１１－Ｉ／Ｏ溶接パッド、４１２－第２キャビティ、４１３－第２接着構造、４１４－第２再配線層、４１５－第２溶接パッド、５０１－第３導電ポスト、５０２－第２回線層、５０３－第３再配線層

【図1】

【図2】

【図3】

【図4】

【図5】

【図6】

【図7】

【図8】

【図9】

【図10】

【国際調査報告】