特表 2023-550848 画素回路及び表示装置

(19)【発行国】日本国特許庁(JP)

(12)【公報種別】公表特許公報(A)

(11)【公表番号】

(43)【公表日】2023-12-06

(54)【発明の名称】画素回路及び表示装置

(51)【国際特許分類】

   G09G 3/36 20060101AFI20231129BHJP

   G09G 3/20 20060101ALI20231129BHJP

   G02F 1/1368 20060101ALI20231129BHJP

【ＦＩ】

G09G3/36

G09G3/20 624B

G09G3/20 622D

G09G3/20 621M

G09G3/20 622C

G02F1/1368

【審査請求】有

【予備審査請求】未請求

(21)【出願番号】P 2021566502

(86)(22)【出願日】2021-11-04

(85)【翻訳文提出日】2021-12-13

(86)【国際出願番号】 CN2021128761

(87)【国際公開番号】W WO2023070720

(87)【国際公開日】2023-05-04

(31)【優先権主張番号】202111263202.1

(32)【優先日】2021-10-28

(33)【優先権主張国・地域又は機関】CN

(81)【指定国・地域】

(71)【出願人】

【識別番号】515203228

【氏名又は名称】ティーシーエル チャイナスター オプトエレクトロニクス テクノロジー カンパニー リミテッド

【氏名又は名称原語表記】ＴＣＬ Ｃｈｉｎａ Ｓｔａｒ Ｏｐｔｏｅｌｅｃｔｒｏｎｉｃｓ Ｔｅｃｈｎｏｌｏｇｙ Ｃｏ．，Ｌｔｄ．

【住所又は居所原語表記】Ｎｏ．９－２，Ｔａｎｇｍｉｎｇ Ｒｄ，Ｇｕａｎｇｍｉｎｇ Ｎｅｗ Ｄｉｓｔｒｉｃｔ，Ｓｈｅｎｚｈｅｎ，Ｇｕａｎｇｄｏｎｇ，Ｃｈｉｎａ ５１８１３２

(74)【代理人】

【識別番号】110002181

【氏名又は名称】弁理士法人ＩＰ－ＦＯＣＵＳ

(72)【発明者】

【氏名】嚴 允晟

(72)【発明者】

【氏名】劉 菁

(72)【発明者】

【氏名】張 ▲き▼

(72)【発明者】

【氏名】曲 凱莉

(72)【発明者】

【氏名】梁 楚尉

【テーマコード（参考）】

2H192

5C006

5C080

【Ｆターム（参考）】

2H192AA24

2H192BC26

2H192CB22

2H192CC22

2H192DA12

2H192JA13

5C006AA15

5C006AA22

5C006AC22

5C006AF42

5C006BB16

5C006BC02

5C006BC06

5C006FA23

5C006FA54

5C006FA55

5C080BB05

5C080CC03

5C080DD06

5C080EE28

5C080JJ03

5C080JJ04

5C080JJ05

(57)【要約】

複数の画素駆動モジュールを含む画素回路及び表示装置が開示される。前記画素駆動モジュールは、主スイッチ及び主画素電極を含む主画素制御群であって、前記主スイッチは、データ線のデータ信号を前記主画素電極に伝達するように本段走査線の走査信号によって制御されるように構成される主画素制御群と、次スイッチ及び次画素電極を含む次画素制御群であって、前記次スイッチは、前記データ線のデータ信号を前記次画素電極に伝達するように前記本段走査線の走査信号によって制御されるように構成される次画素制御群と、前記次画素電極の電位が低くなるように共有走査線の共有走査信号によって制御されるように構成される共有スイッチと、を含む。
【選択図】図１

【特許請求の範囲】

【請求項1】

複数の画素駆動モジュールを含む画素回路であって、
前記画素駆動モジュールは、
主スイッチ及び主画素電極を含む主画素制御群であって、前記主スイッチは、データ線のデータ信号を前記主画素電極に伝達するように本段走査線の走査信号によって制御されるように構成される主画素制御群と、
次スイッチ及び次画素電極を含む次画素制御群であって、前記次スイッチは、前記データ線のデータ信号を前記次画素電極に伝達するように前記本段走査線の走査信号によって制御されるように構成される次画素制御群と、
前記次画素電極の電位が低くなるように共有走査線の共有走査信号によって制御されるように構成される共有スイッチと、を含み、
前記本段走査線及び前記共有走査線は、互いに絶縁され、前記本段走査線の走査信号は、第１正レベルパルスを有するように構成され、前記共有走査線の共有走査信号は、前記第１正レベルパルスよりも遅い第２正レベルパルスを有するように構成され、前記第１正レベルパルスと前記第２正レベルパルスとの間に間隔時間を有する、
画素回路。

【請求項2】

前記主スイッチ、前記次スイッチ及び前記共有スイッチは、それぞれ、制御端、第１端及び第２端を含むトランジスタスイッチであり、前記主スイッチの制御端及び前記次スイッチの制御端は、前記本段走査線に電気的に接続され、前記共有スイッチの制御端は、前記共有走査線に電気的に接続される、
請求項１に記載の画素回路。

【請求項3】

前記共有スイッチは、第１端が前記次画素電極及び前記次スイッチの第２端に電気的に接続され、第２端が共通電極に電気的に接続される、
請求項２に記載の画素回路。

【請求項4】

前記主画素電極及び前記次画素電極は、それぞれ、液晶コンデンサ及び蓄積コンデンサを含み、前記次画素電極は、液晶コンデンサが前記次スイッチの第２端及び第１共通電極に電気的に接続され、蓄積コンデンサが前記次スイッチの第２端及び第２共通電極に電気的に接続され、前記共有スイッチの第２端は、前記第２共通電極に電気的に接続される、
請求項３に記載の画素回路。

【請求項5】

前記本段走査線及び前記共有走査線は、二つの金属材料層に設けられ、二つの前記金属材料層の間に絶縁層が設けられる、
請求項１に記載の画素回路。

【請求項6】

前記共有スイッチは、前記次画素電極の電位が低くなるように、オンにされるように構成される、
請求項１に記載の画素回路。

【請求項7】

前記画素駆動モジュールは、青色サブ画素、赤色サブ画素、又は青色及び赤色サブ画素用に構成される、
請求項１に記載の画素回路。

【請求項8】

複数の画素駆動モジュールを含む画素回路であって、
前記画素駆動モジュールは、
主スイッチ及び主画素電極を含む主画素制御群であって、前記主スイッチは、データ線のデータ信号を前記主画素電極に伝達するように本段走査線の走査信号によって制御されるように構成される主画素制御群と、
次スイッチ及び次画素電極を含む次画素制御群であって、前記次スイッチは、前記データ線のデータ信号を前記次画素電極に伝達するように前記本段走査線の走査信号によって制御されるように構成される次画素制御群と、
前記次画素電極の電位が低くなるように共有走査線の共有走査信号によって制御されるように構成される共有スイッチと、を含む、
画素回路。

【請求項9】

前記主スイッチ、前記次スイッチ及び前記共有スイッチは、それぞれ、制御端、第１端及び第２端を含むトランジスタスイッチであり、前記主スイッチの制御端及び前記次スイッチの制御端は、前記本段走査線に電気的に接続され、前記共有スイッチの制御端は、前記共有走査線に電気的に接続される、
請求項８に記載の画素回路。

【請求項10】

前記共有スイッチは、第１端が前記次画素電極及び前記次スイッチの第２端に電気的に接続され、第２端が共通電極に電気的に接続される、
請求項９に記載の画素回路。

【請求項11】

前記主画素電極及び前記次画素電極は、それぞれ、液晶コンデンサ及び蓄積コンデンサを含み、前記次画素電極は、液晶コンデンサが前記次スイッチの第２端及び第１共通電極に電気的に接続され、蓄積コンデンサが前記次スイッチの第２端及び第２共通電極に電気的に接続され、前記共有スイッチの第２端は、前記第２共通電極に電気的に接続される、
請求項１０に記載の画素回路。

【請求項12】

前記本段走査線及び前記共有走査線は、互いに絶縁される、
請求項８に記載の画素回路。

【請求項13】

前記本段走査線及び前記共有走査線は、二つの金属材料層に設けられ、二つの前記金属材料層の間に絶縁層が設けられる、
請求項８に記載の画素回路。

【請求項14】

前記共有スイッチは、前記次画素電極の電位が低くなるように、オンにされるように構成される、
請求項８に記載の画素回路。

【請求項15】

前記本段走査線の走査信号は、第１正レベルパルスを有するように構成され、前記共有走査線の共有走査信号は、前記第１正レベルパルスよりも遅い第２正レベルパルスを有するように構成され、前記第１正レベルパルスと前記第２正レベルパルスとの間に間隔時間を有する、
請求項８に記載の画素回路。

【請求項16】

前記画素駆動モジュールは、青色サブ画素、赤色サブ画素、又は青色及び赤色サブ画素用に構成される、
請求項８に記載の画素回路。

【請求項17】

請求項８に記載の画素回路を含む、
表示装置。

【発明の詳細な説明】

【技術分野】

【0001】

本発明は、表示技術分野に関し、具体的には、画素回路及び表示装置に関する。

【背景技術】

【0002】

液晶表示装置において、垂直配列型液晶表示装置の大視野角色ずれ現象を改善するために、例えば、各サブ画素ユニットを主画素電極と次画素電極とに分割するなど、画素ユニットの低色ずれ（ｌｏｗ ｃｏｌｏｒ ｓｈｉｆｔ，ＬＣＳ）設計を行うことができる。表示中において、まず主画素電極及び次画素電極に同じ電位を充電し、次に主画素電極と次画素電極の電位が異なるように次画素電極の電位を低くする。

【0003】

例えば、主画素電極のスイッチ、次画素電極のスイッチ及び共有信号スイッチは、同じ信号線によって制御され、ＬＣＳ曲線は、下降傾向となり、ＬＣＳ特徴パラメータが低い場合、視野角が悪くなり、ＬＣＳ特徴パラメータが高い場合、透過性が悪くなる。この状況を改善するために、例えば、共有信号スイッチの制御方式を変更するなど、他の技術が提案されているが、ＬＣＳ特性曲線は、調整可能な範囲が限られており、視野角及び透過率要求を同時に満たすことができず、依然として改善する必要がある。

【発明の概要】

【0004】

本発明によれば、従来技術の低色ずれ曲線の調整可能な範囲を改善するための画素回路及び表示装置が提供される。

【0005】

上記問題を解決するために、本発明の第１態様によれば、複数の画素駆動モジュールを含む画素回路であって、
前記画素駆動モジュールは、
主スイッチ及び主画素電極を含む主画素制御群であって、前記主スイッチは、データ線のデータ信号を前記主画素電極に伝達するように本段走査線の走査信号によって制御されるように構成される主画素制御群と、
次スイッチ及び次画素電極を含む次画素制御群であって、前記次スイッチは、前記データ線のデータ信号を前記次画素電極に伝達するように前記本段走査線の走査信号によって制御されるように構成される次画素制御群と、
前記次画素電極の電位が低くなるように共有走査線の共有走査信号によって制御されるように構成される共有スイッチと、を含み、
前記本段走査線及び前記共有走査線は、互いに絶縁され、前記本段走査線の走査信号は、第１正レベルパルスを有するように構成され、前記共有走査線の共有走査信号は、前記第１正レベルパルスよりも遅い第２正レベルパルスを有するように構成され、前記第１正レベルパルスと前記第２正レベルパルスとの間に間隔時間を有する画素回路が提供される。

【0006】

本発明の一実施例によれば、前記主スイッチ、前記次スイッチ及び前記共有スイッチは、それぞれ、制御端、第１端及び第２端を含むトランジスタスイッチであり、前記主スイッチの制御端及び前記次スイッチの制御端は、前記本段走査線に電気的に接続され、前記共有スイッチの制御端は、前記共有走査線に電気的に接続される。

【0007】

本発明の一実施例によれば、前記共有スイッチは、第１端が前記次画素電極及び前記次スイッチの第２端に電気的に接続され、第２端が共通電極に電気的に接続される。

【0008】

本発明の一実施例によれば、前記主画素電極及び前記次画素電極は、それぞれ、液晶コンデンサ及び蓄積コンデンサを含み、前記次画素電極は、液晶コンデンサが前記次スイッチの第２端及び第１共通電極に電気的に接続され、蓄積コンデンサが前記次スイッチの第２端及び第２共通電極に電気的に接続され、前記共有スイッチの第２端は、前記第２共通電極に電気的に接続される。

【0009】

本発明の一実施例によれば、前記本段走査線及び前記共有走査線は、二つの金属材料層に設けられ、二つの前記金属材料層の間に絶縁層が設けられる。

【0010】

本発明の一実施例によれば、前記共有スイッチは、前記次画素電極の電位が低くなるように、オンにされるように構成される。

【0011】

本発明の一実施例によれば、前記画素駆動モジュールは、青色サブ画素、赤色サブ画素、又は青色及び赤色サブ画素用に構成される。

【0012】

上記問題を解決するために、本発明の第２態様によれば、複数の画素駆動モジュールを含む画素回路であって、
前記画素駆動モジュールは、
主スイッチ及び主画素電極を含む主画素制御群であって、前記主スイッチは、データ線のデータ信号を前記主画素電極に伝達するように本段走査線の走査信号によって制御されるように構成される主画素制御群と、
次スイッチ及び次画素電極を含む次画素制御群であって、前記次スイッチは、前記データ線のデータ信号を前記次画素電極に伝達するように前記本段走査線の走査信号によって制御されるように構成される次画素制御群と、
前記次画素電極の電位が低くなるように共有走査線の共有走査信号によって制御されるように構成される共有スイッチと、を含む画素回路が提供される。

【0013】

本発明の一実施例によれば、前記主スイッチ、前記次スイッチ及び前記共有スイッチは、それぞれ、制御端、第１端及び第２端を含むトランジスタスイッチであり、前記主スイッチの制御端及び前記次スイッチの制御端は、前記本段走査線に電気的に接続され、前記共有スイッチの制御端は、前記共有走査線に電気的に接続される。

【0014】

本発明の一実施例によれば、前記共有スイッチは、第１端が前記次画素電極及び前記次スイッチの第２端に電気的に接続され、第２端が共通電極に電気的に接続される。

【0015】

本発明の一実施例によれば、前記主画素電極及び前記次画素電極は、それぞれ、液晶コンデンサ及び蓄積コンデンサを含み、前記次画素電極は、液晶コンデンサが前記次スイッチの第２端及び第１共通電極に電気的に接続され、蓄積コンデンサが前記次スイッチの第２端及び第２共通電極に電気的に接続され、前記共有スイッチは、第２端が前記第２共通電極に電気的に接続される。

【0016】

本発明の一実施例によれば、前記本段走査線及び前記共有走査線は、互いに絶縁される。

【0017】

本発明の一実施例によれば、前記本段走査線及び前記共有走査線は、二つの金属材料層に設けられ、二つの前記金属材料層の間に絶縁層が設けられる。

【0018】

本発明の一実施例によれば、前記共有スイッチは、前記次画素電極の電位が低くなるように、オンにされるように構成される。

【0019】

本発明の一実施例によれば、前記本段走査線の走査信号は、第１正レベルパルスを有するように構成され、前記共有走査線の共有走査信号は、前記第１正レベルパルスよりも遅い第２正レベルパルスを有するように構成され、前記第１正レベルパルスと前記第２正レベルパルスとの間に間隔時間を有する。

【0020】

本発明の一実施例によれば、前記画素駆動モジュールは、青色サブ画素、赤色サブ画素、又は青色及び赤色サブ画素用に構成される。

【0021】

上記問題を解決するために、本発明の第３態様によれば、上述したような画素回路を含む表示装置が提供される。

【発明の効果】

【0022】

本発明の画素回路及び表示装置によれば、前記主スイッチがデータ線のデータ信号を前記主画素電極に伝達するように本段走査線の走査信号によって制御されるように構成され、前記次スイッチが前記データ線のデータ信号を前記次画素電極に伝達するように前記本段走査線の走査信号によって制御されるように構成され、前記共有スイッチが前記次画素電極の電位が低くなるように共有走査線の共有走査信号によって制御されるように構成されることにより、前記主画素電極の電位と前記次画素電極の電位とが異なるようになり、ＬＣＳ曲線の調整可能な範囲を大幅に増加させ、液晶偏向角度の差別化が適切に制御されるように表示装置の低階調視野角及び高階調透過要求を同時に満たすことができ、視野角を改善し、液晶表示装置の大視野角色ずれ現象を改善することができる。

【図面の簡単な説明】

【0023】

本発明の実施例における技術的手段をより明確に説明するために、以下では、実施例の説明において使用する必要がある図面を簡単に説明する。明らかに、以下の説明における図面は、本発明のいくつかの実施例にすぎず、当業者にとって、創造的な労力を払わずにこれらの図面に基づいて他の図面を得ることができる。

【0024】

【図1】本発明の実施例に係る画素回路の回路を示す概略図である。

【図2】本発明の実施例に係る共有スイッチが主スイッチ及び次スイッチよりも１／４フレーム時間遅延してオンにされる画素輝度変化を示す概略図である。

【図3】本発明の実施例に係る走査信号と共有走査信号との間隔時間を示す概略図である。

【図4】本発明の実施例に係るＬＣＳ曲線を示す概略図である。

【発明を実施するための形態】

【0025】

以下、本発明の実施例における図面を参照しながら本発明の実施例における技術的手段について明確かつ完全に説明する。明らかに、説明される実施例は、本発明の一部の実施例にすぎず、すべての実施例ではない。本発明の実施例に基づいて、当業者は、創造的な労働を払わないことを前提に得られる他のすべての実施例は、いずれも本発明の保護範囲に属する。

【0026】

なお、本明細書の説明において、「中心」、「縦方向」、「横方向」、「長さ」、「幅」、「厚さ」、「上」、「下」、「前」、「後」、「左」、「右」、「垂直」、「水平」、「頂」、「底」、「内」、「外」、「時計回り」、「反時計回り」などの用語で示す方位又は位置関係は、図面に示す方位又は位置関係に基づくものであり、本発明の説明の便宜及び説明の簡略化のためであり、示される装置又は要素が特定の方位を有し、特定の方位で構成及び動作することを示し、又は暗示するものではないため、本発明を限定するものとして理解することができない。

【0027】

なお、本明細書の説明において、「第１」及び「第２」という用語は、説明のみを目的としており、相対的な重要性を示し若しくは暗示し、又は示される技術的特徴の数を暗黙的に示すものとして理解することができない。したがって、「第１」及び「第２」に限定される特徴は、一つ又はより多くの前記特徴を明示的又は暗黙的に含むことができる。本発明の説明において、「複数」とは、特に限定されない限り二つ又は二つ以上を意味する。

【0028】

本明細書では、本発明の異なる構造を実現するために多くの異なる実施形態又は例を提供する。本発明の開示内容を簡略化するために、以下、特定の実施例の構成要素及び設定について説明する。もちろん、それらは一例にすぎず、本発明を限定するものではない。また、本発明では、異なる例において符号及び／又は参照文字を繰り返すことができるが、このような繰り返しは、簡略化及び明確化の目的で、それ自体が議論される種々の実施形態及び／又は設定の間の関係を示すものではない。また、本明細書に提供される様々な特定のプロセス及び材料の例は、当業者であれば、他のプロセスの適用及び／又は他の材料の使用を認識することができる。

【0029】

液晶表示パネルにおいて、液晶表示装置（例えば垂直配列型など）の大視野角色ずれ現象を改善するために、画素ユニットの低色ずれ（ｌｏｗ ｃｏｌｏｒ ｓｈｉｆｔ，ＬＣＳ）設計を行うことができる。

【0030】

例えば、本発明の第１態様によれば、例えば、マルチドメイン（例えば、４ドメイン又は８ドメイン）アーキテクチャの液晶表示装置などの低色ずれ設計の液晶表示装置に適用可能な画素回路が提供されるが、これらに限定されない。

【0031】

図１に示すように、前記画素回路は、複数のサブ画素（例えば、赤、緑、青のサブ画素）を駆動するための複数の画素駆動モジュールＬを含む。例えば、前記画素駆動モジュールＬは、主画素制御群Ｍ及び次画素制御群Ｓを含む。例えば、前記主画素制御群Ｍ及び次画素制御群Ｓｗ含む画素駆動モジュールＬは、表示効果の最適化に有利となるように、青色サブ画素、赤色サブ画素、又は青色及び赤色サブ画素用に構成されてもよいが、これらに限定されない。

【0032】

図１に示すように、前記主画素制御群Ｍは、主スイッチＴ１及び主画素電極Ｐ１を含んでもよい。前記主スイッチＴ１は、データ線ＷＤのデータ信号Ｄを前記主画素電極Ｐ１に伝達するように本段走査線ＷＧ（ｎ）の走査信号Ｇ（ｎ）によって制御されるように構成されてもよく、ｎは、正の整数であり、多段走査アーキテクチャにおける特定の一段走査構成を示す。

【0033】

図１に示すように、前記次画素制御群Ｓは、次スイッチＴ２及び次画素電極Ｐ２を含んでもよい。前記次スイッチＴ２は、前記データ線ＷＤのデータ信号Ｄを前記次画素電極Ｐ２に伝達するように前記本段走査線ＷＧ（ｎ）の走査信号Ｇ（ｎ）によって制御されるように構成されてもよい。

【0034】

図１に示すように、前記画素駆動モジュールは、共有スイッチＴ３をさらに含んでもよい。前記共有スイッチＴ３は、前記次画素電極Ｐ２の電位が低くなるように、共有走査線ＷＳＧ（ｎ）の共有走査信号ＳＧ（ｎ）によって制御されるように構成されてもよい。

【0035】

以下、前記画素回路の実施例を例示するが、これらに限定されない。

【0036】

例えば、図１に示すように、前記主スイッチＴ１、次スイッチＴ２及び共有スイッチＴ３は、それぞれ、トランジスタスイッチである。前記トランジスタスイッチは、制御端、第１端及び第２端、例えば、薄膜トランジスタ（ＴＦＴ）のゲート、ドレイン及びソースを含むが、これらに限定されない。前記制御端は、前記第１端の信号が前記第２端に伝達されるように電気信号により前記第１端と前記第２端との間のオン状態を制御することができる。

【0037】

図１に示すように、前記主スイッチＴ１は、制御端が前記走査線ＷＧ（ｎ）に電気的に接続され、第１端が前記データ線ＷＤに電気的に接続され、第２端が前記主画素電極Ｐ１に電気的に接続される。例えば、前記主画素電極Ｐ１は、液晶コンデンサＣ１１及び蓄積コンデンサＣ１２を含む。前記液晶コンデンサＣ１１は、前記主スイッチＴ１の第２端と第１共通電極Ｃｃｏｍとの間に電気的に接続され、前記蓄積コンデンサＣ１２は、前記主スイッチＴ１の第２端と第２共通電極Ａｃｏｍとの間に電気的に接続される。

【0038】

図１に示すように、前記次スイッチＴ２は、制御端が前記走査線ＷＧ（ｎ）に電気的に接続され、第１端が前記データ線ＷＤに電気的に接続され、第２端が前記次画素電極Ｐ２に電気的に接続される。例えば、前記次画素電極Ｐ２は、液晶コンデンサＣ２１及び蓄積コンデンサＣ２２を含む。前記液晶コンデンサＣ２１は、前記次スイッチＴ２の第２端と前記第１共通電極Ｃｃｏｍとの間に電気的に接続され、前記蓄積コンデンサＣ２２は、前記次スイッチＴ２の第２端と前記第２共通電極Ａｃｏｍとの間に電気的に接続される。

【0039】

図１に示すように、前記共有スイッチＴ３は、制御端が前記共有走査線ＷＳＧ（ｎ）に電気的に接続され、第１端が前記次画素電極Ｐ２（例えば、前記液晶コンデンサＣ２１及び前記蓄積コンデンサＣ２２）及び前記次スイッチＴ２の第２端に電気的に接続され、第２端が前記第２共通電極Ａｃｏｍに電気的に接続される。

【0040】

図１に示すように、表示中において、前記本段走査線ＷＧ（ｎ）の走査信号Ｇ（ｎ）により、前記主スイッチＴ１及び前記次スイッチＴ２がオン（ＯＮ）にされるように制御されると同時に、前記共有走査線ＷＳＧ（ｎ）の共有走査信号ＳＧ（ｎ）により、前記共有スイッチＴ３がオフ（ＯＦＦ）にされるように制御されることで、前記データ線ＷＤのデータ信号Ｄを前記主画素電極Ｐ１及び前記次画素電極Ｐ２に伝達することができるため、前記主画素電極Ｐ１（例えば、前記液晶コンデンサＣ１１及び前記蓄積コンデンサＣ１２）及び前記次画素電極Ｐ２（例えば、前記液晶コンデンサＣ２１及び前記蓄積コンデンサＣ２２）は、同じ電位（例えば高電位）に充電され、次に、前記本段走査線ＷＧ（ｎ）の走査信号Ｇ（ｎ）により、前記主スイッチＴ１及び前記次スイッチＴ２がオフにされるように制御されると同時に、前記共有走査線ＷＳＧ（ｎ）の共有走査信号ＳＧ（ｎ）により、前記共有スイッチＴ３がオンにされるように制御されることで、前記主画素電極Ｐ１と前記次画素電極Ｐ２の電位が異なるようになり、例えば、前記次画素電極Ｐ２は、前記共有スイッチＴ３を介して前記第２共通電極Ａｃｏｍに放電されるため、前記次画素電極Ｐ２の電位が前記主画素電極Ｐ１の電位よりも低くなる。

【0041】

任意選択的に、一実施例において、図１に示すように、前記主スイッチＴ１、前記次スイッチＴ２及び前記共有スイッチＴ３は、それぞれ、制御端、第１端及び第２端を含むトランジスタスイッチである。前記主スイッチＴ１の制御端及び前記次スイッチＴ２の制御端は、前記走査線ＷＧ（ｎ）に電気的に接続され、前記共有スイッチＴ３の制御端は、前記共有走査線ＷＳＧ（ｎ）に電気的に接続される。これにより、前記共有スイッチの制御端は、前記主画素電極と前記次画素電極との輝度比が制御されるように前記主スイッチの制御端及び前記次スイッチの制御端とは独立して制御することができる。

【0042】

任意選択的に、一実施例において、図１に示すように、前記共有スイッチＴ３は、第１端が前記次画素電極Ｐ２及び前記次スイッチＴ２の第２端に電気的に接続され、第２端が共通電極に電気的に接続される。これにより、前記次画素電極は、前記共有スイッチを介して放電されるため、前記次画素電極の電位が前記主画素電極の電位よりも低くなり、視野角の改善に有利となる。

【0043】

任意選択的に、一実施例において、図１に示すように、前記主画素電極Ｐ１及び次画素電極Ｐ２は、それぞれ液晶コンデンサ（例えば、Ｃ１１、Ｃ２１）及び蓄積コンデンサ（例えば、Ｃ１２、Ｃ２２）を含む。前記次画素電極Ｐ２は、液晶コンデンサＣ２１が前記次スイッチＴ２の第２端及び第１共通電極Ｃｃｏｍに電気的に接続され、蓄積コンデンサＣ２２が前記次スイッチＴ２の第２端及び第２共通電極Ａｃｏｍに電気的に接続され、前記共有スイッチＴ３の第２端は、前記第２共通電極Ａｃｏｍに電気的に接続される。これにより、前記次画素電極は、前記共有スイッチを介して前記第２共通電極に放電されるため、前記主画素電極の電位と前記次画素電極の電位とが異なるようになり、液晶の偏向角度の差別化が適切に制御される。

【0044】

任意選択的に、一実施例において、図１に示すように、前記共有スイッチＴ３は、前記次画素電極Ｐ２の電位が低くなるように、オンにされるように構成される。これにより、前記次画素電極の電位が前記主画素電極の電位よりも低くなるため、前記主画素電極の電位と前記次画素電極の電位とが異なるようになり、液晶表示装置の大視野角色ずれ現象を改善することができる。

【0045】

任意選択的に、一実施例において、図１に示すように、前記本段走査線ＷＧ（ｎ）及び前記共有走査線ＷＳＧ（ｎ）は、互いに絶縁される。例えば、前記本段走査線ＷＧ（ｎ）及び前記共有走査線ＷＳＧ（ｎ）は、二つの金属材料層に設けられ、二つの前記金属材料層の間には、制御信号が互いに干渉しないように絶縁層が設けられる。これにより、前記本段走査線の走査信号及び前記共有走査線の共有走査信号は、互いに独立することができ、前記共有走査信号は、前記走査信号間で時間分割により時間長を調整することができ、前記次画素電極及び前記主画素電極の電位及び輝度比の柔軟な調整に有利となる。

【0046】

なお、前記次画素電極の電位が高電位及び低電位にある時間長は、低色ずれ（ＬＣＳ）特徴パラメータ（例えば、次画素電極の輝度と主画素電極の輝度との比）が柔軟に調整できるように調整可能（時間分割）である。

【0047】

例えば、前記共有スイッチが前記主スイッチ及び前記次スイッチよりも１／４フレーム（ｆｒａｍｅ）時間遅延してオンにされる画素輝度を例として、図２は、共有スイッチが主スイッチ及び次スイッチよりも１／４フレーム時間遅延してオンにされる画素輝度変化を示す概略図である。ここで、縦軸に示される画素輝度又は電圧は、正の相関をなし、横軸に示されるのは、時間である。図２において、二フレームの時間長を例として、ここで、Ｕ１は、前記主スイッチがオンにされることにより、前記主画素電極がハイレベル（例えば、１４ボルト）を維持するときに高階調主画素電極の輝度ラインが生成されることを示し、Ｕ２は、前記次スイッチがオン及びオフにされることにより、前記次画素電極がハイレベルパルスを備えるときに高階調次画素電極の輝度ラインが生成されることを示し、Ｕ３は、前記主スイッチがオンにされることにより、前記主画素電極がローレベル（例えば、０．２ボルト）を維持するときに低階調主画素電極の輝度ラインが生成されることを示し、Ｕ４は、前記次スイッチがオン及びオフにされることにより、前記次画素電極の充放電中に低階調次画素電極の輝度ラインが生成されることを示し、Ｕ５は、前記共有スイッチが前記主スイッチ及び前記次スイッチよりも１／４フレーム時間遅延してオンにされる電圧ラインを示す。

【0048】

図２において、ラインＵ１に示すように、前記主画素電極は、高階調時に高輝度を維持し、ラインＵ３に示すように、前記主画素電極は、低階調時に低輝度を維持する。

【0049】

図２において、ラインＵ２及びラインＵ５に示すように、前記次スイッチがオンにされ（ラインＵ２に示すハイレベル）、かつ、前記共有スイッチがオフにされる（ラインＵ５に示すローレベル）とき、前記次画素電極は、高階調時に高輝度（ラインＵ２に示すように）を維持し、前記次スイッチがオフにされ（ラインＵ２に示すローレベル）、かつ、前記共有スイッチがオンにされる（ラインＵ５に示すハイレベル）とき、前記次画素電極は、輝度が前記主画素電極の輝度と異なるように、高階調時に低輝度（ラインＵ２に示すように）を維持する。

【0050】

なお、前記共有スイッチがオンにされた後、前記次画素電極の電圧が低下して明暗変化が生じるが、輝度変化周波数は、表示パネルのリフレッシュ周波数と一致し、決してフリッカ（ｆｌｉｃｋｅｒ）画面の輝度変化周波数が表示パネルのリフレッシュ周波数の２倍のようなものではないため、前記共有スイッチがオンにされた後の明暗変化は、顕著なフリッカを引き起こすことはない。

【0051】

図２において、ラインＵ４及びラインＵ５に示すように、前記共有スイッチがオンにされた後、別のフレーム（例えば、図２におけるフレーム２）において、前記次スイッチがオンにされ（ラインＵ２に示すハイレベル）、かつ、前記共有スイッチがオフにされる（ラインＵ５に示すローレベル）とき、低階調における液晶の反応が遅いため、前記次画素電極の低階調時の輝度が徐々に上昇し（ラインＵ４に示す）、前記次画素電極の輝度がまだ前記主画素電極の輝度に達していないときに、前記次スイッチがオフにされ、かつ、前記共有スイッチがオンにされる（ラインＵ５に示すハイレベル）ことにより、前記次画素電極が放電を開始し、前記次画素電極の低階調時の輝度が徐々に低下し（ラインＵ４に示す）、これにより、前記次画素電極の低階調時の輝度がより低くなるため、低階調のＬＣＳ特徴パラメータが高階調のＬＣＳ特徴パラメータよりも低くなり、ＬＣＳ特性曲線が上昇傾向となる。

【0052】

図２において、ラインＵ２、ラインＵ４及びラインＵ５に示すように、前記共有スイッチがオンにされた後、前記次画素電極の電圧が低下するため、前記次画素電極の輝度が低下する。ＬＣＳ特徴パラメータは、次画素電極の輝度と主画素電極の輝度との比であるため、前記共有スイッチがオンにされる時間を調整することにより、前記次画素電極の輝度を調整することができ、ひいてはＬＣＳ特徴パラメータを調整することができる。

【0053】

なお、図１に示すように、前記本段走査線ＷＧ（ｎ）及び前記共有走査線ＷＳＧ（ｎ）は、互いに絶縁され、前記本段走査線ＷＧ（ｎ）の走査信号Ｇ（ｎ）及び前記共有走査線ＷＳＧ（ｎ）の共有走査信号ＳＧ（ｎ）は、別々に配信されるため、前記共有スイッチＴ３のオン時間は、個別に制御することができる。

【0054】

例えば、図１及び図３に示すように、前記本段走査線ＷＧ（ｎ）の走査信号Ｇ（ｎ）のパルスがハイレベルからローレベルに遷移した後、一定の間隔時間ｔが経過し、前記共有走査線ＷＳＧ（ｎ）の共有走査信号ＳＧ（ｎ）のパルスがローレベルからハイレベルに遷移するため、前記次画素電極Ｐ２が高電位を維持するとき、前記間隔時間ｔが経過した後に前記次画素電極Ｐ２を電位が低下するように制御し、前記次画素電極Ｐ２の電位が前記主画素電極Ｐ１の電位よりも低くなるため、前記主画素電極Ｐ１の電位と前記次画素電極Ｐ２の電位とが異なるようになり、液晶の偏向角度の差別化が適切に制御されることにより、視野角を改善し、液晶表示装置の大視野角色ずれ現象を改善することができる。

【0055】

任意選択的に、一実施例において、図１及び図３に示すように、前記走査線ＷＧ（ｎ）の走査信号Ｇ（ｎ）は、第１正レベルパルスを有するように構成され、前記共有走査線ＷＳＧ（ｎ）の共有走査信号ＳＧ（ｎ）は、前記第１正レベルパルスよりも遅い第２正レベルパルスを有するように構成され、前記第１正レベルパルスと前記第２正レベルパルスとの間に間隔時間を有する。これにより、前記間隔時間を調整することにより、前記主画素電極と前記次画素電極との間の電位及び輝度割合を調節することができる。

【0056】

また、本発明の第２態様によれば、例えば、低色ずれアーキテクチャを備える液晶表示装置など、上述した画素回路を含む表示装置が提供され、その実施の詳細は、上述した実施例を参照することができるが、その説明を省略する。

【0057】

なお、本発明の上記実施例の画素回路及び表示装置によれば、前記共有スイッチのオン及びオフ時間を個別に制御することにより、サブ画素の表示過程に時間分割効果を有するようになる。図４に示すように、ＬＣＳ曲線Ｖが上昇傾向となる調整可能な範囲を大幅に増加させることができ、低階調範囲（範囲Ｅ１に示す）におけるＬＣＳ特徴パラメータが低いほど、視野角効果がよくなり、高階調範囲（範囲Ｅ２に示す）におけるＬＣＳ特徴パラメータが高いほど、透過効果がよくなり、表示装置の低階調視野角及び高階調透過要求を同時に満たすことができる。これにより、本発明の上記実施例に係る画素回路及び表示装置によれば、例えば、視野角及び透過率が制限される場合など、従来技術のＬＣＳ曲線が下降傾向となることや、調整可能な範囲が限られていることから生じる問題を改善することができる。

【0058】

本発明の上記実施例に係る画素回路及び表示装置によれば、前記主スイッチがデータ線のデータ信号を前記主画素電極に伝達するように本段走査線の走査信号によって制御されるように構成され、前記次スイッチが前記データ線のデータ信号を前記次画素電極に伝達するように前記本段走査線の走査信号によって制御されるように構成され、前記共有スイッチが前記次画素電極の電位が低くなるように共有走査線の共有走査信号によって制御されるように構成されることにより、前記主画素電極の電位と前記次画素電極の電位とが異なるようになり、ＬＣＳ曲線の調整可能な範囲を大幅に増加させ、液晶偏向角度の差別化が適切に制御されるように表示装置の低階調視野角及び高階調透過要求を同時に満たすことができ、視野角を改善し、液晶表示装置の大視野角色ずれ現象を改善することができる。

【0059】

以上、本発明の実施例について詳細に説明したが、本明細書では、具体例を適用して本発明の原理及び実施形態を説明した。以上の実施例の説明は、本発明の技術的手段及びそのコア思想の理解を助けるためだけであり、当業者は、依然として前記各実施例に記載された技術的手段を変更したり、その技術的特徴の一部を同等に置き換えたりすることができ、これらの修正又は置換は、本発明の各実施例の技術的手段の範囲から対応する技術的手段の本質を逸脱させるものではないことを理解すべきである。

【図1】

【図2】

【図3】

【図4】

【国際調査報告】