公報発行日 2016年12月21
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【図1】本発明の第1の送信装置の構成を示すブロック図である。
【図2】本発明の第1の受信装置の構成を示すブロック図である。
【図3】本発明の第1の受信装置における雑音分散算出部の処理を説明する図である。
【図4】本発明の第1の送信装置における第1の例の周波数・偏波間インターリーブ部の構成を示すブロック図である。
【図5】本発明の第1の送信装置における周波数・偏波間インターリーブの第1の例のセグメント間インターリーブ部の処理を説明する図である。
【図6】本発明の第1の送信装置における周波数・偏波間インターリーブの第1の例のデータローテーション部の処理を説明する図である。
【図7】本発明の第1の送信装置における周波数・偏波間インターリーブの第1の例のデータランダマイズ部の処理を説明する図である。
【図8】本発明に第1の送信装置との比較のために示す、マッピング前のビットデータに対してデータ分配を行う送信装置の構成を示す図である。
【図9】図1に示す送信装置1と、図8に示す送信装置1’のビット誤り率のシミュレーション結果を示す図である。
【図10】本発明の第1の送信装置における周波数・偏波間インターリーブの第2の例のセグメント間インターリーブ部の処理を説明する図である。
【図11】本発明の第1の送信装置における第3の例の周波数・偏波間インターリーブ部の構成を示すブロック図である。
【図12】本発明の第1の送信装置における周波数・偏波間インターリーブの第3の例のセグメント間インターリーブ部の処理を説明する図である。
【図13】本発明の第1の送信装置における周波数・偏波間インターリーブの第4の例のセグメント間インターリーブ部の処理を説明する図である。
【図14】本発明の第1の送信装置における第5の例の周波数・偏波間インターリーブ部の構成を示すブロック図である。
【図15】本発明の第1の送信装置のビット誤り率のシミュレーション結果を示す図である。
【図16】本発明の第2の送信装置の構成を示すブロック図である。
【図17】本発明の第2の受信装置の構成を示すブロック図である。
【図18】本発明の第2の送信装置における第1の例の周波数・偏波・チャンネル間インターリーブ部の構成を示すブロック図である。
【図19】本発明の第2の送信装置における第3の例の周波数・偏波・チャンネル間インターリーブ部の構成を示すブロック図である。
【図20】本発明の第2の送信装置における周波数・偏波・チャンネル間インターリーブの第3の例のセグメント間インターリーブ部の処理を説明する図である。
【図21】本発明の第2の送信装置における周波数・偏波・チャンネル間インターリーブの第4の例のセグメント間インターリーブ部の処理を説明する図である。
【図22】本発明の第2の送信装置における第5の例の周波数・偏波・チャンネル間インターリーブ部の構成を示すブロック図である。
【図23】受信レベル差に起因するビット誤り率特性の劣化を示す図である。
【図24】本発明による送信方法を示すフローチャートである。
【図25】本発明による受信方法を示すフローチャートである。
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