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■ 2011年 出願公開件数ランキング 第126位 355件
(2010年:第76位 585件)
■ 2011年 特許取得件数ランキング 第69位 462件
(2010年:第71位 397件)
(ランキング更新日:2025年5月29日)筆頭出願人である出願のみカウントしています
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公報番号 | 発明の名称 | 公報発行日 | 備考 |
---|---|---|---|
特許 4721195 | マルチノード分散データ処理システムにおいてリモート・アクセス可能なリソースを管理する方法 | 2011年 7月13日 | |
特許 4721194 | デバイスのネットワークにおける類似オブジェクトの自動検索方法、デバイス、およびシステム | 2011年 7月13日 | |
特許 4721191 | プロキシ証明書の生成によるグリッド相互認証 | 2011年 7月13日 | |
特許 4721174 | ネットワークの評価および認証のための方法および装置 | 2011年 7月13日 | |
特許 4717116 | 表示オブジェクトの形状を変更するための方法、プログラム、およびデータ処理システム | 2011年 7月 6日 | |
特許 4717079 | コンピュータ・システムにおける障害の診断および保守のための方法およびシステム(疑わしいコンポーネントの履歴ベースの優先順位付け) | 2011年 7月 6日 | |
特許 4716985 | 装置近接性に基づいて、コンピューティング装置におけるダイアログの表示を管理する方法、装置、及びプログラム | 2011年 7月 6日 | |
特許 4716729 | データに関するセキュリティを提供する方法、及びそのコンピュータ・プログラム | 2011年 7月 6日 | |
特許 4716709 | 構造化文書処理装置、構造化文書処理方法、及びプログラム | 2011年 7月 6日 | |
特許 4716869 | ダイナミック型半導体記憶装置 | 2011年 7月 6日 | |
特許 4716736 | ゲート制御ダイオードを使用するメモリ・セルおよびこれの使用方法、半導体構造 | 2011年 7月 6日 | |
特許 4717014 | 垂直型FIN−FETMOSデバイス | 2011年 7月 6日 | |
特許 4716870 | 減少されたコンタクト高さでのバイポーラ及びCMOSの集積回路構造体 | 2011年 7月 6日 | |
特許 4716867 | FETベースの磁気ランダム・アクセス・メモリ・デバイス用の自己整列型導電線およびこれを形成する方法 | 2011年 7月 6日 | |
特許 4716733 | 歪みシリコン・オン・インシュレータ(SSOI)を形成する方法 | 2011年 7月 6日 |
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4721195 4721194 4721191 4721174 4717116 4717079 4716985 4716729 4716709 4716869 4716736 4717014 4716870 4716867 4716733
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5月29日(木) - 東京 港区
5月29日(木) - 東京 品川区
5月29日(木) - 東京 新宿区
5月29日(木) -
5月29日(木) -
5月30日(金) -
5月30日(金) -
5月29日(木) - 東京 港区
6月4日(水) -
6月4日(水) -
6月4日(水) -
6月5日(木) -
6月6日(金) -
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