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■ 2011年 出願公開件数ランキング 第126位 355件
(2010年:第76位 585件)
■ 2011年 特許取得件数ランキング 第69位 462件
(2010年:第71位 397件)
(ランキング更新日:2025年2月28日)筆頭出願人である出願のみカウントしています
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公報番号 | 発明の名称 | 公報発行日 | 備考 |
---|---|---|---|
特許 4716870 | 減少されたコンタクト高さでのバイポーラ及びCMOSの集積回路構造体 | 2011年 7月 6日 | |
特許 4716867 | FETベースの磁気ランダム・アクセス・メモリ・デバイス用の自己整列型導電線およびこれを形成する方法 | 2011年 7月 6日 | |
特許 4716733 | 歪みシリコン・オン・インシュレータ(SSOI)を形成する方法 | 2011年 7月 6日 | |
特許 4716909 | ネットワーク接続テーブルを提供するための方法および装置 | 2011年 7月 6日 | |
特許 4709894 | 静電パターン情報を格納した文書を生成および認証するための方法およびシステム | 2011年 6月29日 | |
特許 4711269 | メモリ電力制御方法及びメモリ電力制御プログラム | 2011年 6月29日 | |
特許 4709933 | プログラムコード変換方法 | 2011年 6月29日 | |
特許 4711453 | 装置において更新ステータス警報を発生するための方法 | 2011年 6月29日 | |
特許 4711446 | FINFETと一体化した平坦基板デバイス及びその製造方法 | 2011年 6月29日 | |
特許 4711444 | 改善されたしきい電圧およびフラットバンド電圧の安定性を有する相補型金属酸化膜半導体(CMOS)構造を形成する方法(高k誘電体によるCMOSデバイス形成におけるしきい電圧制御を達成するためのバリア層の選択的実装) | 2011年 6月29日 | |
特許 4709850 | 電気的接続デバイス及びこれの製造方法 | 2011年 6月29日 | |
特許 4709847 | ネットワーク再構成による処理ユニットの並列フラッシング | 2011年 6月29日 | |
特許 4709840 | ネットワークのノード間でデータ・コンポーネントをコピーする方法およびシステム | 2011年 6月29日 | |
特許 4709506 | 電気的相互接続構造およびその形成方法 | 2011年 6月22日 | |
特許 4709475 | CMOSデバイスおよびその製造方法 | 2011年 6月22日 |
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4716870 4716867 4716733 4716909 4709894 4711269 4709933 4711453 4711446 4711444 4709850 4709847 4709840 4709506 4709475
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特許制度に詳しい方にこそ知って欲しい意匠権の使い方 ~コスパの高い意匠権を使って事業を守る方法を、特許権と比較して解説~
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