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■ 2026年 出願公開件数ランキング 第264位 27件
(
2025年:第361位 86件)
■ 2026年 特許取得件数ランキング 第174位 38件
(
2025年:第270位 106件)
(ランキング更新日:2026年3月18日)筆頭出願人である出願のみカウントしています
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| 公報番号 | 発明の名称(クリックすると公報を新しいウィンドウで開きます) | 公報発行日 | 備考 |
|---|---|---|---|
| 特許 7830480 | ビデオデータにおける静止フレーム検出 | 2026年 3月16日 | |
| 特許 7829321 | 可変レートシェーディングとスーパーサンプリングシェーディングの統合 | 2026年 3月13日 | |
| 特許 7829565 | 早期解放を伴うレジスタ圧縮 | 2026年 3月13日 | |
| 特許 7826192 | プロセッサでのハイパーバイザのセキュアイベント処理 | 2026年 3月 9日 | |
| 特許 7826225 | マージされた分岐ターゲットバッファエントリ | 2026年 3月 9日 | |
| 特許 7826472 | 動的共有キャッシュラインコピー保持ポリシー選択を有するコンピュータ処理装置 | 2026年 3月 9日 | |
| 特許 7826481 | プローブフィルタディレクトリ管理 | 2026年 3月 9日 | |
| 特許 7825715 | 並列処理ユニットにおけるサーフェスキャッシュ可能性の確率的最適化 | 2026年 3月 6日 | |
| 特許 7824962 | 2レベルビニングを使用する分散型レンダリングのためのシステム及び方法 | 2026年 3月 5日 | |
| 特許 7823049 | 汎用レジスタ階層システム及び方法 | 2026年 3月 3日 | |
| 特許 7821102 | シャドウラッチ構成のレジスタファイルを用いたビット幅再構成 | 2026年 2月26日 | |
| 特許 7818579 | 効率的なプロセッシングインメモリのためのハードウェア‐ソフトウェア協働アドレスマッピング方式 | 2026年 2月20日 | |
| 特許 7818583 | 複数のフェッチ及びデコードパイプラインを有するプロセッサ | 2026年 2月20日 | |
| 特許 7817278 | DRAMキャッシュタグプリフェッチャ用の方法及び装置 | 2026年 2月18日 | |
| 特許 7813777 | ネットワークオンチップトラフィックの段階的スロットリング | 2026年 2月13日 |
38 件中 1-15 件を表示
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7830480 7829321 7829565 7826192 7826225 7826472 7826481 7825715 7824962 7823049 7821102 7818579 7818583 7817278 7813777
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