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公報番号 | 発明の名称(クリックすると公報を新しいウィンドウで開きます) | 公報発行日 | 備考 |
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特許 7407167 | メモリの複数のランクを有するシステムのダイナミックランダムアクセスメモリリフレッシュの構成 | 2023年12月28日 | |
特許 7403457 | 構成可能コンピューティング基板についてのニアメモリのハード化された計算ブロック | 2023年12月22日 | |
特許 7403541 | メモリ順序付け違反チェックバッファの排出遅延を許容するための投機的命令ウェイクアップ | 2023年12月22日 | |
特許 7402897 | グラフィックスコンテキストバウンシング | 2023年12月21日 | |
特許 7399358 | ミッションモードVMIN予測及び較正 | 2023年12月15日 | |
特許 7397858 | フェッチグループのシーケンスのための分岐予測ユニットへのアクセスの制御 | 2023年12月13日 | |
特許 7397223 | データプロセッサのプログラム可能な電圧調整 | 2023年12月12日 | |
特許 7390304 | 大規模なキャッシュサイズに適合する領域ベースのディレクトリスキーム | 2023年12月 1日 | |
特許 7387873 | ネットワーク化された入出力メモリ管理ユニット | 2023年11月28日 | |
特許 7384806 | 連動メモリデバイスに対するメモリ要求のスケジューリング | 2023年11月21日 | |
特許 7385083 | システムオンチップ(SOC)のための強化された耐久性 | 2023年11月21日 | |
特許 7377869 | グラフィックスプロセッシングユニットでのパイプライン化された行列乗算 | 2023年11月10日 | |
特許 7377952 | 圧縮キャッシュに対するフレキシブルな辞書共有 | 2023年11月10日 | |
特許 7366122 | プロセッサのフィルタリングされた分岐予測構造 | 2023年10月20日 | |
特許 7364564 | 処理ユニットにおけるワークロードの正確な停止及び再開 | 2023年10月18日 |
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7407167 7403457 7403541 7402897 7399358 7397858 7397223 7390304 7387873 7384806 7385083 7377869 7377952 7366122 7364564
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