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■ 2014年 出願公開件数ランキング 第940位 30件
(2013年:第520位 74件)
■ 2014年 特許取得件数ランキング 第597位 57件
(2013年:第797位 39件)
(ランキング更新日:2025年4月15日)筆頭出願人である出願のみカウントしています
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公報番号 | 発明の名称 | 公報発行日 | 備考 |
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特許 5571693 | 歪誘起合金及び段階的なドーパントプロファイルを含むその場で形成されるドレイン及びソース領域 | 2014年 8月13日 | |
特許 5564564 | 計算ユニットの性能を性能感度に従い不均等に変化させる方法及び装置 | 2014年 7月30日 | |
特許 5562030 | I/Q不平衡補償 | 2014年 7月30日 | |
特許 5555698 | トレンチ分離を備えたフィン型半導体デバイスを形成する方法 | 2014年 7月23日 | |
特許 5543366 | ロックされたオペレーションを実行するためのシステムおよび方法 | 2014年 7月 9日 | |
特許 5544367 | トランジスタにおいて進歩したシリサイド形成と組み合わされる凹型のドレイン及びソース区域 | 2014年 7月 9日 | |
特許 5543675 | デバッグステートマシンおよび同マシンを含むプロセッサ | 2014年 7月 9日 | |
特許 5542120 | ピアツーピア専用プロセッサのアーキテクチャ及び方法 | 2014年 7月 9日 | |
特許 5537742 | 多ユーザ機密コードおよびデータを保護するためのアーキテクチャを含む方法および装置 | 2014年 7月 2日 | |
特許 5537546 | 凹状のドレイン及びソース区域並びに非共形的な金属シリサイド領域を有するMOSトランジスタを備えたCMOSデバイス | 2014年 7月 2日 | |
特許 5536760 | シェーダ列のための冗長方法及び装置 | 2014年 7月 2日 | |
特許 5525113 | 条件付きでプリチャージされる、コンテントアドレサブルメモリのマッチ線 | 2014年 6月18日 | |
特許 5520938 | メモリサブシステム内への書き込みレベライゼーションの実装のための方法及び装置 | 2014年 6月11日 | |
特許 5520286 | アンチエイリアシングのためのフィルタ処理方法及び装置 | 2014年 6月11日 | |
特許 5513744 | 動的自動減衰デバイスアーキテクチャ | 2014年 6月 4日 |
57 件中 16-30 件を表示
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5571693 5564564 5562030 5555698 5543366 5544367 5543675 5542120 5537742 5537546 5536760 5525113 5520938 5520286 5513744
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