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公報番号 | 発明の名称(クリックすると公報を新しいウィンドウで開きます) | 公報発行日 | 備考 |
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特許 6621943 | アクティブ・バイ・アクティブプログラマブルデバイス | 2019年12月18日 | |
特許 6612771 | 表皮効果を抑制し、パッケージの相互接続帯域幅を拡大する、断面の薄い金属配線 | 2019年11月27日 | |
特許 6602849 | プログラマブル遅延回路ブロック | 2019年11月 6日 | |
特許 6603304 | 種々のタイプの構成メモリを有するプログラマブル集積回路 | 2019年11月 6日 | |
特許 6598969 | 位相補間器ベースの送受信機システムにおけるクロックデータリカバリ(CDR)の位相ウォーク方式 | 2019年10月30日 | |
特許 6573834 | メモリを有する集積回路デバイスおよび集積回路デバイスにメモリを実装する方法 | 2019年 9月11日 | |
特許 6570625 | ICでのダイ内トランジスタ特性評価 | 2019年 9月 4日 | |
特許 6564375 | 高スループットのキーバリューストアの実現のためのメモリ構成 | 2019年 8月21日 | |
特許 6561195 | クロック回復回路 | 2019年 8月14日 | |
特許 6549219 | 集積回路のキャパシタ構造 | 2019年 7月24日 | |
特許 6530815 | ハイブリッドメモリシステムの動作を制御するための回路および方法 | 2019年 6月12日 | |
特許 6527588 | SERDESアプリケーション用に符号間干渉をフィルタリングするための回路および方法 | 2019年 6月 5日 | |
特許 6510546 | 公開鍵およびセッション鍵による認証 | 2019年 5月 8日 | |
特許 6501882 | 集積回路のための電力管理システム | 2019年 4月17日 | |
特許 6490688 | デュアルポートメモリセル | 2019年 3月27日 |
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6621943 6612771 6602849 6603304 6598969 6573834 6570625 6564375 6561195 6549219 6530815 6527588 6510546 6501882 6490688
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