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■ 2026年 出願公開件数ランキング 第608位 16件
(
2025年:第444位 67件)
■ 2026年 特許取得件数ランキング 第486位 19件
(
2025年:第427位 60件)
(ランキング更新日:2026年5月15日)筆頭出願人である出願のみカウントしています
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| 公報番号 | 発明の名称(クリックすると公報を新しいウィンドウで開きます) | 公報発行日 | 備考 |
|---|---|---|---|
| 特許 7860046 | 3次元メモリデバイス内の階段構造およびそれを形成するための方法 | 2026年 5月15日 | |
| 特許 7856854 | メモリデバイスおよびその読取り動作 | 2026年 5月11日 | |
| 特許 7853227 | メモリデバイスのデフラグメンテーションのためのシステムおよび方法 | 2026年 4月28日 | |
| 特許 7853498 | 3D NANDメモリの最良読み込み基準電圧探索 | 2026年 4月28日 | |
| 特許 7849370 | チップパッケージ構造、チップパッケージ構造の製造方法、および電子デバイス | 2026年 4月21日 | |
| 特許 7835803 | バックサイドソースコンタクトを備える3次元メモリデバイス | 2026年 3月25日 | |
| 特許 7835811 | 半導体デバイス用パッド構造 | 2026年 3月25日 | |
| 特許 7835880 | 集積パッケージデバイス、その製作方法、およびメモリシステム | 2026年 3月25日 | |
| 特許 7835881 | メモリコントローラ、データセット管理取り扱いのためのメモリシステム、方法、およびその記憶媒体 | 2026年 3月25日 | |
| 特許 7835882 | 3次元メモリ、方法、および、メモリシステム | 2026年 3月25日 | |
| 特許 7832357 | 周辺回路、メモリデバイスおよび抵抗オフセット較正のための方法 | 2026年 3月17日 | |
| 特許 7832373 | 高性能入力バッファおよびそれを有するメモリデバイス | 2026年 3月17日 | |
| 特許 7827728 | メモリシステムおよびその動作 | 2026年 3月10日 | |
| 特許 7824426 | メモリ、ストレージシステム、およびメモリを動作させるための方法 | 2026年 3月 4日 | |
| 特許 7824444 | 複数の部分を含み、プログラム妨害を低減するために使用されるメモリ、およびそのプログラム方法 | 2026年 3月 4日 |
19 件中 1-15 件を表示
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7860046 7856854 7853227 7853498 7849370 7835803 7835811 7835880 7835881 7835882 7832357 7832373 7827728 7824426 7824444
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