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■ 2024年 出願公開件数ランキング 第1332位 17件
(
2023年:第2149位 10件)
■ 2024年 特許取得件数ランキング 第1355位 15件
(
2023年:第2186位 8件)
(ランキング更新日:2025年10月31日)筆頭出願人である出願のみカウントしています
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| 公報番号 | 発明の名称(クリックすると公報を新しいウィンドウで開きます) | 公報発行日 | 備考 |
|---|---|---|---|
| 特許 7573567 | 階段状接点構成を備えた3次元回路構造 | 2024年10月25日 | |
| 特許 7559316 | メモリシステムの誤り訂正管理 | 2024年10月 2日 | |
| 特許 7527435 | 半導体デバイス内でのデータ転送の管理 | 2024年 8月 2日 | |
| 特許 7524511 | メモリ内データコンピューティングおよび分析 | 2024年 7月30日 | |
| 特許 7524369 | 3Dメモリデバイス及びシール構造を形成する方法 | 2024年 7月29日 | |
| 特許 7520096 | ページバッファのスイッチングデバイスを有するメモリデバイス及びその消去方法 | 2024年 7月22日 | |
| 特許 7512566 | メモリ構造体 | 2024年 7月 9日 | |
| 特許 7503678 | 半導体装置内における信号転送の管理 | 2024年 6月20日 | |
| 特許 7490111 | メモリデバイスおよびそのデータ近似検索方法 | 2024年 5月24日 | |
| 特許 7480391 | インメモリコンピューティングのための記憶装置 | 2024年 5月 9日 | |
| 特許 7479527 | メモリデバイスおよびそのプログラミング方法 | 2024年 5月 8日 | |
| 特許 7461520 | メモリデバイス | 2024年 4月 3日 | |
| 特許 7450672 | メモリデバイス、回路構造、及びその製造方法 | 2024年 3月15日 | |
| 特許 7433372 | 3Dメモリ構造およびその形成方法 | 2024年 2月19日 | |
| 特許 7432782 | メモリデバイス | 2024年 2月16日 |
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7573567 7559316 7527435 7524511 7524369 7520096 7512566 7503678 7490111 7480391 7479527 7461520 7450672 7433372 7432782
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10月31日(金) -
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11月4日(火) -
11月4日(火) - 大阪 大阪市
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11月5日(水) -
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11月6日(木) - 東京 港区
11月6日(木) - 大阪 大阪市
11月6日(木) - 大阪 大阪市
11月7日(金) -
11月7日(金) -
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