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■ 2024年 出願公開件数ランキング 第225位 157件
(2023年:第242位 151件)
■ 2024年 特許取得件数ランキング 第402位 73件
(2023年:第438位 67件)
(ランキング更新日:2025年9月1日)筆頭出願人である出願のみカウントしています
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公報番号 | 発明の名称(クリックすると公報を新しいウィンドウで開きます) | 公報発行日 | 備考 |
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特許 7498660 | ビデオストリームのロバスト性を高めるための調整可能な変調符号化スキーム | 2024年 6月12日 | |
特許 7498166 | プロセッサ命令パイプラインにおいてアドレス生成ハードウェアを選択的にバイパスするシステム及び方法 | 2024年 6月11日 | |
特許 7492515 | コンパクトな受動素子構成を有する回路基板 | 2024年 5月29日 | |
特許 7490766 | 演算論理回路レジスタの順序付け | 2024年 5月27日 | |
特許 7490791 | マルチテナントグラフィック処理ユニットの動的透過再構成 | 2024年 5月27日 | |
特許 7478229 | 統合キャッシュを有するアクティブブリッジチップレット | 2024年 5月 2日 | |
特許 7476207 | レジデンシマップ記述子 | 2024年 4月30日 | |
特許 7471305 | 積層された導体ライン及び空隙を有する半導体チップ | 2024年 4月19日 | |
特許 7469306 | 仮想ページを不連続なバッキング物理サブページに割り当てることを可能にする方法 | 2024年 4月16日 | |
特許 7465848 | 非同期パイプラインのステージの動作速度の制御 | 2024年 4月11日 | |
特許 7461895 | GPU主導の通信のためのネットワークパケットテンプレーティング | 2024年 4月 4日 | |
特許 7461945 | 部分行列の順序付けを伴う行列乗算器 | 2024年 4月 4日 | |
特許 7461947 | プロセッサにおける余裕認識(laxity-aware)型動的優先度変更 | 2024年 4月 4日 | |
特許 7461953 | 混合精度演算のプロセッシングユニット | 2024年 4月 4日 | |
特許 7453360 | キャッシュアクセス測定デスキュー | 2024年 3月19日 |
75 件中 46-60 件を表示
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7498660 7498166 7492515 7490766 7490791 7478229 7476207 7471305 7469306 7465848 7461895 7461945 7461947 7461953 7453360
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