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■ 2017年 出願公開件数ランキング 第588位 52件
(
2016年:第216位 189件)
■ 2017年 特許取得件数ランキング 第306位 94件
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2016年:第361位 82件)
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| 公報番号 | 発明の名称(クリックすると公報を新しいウィンドウで開きます) | 公報発行日 | 備考 |
|---|---|---|---|
| 特許 6086983 | メモリセルおよび磁気メモリセル構造のアレイの形成方法、ならびに関連するメモリセルおよびメモリセル構造 | 2017年 3月 1日 | |
| 特許 6085396 | マルチビット強誘電体メモリデバイス及びその形成方法 | 2017年 2月22日 | |
| 特許 6085287 | パターン形成方法 | 2017年 2月22日 | |
| 特許 6082752 | メモリ応答の順序付けのためのメモリ装置、コンピュータシステムおよび方法 | 2017年 2月15日 | |
| 特許 6080953 | 少なくとも2個のマスクを使用する階段形成 | 2017年 2月15日 | |
| 特許 6080975 | 垂直ソリッドステート変換器および埋め込み接点を有する高電圧ソリッドステート変換器ならびに関連システムおよび方法 | 2017年 2月15日 | |
| 特許 6082736 | アライメントされていないデータの結合 | 2017年 2月15日 | |
| 特許 6082753 | ステートマシンにおけるデータ解析用の方法およびシステム | 2017年 2月15日 | |
| 特許 6082803 | スケーラブルドライバを含む装置及び方法 | 2017年 2月15日 | |
| 特許 6082827 | 装置、検知回路、およびワード線電圧の上昇を補償する方法 | 2017年 2月15日 | |
| 特許 6072981 | 論理演算を、センス回路を使用して実行する装置及び方法 | 2017年 2月 1日 | |
| 特許 6072265 | 犠牲プラグを用いた基板貫通ビアの形成に係るデバイス、システム、および方法 | 2017年 2月 1日 | |
| 特許 6072252 | 隣接するデータ状態間の谷内のメモリセル状態 | 2017年 2月 1日 | |
| 特許 6072226 | 導波管およびエバネッセント場結合フォトニック検出器を提供する方法および装置 | 2017年 2月 1日 | |
| 特許 6072082 | 液晶を使用した、光ファイバのチップへのアクティブアライメント | 2017年 2月 1日 |
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6086983 6085396 6085287 6082752 6080953 6080975 6082736 6082753 6082803 6082827 6072981 6072265 6072252 6072226 6072082
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10月13日(火) - オンライン
AI Native知財 - 私たちはどう生きるか? - 楠浦崇央 氏(TechnoProducer株式会社 代表取締役/発明塾 塾長) x 弁理士木本大介(リーガルテック株式会社アドバイザー)
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企業の知財部員がすべき「知財実務手順の対応」 ~特許出願から明細書作成のノウハウ及び先行技術調査の基礎、特許権侵害の実務対応~
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〜発明が生まれる開発現場の知財力を強化する~一枚図解でわかる 新規性・進歩性 ──発明とは何なのかを理解して、その先のイノベーションへ!
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